Quantic X-Microwave

Analog Devices RF and microwave components are available as drop-in X-MWblocks®
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LT3094

新規設計に推奨

−20 V、500 mA、超低ノイズ、超高 PSRR、負電圧のリニア電圧レギュレータ

データシート (Rev. B)
製品セレクション・テーブル
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Viewing:

製品情報

  • 超低 RMS ノイズ: 0.8 μVRMS（10 Hz ～ 100 kHz）
  • 超低スポット・ノイズ: 10 kHz で 2.2 nV/√Hz
  • 超高 PSRR: 1 MHz で 74 dB
  • 出力電流: 500 mA
  • 広い入力電圧範囲: −1.8 V ～ −20 V
  • 単一コンデンサによるノイズと PSRR の改善
  • 100 μA セット・ピン電流: ±1 % の初期精度
  • 単一抵抗による出力電圧のプログラミング
  • プログラマブルな電流制限
  • 低ドロップアウト電圧: 235 mV
  • 出力電圧範囲: 0 V ～ −19.5 V
  • プログラマブルなパワー・グッドおよび高速なスタートアップ
  • バイポーラ高精度イネーブル／UVLO ピン
  • VIOC ピンでのアップストリーム・レギュレータの制御による消費電力の最小化と PSRR の最適化
  • 最小出力コンデンサ: 10 μF セラミック
  • 12 ピン MSOP および 3 mm × 3 mm DFN パッケージ

LT3094 は高性能低ドロップアウトで負電圧のリニア電圧レギュレータです。アナログ・デバイセズの超低ノイズおよび超高 PSRR アーキテクチャを備え、ノイズに敏感なアプリケーションへの電力供給を実現します。このデバイスは簡単に並行動作でき、ノイズを更に低減し、出力電流を高め、PCB 上の熱を放散させます。

LT3094 は 500 mA の電流を 235 mV（代表値）のドロップアウト電圧で供給します。動作時の静止電流は名目値で 2.35 mA であり、シャットダウン時には 3 μA まで低下します。デバイスの広い出力電圧範囲（0 V ～ −19.5 V）の誤差アンプは、ユニティ・ゲインで動作します。また、プログラミングされた出力電圧に関係なく、ほぼ一定の出力ノイズ、PSRR、帯域幅、および負荷レギュレーションを実現します。追加機能は、バイポーラ・イネーブル・ピン、プログラマブルな電流制限、高速スタートアップ機能、および出力電圧レギュレーションを示すプログラマブルなパワー・グッドです。このレギュレータには、上流の電源を制御するトラッキング機能が組み込まれています。これにより、LT3094 全体の電圧を一定に保ち、消費電力の最小化と PSRR の最適化を実現しています。

LT3094 は、最小 10 μF のセラミック出力コンデンサにより安定動作します。内蔵保護機能には、フォールドバックによる内部電流制限とヒステリシスによる熱制限が含まれています。LT3094 には、熱強化型 12 ピン MSOP パッケージと 3 mm × 3 mm DFN パッケージが用意されています。

アプリケーション

  • RF 電源および高精度電源
  • 超低ノイズ計測器
  • 高速／高精度データ・コンバータ
  • 医療用アプリケーション: 診断とイメージング
  • スイッチング電源用のポストレギュレータ
LT3094
−20 V、500 mA、超低ノイズ、超高 PSRR、負電圧のリニア電圧レギュレータ
LT3094 Application circuit LT3094 Performance Graph LT3094 Pin configuration LT3094 Pin configuration
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ツールおよびシミュレーション

LTspice 1

下記製品はLTspiceで使用することが出来ます。:

  • LT3094
LTspice

LTspice®は、無料で提供される強力で高速な回路シミュレータと回路図入力、波形ビューワに改善を加え、アナログ回路のシミュレーションを容易にするためのモデルを搭載しています。

 

評価用キット

eval board
schematic 1
schematic 2
DC2624A

LT3094 デモ用ボード | 超低ノイズ、超高 PSRR 負電圧 RF LDO、−20 V ≤ VIN ≤ −3.8 V、VOUT = −3.3 V@500 mA

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製品詳細

デモ回路 2624A は、超低ノイズ、超高電源電圧変動除去比（PSRR）の負電圧低ドロップアウト（LDO）レギュレータ LT3094 を備えています。DC2624A は、−3.8 V ～ −20 V の入力範囲で動作し、最大 500 mA の出力電流を供給できます。超低ノイズ（10 Hz ～ 100 kHz で 0.8 µVRMS）と非常に高い PSRR（1 MHz で 75 dB）が特徴です。

LT3094 のイネーブル機能（EN/UVLO ピン）には双方向性があり、正電圧または負電圧で制御できます。LT3094 では、ILIM から GND に抵抗を接続することにより、プログラマブルな電流制限機能も使用できます。ILIM ピン電圧を検出することにより、電流のモニタリングもできます。VIOC トラッキング機能を使用すると、上流のスイッチング・コンバータを制御して、レギュレータ全体の電圧を一定に保ち、消費電力を最小化できます。パワー・グッド・フィードバック（PGFB）ピンは、プログラマブルなパワー・グッド閾値を設定するために使用され、高速起動回路を作動させます。パワー・グッド機能を使用するには、外部電圧源を VEXT に​接続します。パワー・グッド機能および高速起動機能が不要な場合は、PGFB を IN に接続します。

内蔵保護機能には、バッテリ逆入れ保護、逆電流保護、フォールドバックによる内部電流制限、およびヒステリシスによる熱制限が含まれています。

LT3094 のデータシートには、部品、動作、および用途の詳細が記載されています。このデータシートは、デモ回路 DC2624A 用デモ・マニュアルと併せて参照してください。LT3094 は、IC の下側にパッドが露出した 12 ピン MSOP および 3 mm × 3 mm DFN パッケージに組み立てられています。最大の熱性能を得るため、ボードを適切にレイアウトすることは不可欠です。

eval board
schematic 3
schematic 4
schematic 5
SCP-LT3094-EVALZ

LT3094シグナル・チェーン評価用ボード | 500mA超低ノイズ負電圧LDO

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製品詳細

デモ回路SCP-LT3094-EVALZは、超低ノイズ、超高電源電圧変動除去比（PSRR）の負電圧低ドロップアウト（LDO）レギュレータLT3094を備えています。–3.8V～20Vの入力範囲で動作し、最大500mA の出力電流を供給できます。

シグナル・チェーン電源シリーズの他のすべてのボードと同様、このボードも他のSCPボードに簡単に接続可能で、シグナル・チェーン電源システム一式を構築できるよう設計されており、低消費電力シグナル・チェーンの迅速な評価を実現できます。このボードを評価するには、以下の汎用SCPハードウェアが必要になります。

  • SCP-INPUT-EVALZ
  • SCP-OUTPUT-EVALZ
  • SCP-1X5BKOUT-EVALZ
  • SCP-THRUBRD-EVALZ
  • SCP-FILTER-EVALZ
  • SCP-1X2BKOUT-EVALZ
  • SCP-5X1-EVALZ

 

SCPシリーズのデモ・ボードを正しく評価するには、SCPコンフィグレータ付属ソフトウェアが必要です。SCPコンフィグレータは、設計に適したボードとトポロジの選択に役立ちます。

デモ・マニュアルには、LT3094の動作や設定に関する重要な詳細情報は記載されていない点に注意してください。部品の詳細については、LT3094のデータシートを参照してください。

ADXBAND16EBZ

16Tx/16Rx Direct X-Band Sampled Phased-Array/RADAR/SATCOM Development Platform

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機能と利点

ADXBAND16EBZ Digitizing Card
  • Multi-Channel, Wideband System Development Platform Using Apollo (AD9084)
  • Mates With Xilinx VCU118 Evaluation Board (Not Included)
  • 16x RF Receive (Rx) Channels
    • Total 16x 8GSPS to 20GSPS ADC
    • Digital Down Converters (DDCs), Each Including Complex Numerically-Controlled Oscillators (NCOs)
    • Programmable Finite Impulse Response Filters (pFIRs)
    • Complex Finite Impulse Response Filters (CFIRs)
  • 16x RF Transmit (Tx) Channels
    • Total 16x 8GSPS to 28GSPS DAC
    • Digital Up Converters (DUCs), Each Including Complex Numerically-Controlled Oscillators (NCOs)
    • Programmable Finite Impulse Response Filters (pFIRs)
    • Complex Finite Impulse Response Filters (CFIRs)
  • Flexible Rx & Tx RF Front-Ends
    • Rx: Filtering, Amplification, Digital Step Attenuation for Gain Control
    • Tx: Filtering, Amplification
  • Flexible Clock Distribution
    • On-Board Clock Distribution from Single External 400MHz Reference
    • Support for External Converter Clock per AD9084 via solder rework
  • On-Board Power Regulation from Single 12V Power Adapter (Included)
16Tx / 16Rx Calibration Board
  • Mates to ADXBAND16EBZ Digitizing Card & VCU118 PMOD Interface (Cable Included)
  • Provides Both Individual Adjacent Channel Loopback and Combined Channel Loopback Options
  • Combined Tx Channels Out Option
  • Combined Rx Channels In Option
Software Features and Benefits

Easy Control Tools and Platform Interfaces to Simplify Software Framework Developments:

  • IIO Oscilloscope GUI
  • MATLAB Add-Ons & Example Scripts
  • Example HDL Builds including JESD204C Bring-Up
  • Embedded Software Solutions for Linux and Device Drivers
Software Reference Design Examples for ADEF Applications to Reduce Prototyping Time:
  • Multi-Chip Synchronization for Power-Up Phase Determinism
  • System-Level Amplitude/Phase Alignment Using NCOs
  • Low-Latency ADC-to-DAC Loopback Bypassing JESD Interface
  • pFIR Control for Broadband Channel-to-Channel Amplitude/Phase Alignment
  • Fast-Frequency Hopping

製品詳細

The ADXBAND16EBZ contains four AD9084 mixed‑signal front‑end devices, including the RF front end, clocking, and power circuitry. The ADXBAND16EBZ serves as a complete system solution targeting common applications such as phased‑array radars, wideband systems, and ground‑based SATCOM. Its primary target application is a 16‑Tx/16‑Rx direct X‑band sampling phased array.

The platform is intended as a testbed for demonstrating multi‑chip synchronization, as well as implementing system‑level calibrations, beamforming algorithms, and other signal‑processing techniques. The system is designed to interface with the VCU118 Evaluation Board from Xilinx®, which features the Virtex® UltraScale+™ XCVU9P FPGA, along with provided reference software, HDL code, and MATLAB system‑level interfaces.

A 16‑Tx/16‑Rx Calibration Board can be used to develop system‑level calibration algorithms, including demonstrations of power‑up phase determinism. The Calibration Board provides improvements in combined‑channel dynamic range, spurious performance, and phase noise, and can be controlled via a MATLAB add‑on when connected to the PMOD interface of the VCU118.
DC2624A
LT3094 デモ用ボード | 超低ノイズ、超高 PSRR 負電圧 RF LDO、−20 V ≤ VIN ≤ −3.8 V、VOUT = −3.3 V@500 mA
DC2624A_UG-1386 Application Circuit DC2624A_UG-1386 Application Circuit
SCP-LT3094-EVALZ
LT3094シグナル・チェーン評価用ボード | 500mA超低ノイズ負電圧LDO
LT3094 Signal Chain Evaluation Board LT3094 Signal Chain Evaluation Board - Top View LT3094 Signal Chain Evaluation Board - Bottom View
ADXBAND16EBZ
16Tx/16Rx Direct X-Band Sampled Phased-Array/RADAR/SATCOM Development Platform

リファレンス・デザイン

Figure 1. CN0577 Simplified Block Diagram
Figure 1. CN0577 Simplified Block Diagram
EVAL-CN0577-FMCZ
EVAL-CN0577-FMCZ - Top View
EVAL-CN0577-FMCZ - Bottom View
CN0577 Circuits from the Lab®

シリアルLVDS SAR ADC用のアナログ・フロント・エンドおよびデジタル・インターフェース

詳細なリファレンス・デザインを表示

機能と利点

  • 18ビット分解能、15MSPSデータ・アクイジション・システム
  • 任意の電圧入力をサポート
  • クロッキングと電源に必要な全ての機能がオンボード
  • FPGAインターフェース用FMCコネクタ
Figure 1. CN0585 Simplified Block Diagram
Figure 1. CN0585 Simplified Block Diagram
EVAL-CN0585-FMCZ Angle View
EVAL-CN0585-FMCZ Bottom View
EVAL-CN0585-FMCZ Top View
CN0585 Circuits from the Lab®

Quad Channel, Low Latency, Data Acquisition and Signal Generation Module

詳細なリファレンス・デザインを表示

機能と利点

  • 4 Analog Input Channels with Configurable Voltage Ranges
  • 4 Analog Output Channels with Configurable Voltage Ranges
  • 200 ns Latency between ADC Measurement and DAC Settling
  • Analog Front End Interface Connector
  • Modeling and Simulation Compatible with MATLAB and Python
  • FMC Connector Interface to FPGA

使用製品

資料

設計および組み込みツール

ビデオ

  • lazy blur
    VIDEO · 2023-04-03 03:08
    Personalized Low Latency Hardware in the Loop (HiL) Solution
  • lazy blur
    VIDEO · 2022-10-31 03:03
    Low Latency Test and Measurement Kit – Hardware in the Loop
CN0577
シリアルLVDS SAR ADC用のアナログ・フロント・エンドおよびデジタル・インターフェース
Figure 1. CN0577 Simplified Block Diagram
EVAL-CN0577-FMCZ
EVAL-CN0577-FMCZ - Top View
EVAL-CN0577-FMCZ - Bottom View
CN0585
Quad Channel, Low Latency, Data Acquisition and Signal Generation Module
Figure 1. CN0585 Simplified Block Diagram
EVAL-CN0585-FMCZ Angle View
EVAL-CN0585-FMCZ Bottom View
EVAL-CN0585-FMCZ Top View

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