AD9680

新規設計に推奨

A/Dコンバータ、14ビット、1.25GSPS/1GSPS/820MSPS/500MSPS、デュアル、JESD204B

データシート (Rev. E)
製品セレクション・テーブル
利用上の注意

本データシートの英語以外の言語への翻訳はユーザの便宜のために提供されるものであり、リビジョンが古い場合があります。最新の内容については、必ず最新の英語版をご参照ください。

なお、日本語版のデータシートは基本的に「Rev.0」（リビジョン0）で作成されています。そのため、英語版が後に改訂され、複数製品のデータシートがひとつに統一された場合、同じ「Rev.0」の日本語版のデータシートが異なる製品のデータシートとして表示されることがあります。たとえば、「ADM3307E」の場合、日本語データシートをクリックすると「ADM3311E」が表示されます。これは、英語版のデータシートが複数の製品で共有できるように1本化され、「ADM3307E/ADM3310E/ADM3311E/ADM3312E/ADM3315E」（Rev.J）と改訂されたからで、決して誤ってリンクが張られているわけではありません。和文化されたデータシートを少しでも有効に活用していただくためにこのような方法をとっておりますので、ご了解ください。

アナログ・デバイセズ社は、提供する情報が正確で信頼できるものであることを期していますが、その情報の利用に関して、あるいはその利用によって生じる第三者の特許やその他の権利の侵害に関して一切の責任を負いません。また、アナログ・デバイセズ社の特許または特許の権利の使用を明示的または暗示的に許諾するものでもありません。仕様は予告なしに変更する場合があります。本紙記載の商標および登録商標は、各社の所有に属します。
Viewing:

製品情報

  • 最大1.25GSPSのサンプルレートに対応するピン・コンパチブル・ファミリー
  • JESD204B（サブクラス1）にコード化されるシリアル・デジタル出力
  • 1GSPS（デフォルト設定）におけるチャンネル当たりのパワー：1.65W
  • SFDR＝85dBFS＠340MHz、80dBFS＠1GHz
  • SNR＝65.3dBFS＠340MHz、（AIN＝－1.0dBFS）、60.5dBFS＠1GHz（AIN＝－1.0dBFS）
  • ENOB＝10.8ビット＠10MHz
  • DNL誤差：±0.5LSB
  • INL誤差：±2.5LSB
  • ノイズ密度＝－154dBFS/Hz＠1GSPS
  • 動作電源電圧：1.25V、2.5Vまたは3.3V
  • ノーミッシング・コード保証
  • ADC用電圧リファレンスを内蔵
  • 柔軟な入力範囲
    • AD9680-1000/AD9680-820：1.46V p-p～1.94V p-p（公称1.70V p-p）
    • AD9680-500：1.46V p-p～2.06V p-p（公称2.06V p-p）
  • プログラマブル終端抵抗
    • 400Ω、200Ω、100Ω、50Ω差動
  • 入力可能なアナログ・フルパワー帯域：2GHz
  • チャンネル・アイソレーション／クロスト－ク：95dB
  • AGC導入に有効な振幅検出ビット
  • チャンネルあたり2つの広帯域デジタル・プロセッサを内蔵
    • 12ビットNCO、最大4段にカスケードされたハーフバンド・フィルタ
  • 差動クロック入力
  • 1、2、4、8の整数クロック分周
  • 柔軟なJESD204Bレーン構成
  • 小信号ディザ

AD9680は、デュアル、14ビット、1.25GSPS/1GSPS/820MSPS/500MSPSのA/Dコンバータ（ADC）です。デバイスは、オンチップのバッファ回路とサンプル＆ホールド回路を備えており、低消費電力、小型サイズおよび使い易く設計されています。このデバイスは、最大2GHzまでの広帯域幅アナログ信号をサンプリングするように設計されています。AD9680は、小型パッケージ内に、広い入力帯域幅、高サンプリング・レート、優れた直線性および低消費電力と最適化されています。

デュアルのADCコアは、マルチステージの差動パイプライン・アーキテクチャを採用し、出力誤差補正ロジックを内蔵しています。各ADCは、ユーザー選択可能な多様な入力範囲をサポートする広帯域幅入力となっています。リファレンス電圧を内蔵しているため設計が容易です。

アナログ入力とクロック信号は、差動の入力となっています。各ADCデータの出力は、2つのデジタル・ダウンコンバータ（DDC）に内部で、接続されています。各DDCは、5段にカスケードされた信号処理段で構成されています。：12ビットの周波数変換（NCO）と4つのハーフ・バンド・デシメーション・フィルタ。DDCはデフォルトでバイパスされます。

DDCブロックに加えて、AD9680は、通信用レシーバ内の自動ゲイン制御（AGC）機能を簡素化する幾つかの機能を備えています。プログラマブルなスレッショールド検出器を使うと、ADCの高速検出ビットを使って着信信号パワーをモニタすることができます。もし入力信号レベルがプログラマブルなスレッショールドを超えると、高速検出インジケータがハイ・レベルになります。このスレッショールド・インジケータの待ち時間は小さいため、迅速にシステム・ゲインを下げてADC入力で範囲外状態を回避することができます。

ユーザーは、DDC構成とレシーブ・ロジック・デバイスがアクセプト可能なレーン・レート次第で、サブクラス1　JESD204Bベースの高速シリアル出力は、1、2、4レーン配置のさまざまな構成にすることできます。複数個のデバイス同期は、SYSREF±とSYNCINB±入力ピンを通してサポートされています。

AD9680は柔軟なパワーダウン・オプションを備えており、必要に応じて大幅な省電力を可能にします。これら全ての機能は、1.8V～3.3Vの3線SPIを使ってプログラムすることができます。

AD9680は、64ピン鉛フリーLFCSPパッケージを採用し、－40℃～＋85℃の工業用温度範囲にわたって仕様規定されています。この製品はUS特許によって保護されています。


製品のハイライト

  1. 広いフルパワー帯域幅は、最大2GHZまでの信号のIFサンプリングをサポートします。
  2. プログラマブル入力終端を持ったバッファ入力は、フィルタの設計と導入を簡素化します。
  3. 4つの内蔵された広帯域デシメーション・フィルタと数値制御発振（NCO）ブロックは、マルチバンド・レシーバをサポートします。
  4. 柔軟なシリアル・ポート・インターフェース（SPI）は、システムが必要とする仕様にミートするための、いろいろな製品の特性と機能を制御します。
  5. プログラマブルな高速オーバ・レンジ検出機能
  6. 9mm×9mmの64ピンLFCSPパッケージ

アプリケーション

  • 通信関連
  • ダイバーシティ・マルチバンド、マルチ・モード・デジタル・レシーバ：
    3G/4G、TD-SCDMA、W-CDMA、GSM、LTE
  • 汎用ソフトウェア無線
  • ウルトラ・ワイドバンド衛星用レシーバ
  • 計測機器
  • レーダ
  • 通信諜報（SIGINT）
  • DOCSIS　3.0　CMTSアップストリーム・レシーバ・パス
  • HFCデジタル・リバース・パス・レシーバ
AD9680
A/Dコンバータ、14ビット、1.25GSPS/1GSPS/820MSPS/500MSPS、デュアル、JESD204B
AD9680 Functional Block Diagram AD9680 Pin Configuration
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技術記事 21

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ソフトウェア・リソース

デバイス・ドライバ 3

ハードウェア・エコシステム

製品モデル 製品ライフサイクル 詳細
クロックIC 6
LTC6953
最終販売 11出力を備えた、JESD204B/JESD204C対応の超低ジッタ4.5GHzクロック分配器
HMC7043
新規設計に推奨

JESD204B/JESD204C 用機能付き、3.2 GHz、14 出力、高性能ファンアウト・バッファ
LTC6951
最終販売 超低ジッタ VCO内蔵の複数出力 クロック・シンセサイザ
LTC6952
最終販売 11 の出力を備えた、JESD204B/JESD204C をサポートする超低ジッタ 4.5 GHz PLL
HMC7044
新規設計に推奨

JESD204B / JESD204 用機能付き、3.2 GHz、14 出力、高性能ジッター減衰器
AD9528
新規設計に推奨

クロック・ジェネレータ、14 LVDS / HSTL出力、JESD204B対応

※英文データシート（Rev.C）、和文データシート（Rev.0）に対する正誤表があります
スイッチング・レギュレータ ＆ コントローラ 2
ADP2164
製造中 ステップダウンDC-DCレギュレータ、6.5V、4A、高効率
ADP2384
製造中 ステップダウンDC-DCレギュレータ、20V、4A、同期型
ファンアウト・バッファ 1
LTC6955
最終販売 超低ジッタ、7.5 GHz、11 出力ファンアウト・バッファ・ファミリー
リニア・レギュレータ 1
ADP1741
製造中 低ドロップアウト・リニア・レギュレータ、2A、CMOS
可変ゲイン・アンプ（VGA） 2
ADA4961
新規設計に推奨 RF DGA、3.2GHz、低歪み
ADL5205
新規設計に推奨

DGA（デジタル制御ゲイン・アンプ）、デュアル、35 dBのゲイン範囲、ステップ・サイズ 1 dB
差動アンプ 4
ADL5565
新規設計に推奨 差動アンプ、超高ダイナミックレンジ、6GHz
ADL5569
新規設計に推奨 6.5 GHz、超高感度ダイナミック・レンジ、差動アンプ
ADL5567
新規設計に推奨 4.3 GHz, Ultrahigh Dynamic Range, Dual Differential Amplifier
ADL5566
新規設計に推奨 差動アンプ、デュアル、4.5GHz 、超高ダイナミックレンジ
Modal heading
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ツールおよびシミュレーション

Virtual Eval（仮想評価、 ベータ版）

Virtual Evalは、ADC、DAC、およびその応用製品評価を支援するウェブベースの設計ツールです。アナログ・デバイセズのサーバ上にあるモデルを使用して、重要な部品の性能特性をわずか数秒でシミュレートします。使用時は、入力トーンや外部ジッタなどの動作条件のほか、ゲインやデジタル・ダウンコンバージョンといったデバイス機能を設定してください。ノイズ、歪み、分解能、FFT、タイミング図、周波数応答プロット、その他さまざまな性能特性を確認することができます。

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設計ツール 1

ADIsimRF

ADIsimRFは使いやすいRFシグナル・チェーン計算ツールです。最大50段までのシグナル・チェーンについて、カスケード・ゲイン、ノイズ、歪み、消費電力を計算し、プロット、エクスポートが可能です。ADIsimRFには、アナログ・デバイセズのRFおよびミックスド・シグナル部品のデバイス・モデルの広範なデータ・ベースも含まれています。

ツールを開く

ADC Companion Transport Layer RTL Code Generator Tool

This command line executable tool generates a Verilog module which implements the JESD204 receive transport layer. The user specifies in a configuration file one or more modes to be supported by the transport layer module. These modes are defined as a set of JESD204 parameter values: L, M, F, S, N', and CF. The transport layer converts JESD204 lane data output from a JESD204 link layer IP to a data bus with a fixed width, containing interleaved virtual converter samples. Both JESD204B and JESD204C link layers are supported.

ツールを開く

Visual Analog

VisualAnalog™は、高速ADCの選択や評価を行う設計者向けに、強力なシミュレーション／データ解析ツール・セットとユーザ・フレンドリなグラフィカル・インターフェースを組み合わせたソフトウェア・パッケージです。

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MathWorks® 1

AD9680 MATLAB ADIsimADC

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Sパラメータ 1

IBISモデル 1

AD9680 AMI Model

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LTspice

LTspice®は、無料で提供される強力で高速な回路シミュレータと回路図入力、波形ビューワに改善を加え、アナログ回路のシミュレーションを容易にするためのモデルを搭載しています。

 

評価用キット

eval board
schematic 1
schematic 2
AD-FMCADC4-EBZ

ADA4961 & AD9680 Analog Signal Chain Evaluation and AD9528 Converter Synchronization

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機能と利点

  • Four channels of 1.0 GSPS conversion utilizing JESD204B high speed serial interface
  • Driver amplifier interface with 21dB voltage gain adjustment
  • Optional on-board or external clocking
  • Specific design and I/O added for multi-board synchronization

製品詳細

The AD-FMCADC4-EBZ is a high speed 4-channel data acquisition board featuring two AD9680 dual channel ADC at 1000 MSPS and four ADA4961 low distortion, 3.2 GHz, RF DGA driving each converter. The FMC form factor supports the JESD204B high speed serial interface. All clocking and channel synchronization is support on-board using the AD9528 clock generator. This product is designed for sampling wide bandwidth analog signals up to the second Nyquist zone. The combination of wide input bandwidth, high sampling rate, and excellent linearity of the AD9680 is ideally suited for spectrum analyzers, data acquisition systems, and a wide assortment of military electronics applications, such as radar and jamming/anti-jamming measures.


The board meets most of the FMC specifications in terms of mechanical size, mounting hole locations, and more. Although this board does meet most of the FMC specifications, it’s not meant as a commercial off the shelf (COTS) board. If you want a commercial, ready to integrate product, please refer to one of the many FMC manufacturers and the FMC specification (ANSI/VITA 57.1).

This board is targeted to use the ADI reference designs that work with Xilinx development systems. ADI provides complete source (HDL and software) to re-create those projects (minus the IP provided by the FPGA vendors, which we use), but may not provide enough info to port this to your custom platform.

The design of the board is specifically tailored to synchronizing multiple AD-FMCADC4-EBZ boards together. For more information on synchronization please refer to A Test Method for Synchronizing Multiple GSPS Converters. The reference design includes the device data capture via the JESD204B serial interface and the SPI interface. The samples are written to the external DDR-DRAM. It allows programming the device and monitoring its internal registers via SPI.

eval board
schematic 3
schematic 4
schematic 5
AD-FMCDAQ2-EBZ

AD-FMCDAQ2-EBZ評価用ボード

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機能と利点

  • 回路図、レイアウト、部品表、ガイバー・ファイル、HDL、Linux®ドライバ、IIOオシロスコープ、VisualANALOGを同梱
  • FMC互換のフォーム・ファクタ
  • FMCコネクタを通じて給電
  • 完全な同期機能を持つ2チャンネルADCおよび2チャンネルDACを内蔵

製品詳細

AD-FMCDAQ2-EBZモジュールは、AD9680（デュアル、14ビット、1.0GSPSのJESD204B ADC）、AD9144（クワッド、16ビット、2.8GSPSのJESD204B DAC）、AD9523-1（14出力、1GHzクロック）、およびパワー・マネージメント部品で構成されています。このモジュールは、FMCコネクタを介して内部生成キャリア・プラットフォームによってクロックされ、完全に自己完結型のデータ・アクイジションおよびシグナル合成のプロトタイピング・プラットフォームを構成します。FMCのフットプリントで（84mm × 69mm）、モジュールの広帯域データ変換、クロック、電力の組み合わせが現実のハードウェアおよびソフトウェアに非常に近いものになっているため、シグナル・チェーン性能を損なうことなくシステムのプロトタイピングと設計を行うことができます。

アプリケーション

  • 電子試験装置および計測装置
  • 汎用ソフトウェア無線
  • レーダー・システム
  • 超広帯域衛星受信機
  • ポイントtoポイント通信システム

eval board
schematic 6
EVAL-AD9680

AD9680/AD9234/AD9690 評価用ボード

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機能と利点

  • AD9680 および AD9234 用のフル機能評価用ボード
  • セットアップと制御用の SPI インターフェース
  • 広帯域バラン駆動入力
  • 外部電源不要。FMC からの 12V-1A および 3.3V-3A 電源を使用
  • VisualAnalog® および SPI コントローラ・ソフトウェア・インターフェース

製品詳細

AD9680-1000EBZ/AD9234-1000EBZ/AD9690-1000EBZ は、 AD9680-1000 14 ビット、1000MSPS JESD204B、デュアル A/D コンバータ／ AD9234-1000 14 ビット、1000 MSP JESD204B、デュアル A/D コンバータ／ AD9690-1000 14 ビット、500 MSP、1 GSPS JESD204B、A/D コンバータ（ADC）の評価用ボードです。このリファレンス設計により、ADC をさまざまなモードおよび構成で動作させるために必要なサポート回路がすべて提供されます。 ADS7-V2EBZ データ・キャプチャ・カードを直接操作できるように設計されているので、ユーザーはキャプチャされたデータを分析用にダウンロードできます。Visual Analog ソフトウェア・パッケージはデバイスのハードウェアとのインターフェースに使用されるもので、ユーザーフレンドリーなグラフィカル・インターフェースでデータをダウンロードして分析できます。SPI コントローラ・ソフトウェア・パッケージもこのハードウェアと互換性があり、AD9680/AD9234/AD9690 の SPI プログラマブル機能にアクセスできます。 ユーザー・ガイド wiki は、ラボでの性能評価用にデバイスを設定するための技術文書と手順を提供します。

AD9680/AD9234/AD9690 データシートにはデバイスの設定と性能に関する追加情報が記載されています。評価用ボードを使用する際に参照してください。すべての文書および Visual Analog と SPI コントローラは、High Speed ADC Evaluation Boards（高速 ADC 評価用ボード）ページから入手できます。詳細やご質問については、highspeed.converters@analog.com
まで電子メールでお問い合わせください。

必要な装置
  • アナログ信号ソースおよびアンチエイリアシング（折返し誤差防止）・フィルタ
  • サンプリング・クロック源
  • FPGA レシーバー用の REFCLOCK 源
  • Windows 7、XP、または Vista 搭載 PC
  • USB 2.0 ポート推奨（USB 1.1 互換）
  • AD9680-1000EBZ 評価用ボード
  • ADS7-V2EBZ FPGA ベースのデータ・キャプチャ・キット

eval board
schematic 7
schematic 8
EVAL-FMCDAQ3-EBZ

High speed data acquisition FMC board

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機能と利点

  • Provides two channels of ADC and two channels of DAC with full synchronization capabilities
  • FMC-compatible form factor
  • Powered from single FMC connector

製品詳細

The AD-FMCDAQ3-EBZ module is comprised of the AD9680 dual, 14-bit, 1.25 GSPS, JESD204B ADC, the AD9152 dual, 16-bit, 2.5 GSPS, JESD204B DAC, the AD9528 clock, and power management components. It is clocked by an internally generated carrier platform via the FMC connector, comprising a completely self-contained data acquisition and signal synthesis prototyping platform. In an FMC footprint (84 mm × 69 mm), the module’s combination of wideband data conversion, clocking, and power closely approximates real-world hardware and software for system prototyping and design, with no compromise in signal chain performance.


Applications

  • Electronic test and measurement equipment
  • General-purpose software radios
  • Radar systems
  • Ultra-wideband satellite receivers
  • Signals intelligence (SIGINT)
  • Point to point communication systems
  • DOCSIS 3.0 CMTS and HFC networks
  • Multiple input/multiple output (MIMO) radios
  • Automated test equipment

eval board
schematic 9
ADS7-V2EBZ

FPGAベースのデータ・キャプチャ・キット

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機能と利点

  • Virtex-7 FPGAに基づく
  • 1つのFMC-HPCコネクタ
  • 10個の13.1Gbpsトランシーバーをサポート
  • 2つのDDR3-1866 DIMM
  • シンプルなUSB ポート・インターフェース（2.0）



製品詳細

ADS7-V2評価用ボードは、アナログ・デバイセズの高速A/Dコンバータ、D/Aコンバータ、およびビット・レートが最大13.1GbpsのJESD204Bに準拠したトランシーバーの評価をサポートするために開発されました。以下のQuick Start Wikiサイトに、プラットフォームの概要が記載されています。更に、ボードの各使用例に独自のセクションがあります（例：高速A/Dコンバータの評価にADS7-V2を使用）。ADS7-V2は、特定のアナログ・デバイセズの評価用ボードのみでの使用を意図しています。開発プラットフォームとしての使用は意図しておらず、スタンドアロン動作はサポートしていません。FPGA開発キットについては、Xilinx社および当社認定の販売代理店にお問い合わせください。

AD-FMCADC4-EBZ
ADA4961 & AD9680 Analog Signal Chain Evaluation and AD9528 Converter Synchronization
AD-FMCADC4-EBZ Evaluation Board (top) AD-FMCADC4-EBZ Evaluation Board (bottom)
AD-FMCDAQ2-EBZ
AD-FMCDAQ2-EBZ評価用ボード
AD-FMCDAQ2-EBZ Block Diagram AD-FMCDAQ2-EBZ - top view AD-FMCDAQ2-EBZ - bottom view
EVAL-AD9680
AD9680/AD9234/AD9690 評価用ボード
EVAL-AD9680
EVAL-FMCDAQ3-EBZ
High speed data acquisition FMC board
FMCDAQ3 Block Diagram FMCDAQ3 (top)
ADS7-V2EBZ
FPGAベースのデータ・キャプチャ・キット
ADS7-V2EBZ

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