製品概要

機能と利点

  • 超低rmsジッタ:44fs(2457.6MHzにおける代表値、12kHz~20MHz)
  • ノイズ・フロア:−156dBc/Hz @ 2457.6MHz
  • 低位相ノイズ:−141.7dBc/Hz @ 800kHz、983.04MHz出力
  • 最大14 LVDS、LVPECL、またはCMLタイプのデバイス・クロック(DCLK)(PLL2による)
    • 最大CLKOUTx/CLKOUTxおよびSCLKOUTx/SCLKOUTx周波数(最大3200MHz)
  • JESD204B / JESD204 対応のシステム・リファレンス(SYSREF)パルス
  • 25 ps アナログ、½ VCO サイクルのデジタル遅延を 14 のクロック出力チャンネルのそれぞれに個別に設定可能
  • SPI で設定可能な位相ノイズ対消費電力
  • SYSREF 有効割込みによる簡単な JESD204B / JESD204 同期化
  • 狭帯域、デュアルコア VCO
  • 最大 2 つのバッファ付き電圧制御型発振器(VCXO)出力
  • LVDS、LVPECL、CMOS および CML モードで最大 4 つの入力クロック
  • 出力周波数を維持する周波数ホールドオーバー・モード
  • 信号喪失(LOS)検出とヒットレス・リファレンス・スイッチング
  • 4 個の GPIO アラーム/状態インジケータでシステムの動作状態を確認
  • 最大 6000 MHz まで対応可能な外部VCO入力
  • 優れた PSRR を実現する内蔵レギュレータ
  • 68 ピン、10 mm × 10 mm LFCSP パッケージ

製品概要

HMC7044 は、高性能のデュアル・ループ、整数N型ジッタ・アッテネータです。パラレルまたはシリアル(JESD204B/JESD204C タイプ)インターフェース付きの高速データ・コンバータ用に超低位相ノイズ周波数の生成とリファレンスの選択を行います。HMC7044 は、2個の整数モード PLL と、オーバーラップした2個のオンチップ VCO を搭載し、SPI によって選択し、それぞれ約 2.5 GHz と 3 GHz の広範囲な調整範囲に対応します。GSM と LTE の基地局設計の条件に適合し、広範囲のクロック管理と配分の機能を提供するため、ベースバンドと無線カードのクロック・ツリー設計が簡素化します。HMC7044 は、14の設定可能な低ノイズ出力を持ち、データ・コンバータ、FPGA(フィールド・プログラマブル・ゲート・アレイ)、ミキサーのローカル発振器(LO)など数多くのさまざまなコンポーネントに柔軟に接続できます。 

HMC7044 の DCLK と SYSREF のクロック出力は、CML、LVDS、LVPECL、LVCMOS などの信号規格やさまざまなバイアス設定に対応するように設定できるため、さまざまなボードの挿入損失をなくすことができます。 

アプリケーション

  • JESD204B/JESD204C クロック生成
  • セルラのインフラストラクチャ(マルチキャリア GSM、LTE、W-CDMA)
  • データ・コンバータのクロッキング
  • マイクロ波ベースバンド・カード
  • 位相アレイのリファレンス配分

データシートに関する追加・詳細情報は RFMG-timing@analog.com へ英語でお問い合わせください。

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評価キット (4)

参考資料

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    ツールおよびシミュレーション

    IBIS Models

    設計ツール

    ADIsimCLK 設計・評価 ソフトウェア

    ADIsimCLKはアナログ・デバイセズの超低ジッタのクロック分配器とクロック生成用製品向けに開発された設計ツールです。ADIsimCLKを使用すれば、ワイヤレス・インフラストラクチャ、計測器、ネットワーキング、ブロードバンド、ATE(自動試験装置)あるいはクロック性能が予測可能であることが求められるあらゆる分野のアプリケーションで、設計を迅速に開発、評価、最適化できます。

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    設計リソース

    アナログ・デバイセズでは、最高レベルの品質と信頼性を備えた製品を提供することに最大の力を常に注いでいます。これを実現するため、製品およびプロセスの設計のあらゆる観点で品質と信頼性のチェックを行っています。そして、それは、製造工程においても同様です。アナログ・デバイセズは常に、出荷製品の「ゼロ・ディフェクト」を目指しています。

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