HMC7044

新規設計に推奨

JESD204B / JESD204 用機能付き、3.2 GHz、14 出力、高性能ジッター減衰器

データシート (Rev. E) 製品セレクション・テーブル
利用上の注意

本データシートの英語以外の言語への翻訳はユーザの便宜のために提供されるものであり、リビジョンが古い場合があります。最新の内容については、必ず最新の英語版をご参照ください。

なお、日本語版のデータシートは基本的に「Rev.0」（リビジョン0）で作成されています。そのため、英語版が後に改訂され、複数製品のデータシートがひとつに統一された場合、同じ「Rev.0」の日本語版のデータシートが異なる製品のデータシートとして表示されることがあります。たとえば、「ADM3307E」の場合、日本語データシートをクリックすると「ADM3311E」が表示されます。これは、英語版のデータシートが複数の製品で共有できるように1本化され、「ADM3307E/ADM3310E/ADM3311E/ADM3312E/ADM3315E」（Rev.J）と改訂されたからで、決して誤ってリンクが張られているわけではありません。和文化されたデータシートを少しでも有効に活用していただくためにこのような方法をとっておりますので、ご了解ください。

アナログ・デバイセズ社は、提供する情報が正確で信頼できるものであることを期していますが、その情報の利用に関して、あるいはその利用によって生じる第三者の特許やその他の権利の侵害に関して一切の責任を負いません。また、アナログ・デバイセズ社の特許または特許の権利の使用を明示的または暗示的に許諾するものでもありません。仕様は予告なしに変更する場合があります。本紙記載の商標および登録商標は、各社の所有に属します。
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製品の詳細

  • 超低rmsジッタ：44fs（2457.6MHzにおける代表値、12kHz～20MHz）
  • ノイズ・フロア：−156dBc/Hz @ 2457.6MHz
  • 低位相ノイズ：−141.7dBc/Hz @ 800kHz、983.04MHz出力
  • 最大14 LVDS、LVPECL、またはCMLタイプのデバイス・クロック（DCLK）（PLL2による）
    • 最大CLKOUTx/CLKOUTxおよびSCLKOUTx/SCLKOUTx周波数（最大3200MHz）
  • JESD204B / JESD204 対応のシステム・リファレンス（SYSREF）パルス
  • 25 ps アナログ、½ VCO サイクルのデジタル遅延を 14 のクロック出力チャンネルのそれぞれに個別に設定可能
  • SPI で設定可能な位相ノイズ対消費電力
  • SYSREF 有効割込みによる簡単な JESD204B / JESD204 同期化
  • 狭帯域、デュアルコア VCO
  • 最大 2 つのバッファ付き電圧制御型発振器（VCXO）出力
  • LVDS、LVPECL、CMOS および CML モードで最大 4 つの入力クロック
  • 出力周波数を維持する周波数ホールドオーバー・モード
  • 信号喪失（LOS）検出とヒットレス・リファレンス・スイッチング
  • 4 個の GPIO アラーム／状態インジケータでシステムの動作状態を確認
  • 最大 6000 MHz まで対応可能な外部VCO入力
  • 優れた PSRR を実現する内蔵レギュレータ
  • 68 ピン、10 mm × 10 mm LFCSP パッケージ
HMC7044

JESD204B / JESD204 用機能付き、3.2 GHz、14 出力、高性能ジッター減衰器

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ソフトウェア・リソース

デバイス・ドライバ 1

ハードウェア・エコシステム

製品モデル 製品ライフサイクル 詳細
ファンアウト・バッファ ＆ スプリッタ 2
LTC6955
最終販売 超低ジッタ、7.5 GHz、11 出力ファンアウト・バッファ・ファミリー
HMC7043
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ツールおよびシミュレーション

IBISモデル 1

ADIsimCLK 設計・評価 ソフトウェア

ADIsimCLKはアナログ・デバイセズの超低ジッタのクロック分配器とクロック生成用製品向けに開発された設計ツールです。ADIsimCLKを使用すれば、ワイヤレス・インフラストラクチャ、計測器、ネットワーキング、ブロードバンド、ATE（自動試験装置）あるいはクロック性能が予測可能であることが求められるあらゆる分野のアプリケーションで、設計を迅速に開発、評価、最適化できます。

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