製品概要

機能と利点

  • Flexible reconfigurable common platform design
    • 4 DAC cores connected to various DSP and bypass datapaths
    • Supports single, dual, and quad band
    • Datapaths and DSP blocks are fully bypassable
    • On-chip PLL with multichip synchronization
      • External RF clock input option for off chip PLL
  • Maximum DAC sample rate up to 12 GSPS
    • Maximum data rate up to 12 GSPS using JESD204C
    • Useable analog bandwidth to 8 GHz
  • DAC ac performance at 12 GSPS
    • Full-scale output current range: 7 mA to 40 mA
    • Two tone IMD3 (−7 dBFS per tone): −78.9 dBc
    • Noise spectral density (NSD), single tone at 3.7 GHz: −155.1 dBc/Hz
    • Spurious free dynamic range (SFDR), single tone at 3.7 GHz: −70 dBc
  • Versatile digital features
    • Selectable interpolation filters
    • Configurable digital up conversion (DUC)
      • 8 fine complex DUCs and 4 coarse complex DUCs
      • 48-bit numerically controlled oscillator (NCO) per DUC
      • Option to bypass fine and coarse DUC
    • Programable delay per data path
    • Transmit digital predistortion (DPD) support
      • Fine DUC channel gain control and delay adjust
  • Programmable 192 tap PFIR filter for receive equalization
    • Supports 4 different profile settings loaded via GPIO
  • Receive automatic gain control (AGC) support
    • Fast detect with low latency for fast AGC control
    • Signal monitor for slow AGC control
    • Dedicated AGC support pins
  • Auxiliary features
    • Fast frequency hopping
    • Direct digital synthesis (DDS)
    • Low latency digital loopback mode (receive datapath
      • NCOs can be routed to transmit datapaths
      • Power amplifier downstream protection circuitry
      • On-chip temperature monitoring unit
      • Flexible GPIOx pins
      • TDD power savings option
  • SERDES JESD204B/JESD204C interface
    • 8 lanes up to 24.75 Gbps
    • JESD204B compatible with the maximum 15.5 Gbps
    • JESD204C compatible with the maximum 24.75 Gbps
    • Supports real or complex digital data (8-bit, 12-bit, 16-bit, or 24-bit)
  • 15 mm × 15 mm, 324-ball BGA with 0.8 mm pitch

製品概要

The AD9177 is a highly integrated device with four, 16-bit, 12 GSPS maximum sample rate, RF digital-to-analog converter (DAC) cores, supporting up to eight baseband channels. The device is well suited for applications requiring wideband DACs to process signal(s) of wide instantaneous bandwidth. The device features an 8 lane, 24.75 Gbps JESD204C or 15.5 Gbps JESD204B data receiver port, an on-chip clock multiplier, and digital signal processing (DSP) features targeted at either wideband or multiband direct to RF applications. The DSP datapaths may be bypassed to allow a direct connection between the DAC cores and the data receiver port. The device also features frequency hopping modes and datapath mux configurations useful for phase array radar systems and electronic warfare applications.

APPLICATIONS

  • Wireless communications infrastructure
  • Microwave point-to-point, E-band, and 5G mm wave Broadband communications systems
  • Data over cable service interface specification (DOCSIS) 3.1
    and 4.0 cable modem termination system (CMTS)
  • Phased array radar and electronic warfare
  • Electronic test and measurement systems

製品ライフサイクル icon-recommended 発売前

新たに発売予定の製品です。技術的な検証が継続中の場合もあります。数量が限られており、設計仕様は量産開始前に変更されることがあります。

評価キット (2)

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設計リソース

ADI has always placed the highest emphasis on delivering products that meet the maximum levels of quality and reliability. We achieve this by incorporating quality and reliability checks in every scope of product and process design, and in the manufacturing process as well.  "Zero defects" for shipped products is always our goal.

サンプル&購入

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モデル一覧の項目説明

 

 

 

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