製品概要
機能と利点
- 柔軟性の高い再構成可能な共通プラットフォーム設計
- 様々なDSPおよびバイパス・データパスに接続される4つのDACコア
- シングル、デュアル、クワッド・バンドをサポート
- データパスおよびDSPブロックにより完全にバイパス可能
- マルチチップ同期機能搭載のオンチップPLL
- オフチップPLL用の外部RFLK入力オプション
- 最大12GSPSのDACサンプル・レート
- JESD204C使用による最大12GSPSの最大データ・レート
- 8GHzまでのアナログ帯域幅を使用可能
- DACのAC性能（12GSPS時）
- フルスケール出力電流範囲：6.43mA～37.75mA
- ツー・トーンIMD3（トーンあたり-7dBFS）：-78.9dBc
- NSD、3.7GHzでのシングル・トーン：−155.1dBc/Hz
- SFDR、3.7GHzでのシングル・トーン：-70dBc
- 汎用デジタル機能
- 選択可能なインターポレーション・フィルタ
- 設定可能またはバイパス可能DUC
- 8つの微調整・複素DUCと4つの粗調整・複素DUC
- DUCあたり48ビットNCOを内蔵
- オプションで微調整および粗調整DUCをバイパス可能
- データパスごとにプログラマブルな遅延
- DPD対応トランスミッタ
- DUCチャンネル・ゲインの微調整および遅延調整
- 補助機能
- ダイレクト・デジタル合成と高速周波数ホッピング
- 低遅延ループバック・モード（受信データパスNCO出力は送信データパスに接続できます）
- パワー・アンプ後段の保護回路
- 温度モニタリング・ユニット内蔵
- 柔軟なGPIOピン
- TDD省電力オプション
- SERDES JESD204B/JESD204Cインターフェース
- 8レーンJESD204B/Cレシーバー（JRx）
- JESD204B互換の最大15.5Gbps
- JESD204C互換の最大24.75Gbps
- 実数または複素数のデジタル・データ（8、12、16、または24ビット）に対応
- 15mm × 15mm、0.8mmピッチ、324ボールBGA
製品概要
AD9177は、16ビットで最大サンプル・レートが12GSPSのRF D/Aコンバータ（DAC）コアを4つ内蔵した高集積デバイスで、最大8つのベースバンド・チャンネルをサポートできます。このデバイスは、広範な瞬時帯域幅の信号を処理するために広帯域のDACが必要なアプリケーションに最適です。このデバイスは、8レーン、24.75Gbps JESD204Cまたは15.5Gbps JESD204Bデータ・レシーバー（JRx）ポート、オンチップ・クロック逓倍器、デジタル信号処理（DSP）データパスを備えており、広帯域またはマルチバンドのダイレクトto RFアプリケーション、フェーズ・アレイ・レーダー・システム、および電子戦アプリケーションの複素信号の処理を行えます。DSPデータパスは、データ・レシーバー・ポートとDACコア間で直接接続できるようにバイパスできます。
ダイレクト・デジタル合成（DDS）アプリケーションでは、AD9177は、様々な周波数の複数のサイン波トーンを生成するためにデータ・レシーバー・ポートを使わず動作できます。4つの各粗調整デジタル・アップコンバータ（DUC）内のメインの数値制御発振器（NCO）ブロックには、1個の48ビットNCO、31個の32ビットNCOのバンクが含まれ、それぞれ独立した位相アキュムレータを備えています。同様に、受信データパスの各粗調整および微調整デジタル・ダウンコンバータ（DDC）内のメインNCOブロックには、粗調整DUCとDAC出力の前に処理するために送信データパスにループされる16個の48ビットNCOのバンクが含まれます。周波数ホッピングの汎用入出力（GPIO）コントロール、事前設定可能なプロファイル選択、SYSREF入力ポートを使用したNCOと一般的なトリガの同期機能を組み合わせたこのバンクによって、位相コヒーレントな高速周波数ホッピング（FFH）が実現し、複数のデバイスが同期されたり、動作中にNCO周波数が継続的に調整されたりするアプリケーションに対応できます。
アプリケーション
- ワイヤレス通信インフラストラクチャ
- マイクロ波のポイントtoポイント、Eバンド、および5Gミリ波
- 広帯域通信システム
- DOCSIS 3.1および4.0 CMTS
- フェーズド・アレイ・レーダーおよび電子戦
- 電子テストおよび計測システム
製品カテゴリ
マーケット＆テクノロジー
製品ライフサイクル
新規設計にお薦めします
発売済みの製品です。データシートには、最終的な仕様と動作条件がすべて記載されています。新規の設計には、これらの製品の使用を推奨します。
評価キット (2)
参考資料
-
DAC/ADCとDSPの統合ICにより、広帯域マルチチャンネル・システムの性能を改善する5/1/2021
-
EVMの計測結果に基づき、システム・レベルの性能を高める4/1/2021
-
マルチオクターブに対応する広帯域デジタル・レシーバー、そのSFDRについて考慮すべき事柄1/8/2021 アナログ・ダイアログ
-
マルチチップ同期機能を活用し、広帯域対応のDAC/ADCをデタミニスティックな位相で起動する10/1/2020
-
DAC の位相ノイズ性能を改善、極めて精度の高い DDS アプリケーションを実現可能に8/1/2017 アナログ・ダイアログ
-
MxFE評価用プラットフォームのデモ・シリーズ4/24/2023シリーズ
ツールおよびシミュレーション
Software and Simulation
IBISモデル
S-Parameter
ZIP
AD9081/AD9082/AD9986/AD9988 RFIO Models
2.22 M
Keysight ADS workbook and s-parameter files for simulating the frequency response of the AD908x DAC, ADC, and CLK interfaces. See Application note AN-2065: Optimizing RF performance of the AD9081 and AD9082” for instructions on how to use the models.
設計ツール
DAC Companion Transport Layer RTL Code Generator (Rev. 1.0)
These command line executable tool generates a Verilog module which implements the JESD204 transmitter transport layer. The user specifies in a configuration file one or more modes to be supported by the transport layer module. These modes are defined as a set of JESD204 parameter values: L, M, F, S, N', and CF. The transport layer converts JESD204 lane data output from a JESD204 link layer IP to a data bus with a fixed width, containing interleaved virtual converter samples. Both JESD204B and JESD204C link layers are supported.
MxFE JESD204 Mode Selector Tool (Rev. F)
The JESD204B/C Mode Selector Tool is a simple command line-based Windows executable that can be used to narrow down the number of JESD204x modes to only include those modes that support the user’s specific application use case. The tool guides the user through a use case description flow chart and gives the user a small list of applicable transmit and/or receive modes to choose from. This tool is applicable to the AD9081, AD9082, AD9177, AD9207, AD9209, AD9986, and AD9988.
JESD204x Frame Mapping Table Generator
The JESD204x Frame Mapping Table Generator tool consists of two Windows executables that will allow the user to input any valid combination of JESD204x parameters (L, M, F, S, NP) in order to output a .csv file that illustrates the frame mapping of the JESD204x mode in table format. There is an executable that allows the user to input a single JESD204x mode and another, that allows the user to input the parameters for multiple JESD204x modes in a specified .csv format in order to output a .csv file that illustrates the frame mapping of each of the JESD204x modes that were input into separate tables.
ADIsimPLL™
アナログ・デバイセズの新しい高性能PLL製品を迅速かつ確実に評価できるツールです。現在利用できるツールの中で、最も総合的なPLLシンセサイザーの設計／シミュレーション・ツールです。実施されるシミュレーションには、主要な非線形効果が含まれており、これはPLLの性能に大きく影響を及ぼします。ADIsimPLLによって、設計プロセスの繰り返し作業が1つ以上排除されるため、設計から製品の市場投入までの期間が大幅に短縮することができます。
おすすめ製品
AD9177 コンパニオン製品
設計リソース
アナログ・デバイセズでは、最高レベルの品質と信頼性を備えた製品を提供することに最大の力を常に注いでいます。これを実現するため、製品およびプロセスの設計のあらゆる観点で品質と信頼性のチェックを行っています。そして、それは、製造工程においても同様です。アナログ・デバイセズは常に、出荷製品の「ゼロ・ディフェクト」を目指しています。詳細についてはアナログ・デバイセズの品質および信頼性プログラム/認定証をご覧ください。
| 製品番号 | 材料宣誓書（MD） | 信頼性データ | ピン/パッケージ図 | CADシンボル、フットプリント & 3Dモデル |
|---|---|---|---|---|
| AD9177BBPZ | 材料宣誓書（MD） | 信頼性データ | 324-Ball BGA_ED (15mm x 15mm x 1.58mm) | |
| AD9177BBPZRL | 材料宣誓書（MD） | 信頼性データ | 324-Ball BGA_ED (15mm x 15mm x 1.58mm) | |
| ウェハ・ファブリケーション・データ |
サポート ＆ ディスカッション
AD9177 Discussions
AD9081 Device Tree JESD204C DAC mode 15
5 週間前 Linux Software Drivers
RE: Unable to correctly page DACs for FFH via GPIO
9 週間前 Speed DACs
サンプル＆購入
ご注文に関するFAQ
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購入価格
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リスト価格
(*)価格は1Ku当たりの米ドルで、米国内における販売価格（FOB）で表示されておりますので、予算のためにのみご使用いただけます。また、その価格は変更されることがあります。米国以外のお客様への価格は、輸送費、各国の税金、手数料、為替レートにより決定されます。価格・納期等の詳細情報については、弊社正規販売代理店. または担当営業にお問い合わせください。なお、 評価用ボードおよび評価用キットの表示価格は1個構成としての価格です。
リードタイム
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analog.comサイトから購入できるボードは、最大で2枚までとなります。3枚以上の購入をご希望の場合は、正規販売代理店からご購入ください。
価格は1個当たりの米ドルで、米国内における販売価格（FOB）で表示されておりますので、予算のためにのみご使用いただけます。 また、その価格は変更されることがあります。米国以外のお客様への価格は、輸送費、各国の税金、手数料、為替レートにより決定されます。価格・納期等の詳細情報については、弊社正規販売代理店または担当営業にお問い合わせください。なお、 評価用ボードおよび評価用キットの表示価格は1個構成としての価格です。