最新情報 (1)
製品概要
機能と利点
- 柔軟性の高い再構成可能な共通プラットフォーム設計
- シングル、デュアル、クワッドバンドをサポート
- データパスおよびDSPブロックにより完全にバイパス可能
- マルチチップ同期機能搭載のオンチップPLL
- オフチップPLL用の外部RFクロック入力オプション
- 最大12GHzのクロック入力周波数に対応
- 最大4GSPSの最大ADCサンプル・レート
- JESD204C使用による最大4GSPSの最大データ・レート
- 8GHzのアナログ入力帯域幅（−3dB）
- ADCのAC性能（4GSPS時）
- 差動入力電圧：1.4Vp-p
- ノイズ密度：−151.5dBFS/Hz
- HD2：−69dBFS（2.7GHz、AIN = −1dBFS時）
- HD3：−76dBFS（2.7GHz、AIN = −1dBFS時）
- その他の最大高調波歪み（HD2とHD3を除く）：2.7GHzで−79dBFS
- 補助機能
- 位相コヒーレント高速周波数ホッピング
- 分周比を選択可能なADCクロック・ドライバ
- 温度モニタリング・ユニット内蔵
- 柔軟性に優れたGPIOxピン
- 汎用デジタル機能
- 選択可能なデシメーション・フィルタ
- 設定可能なDDC
- 8つの微調整・複素DDCと4つの粗調整・複素DDC
- DDCあたり48ビットNCOを内蔵
- レシーバーのイコライゼーション用にプログラマブルな192タップPFIRフィルタ
- GPIOを介して4つの異なるプロファイル設定をロード可能
- データパスごとにプログラマブルな遅延
- AGC対応レシーバー
- 高速AGC制御用の低遅延・高速検出
- 低速AGC制御用の信号監視
- 専用のAGC対応ピン
- SERDES JESD204B/JESD204Cインターフェース、8レーン、最大24.75Gbps
- ADCあたり8レーン
- 8レーンJESD204B/JESD204C Tx（JTx）
- 実数または複素数のデジタル・データ（8、12、16、または24ビット）に対応
- 15mm × 15mm、0.8mmピッチ、324ボールBGA
製品概要
AD9209は、クワッド12ビット、4GSPS A/Dコンバータ（ADC）です。ADC入力はオンチップの広帯域バッファと過負荷保護機能を使用しています。最大で8GHzの広帯域信号をダイレクト・サンプリングできるアプリケーションをサポートするように設計されています。オンチップ低位相ノイズのフェーズ・ロック・ループ（PLL）・クロック・シンセサイザは、ADCサンプリング・クロックを生成でき、高周波数クロック信号のプリント回路基板（PCB）分配を簡略化します。クロック出力バッファは、ADCサンプリング・クロックを他のデバイスに送信するために使用できます。
クワッドADCコアは1 × 10−20より良いコード誤差率（CER）を示します。低遅延高速検出および信号モニタリングは自動ゲイン制御（AGC）目的で使用できます。柔軟性に優れた192タップのプログラマブル有限インパルス応答（PFIR）フィルタはデジタル・フィルタリングやイコライゼーションで使用されます。プログラマブルなインテジャーおよびフラクショナルの遅延ブロックはアナログ遅延のミスマッチに対する補償をサポートします。
デジタル信号処理（DSP）ブロックは、1対のADCあたり2つの粗調整デジタル・ダウン・コンバータ（DDC）と4つの微調整DDCを備えています。各ADCはマルチバンド・アプリケーションに対応した1つまたは2つのメインDDC段で動作します。4つの追加微調整DDC段でADCあたり最大4つの帯域をサポートできます。各DDCと関連付けられた48ビット数値制御発振器（NCO）は、高速周波数ホッピング（FFH）をサポートすると同時に、汎用の入出力（GPIOx）ピンまたはシリアル・ポート・インターフェース（SPI）を介して選択された最大16の固有周波数の割り当てとの同期を維持します。
AD9209は、JESD204BまたはJESD204Cサブクラスの動作に合わせて構成可能な1つまたは2つのJTxリンクをサポートします。これにより、各ADCで異なるデータパス構成が可能になります。マルチデバイス同期は、SYSREF±入力ピンを通してサポートされています。
アプリケーション
- ワイヤレス通信インフラストラクチャ
- マイクロ波のポイントtoポイント、Eバンド、および5Gミリ波
- 広帯域通信システム
- DOCSIS 3.1および4.0 CMTS
- フェーズド・アレイ・レーダーおよび電子戦
- 電子テストおよび計測システム
製品カテゴリ
製品ライフサイクル
新規設計にお薦めします
発売済みの製品です。データシートには、最終的な仕様と動作条件がすべて記載されています。新規の設計には、これらの製品の使用を推奨します。
評価キット (2)
参考資料
-
DAC/ADCとDSPの統合ICにより、広帯域マルチチャンネル・システムの性能を改善する5/1/2021
-
マルチチップ同期機能を活用し、広帯域対応のDAC/ADCをデタミニスティックな位相で起動する10/1/2020
-
次世代電子戦用レシーバーの実現を可能にする28nmプロセスのADC6/29/2018
-
広帯域RFレシーバー・アーキテクチャ・オプションの検討2/1/2017
-
MxFE評価用プラットフォームのデモ・シリーズ4/24/2023シリーズ
ツールおよびシミュレーション
Software and Simulation
IBIS Models
S-Parameters
ZIP
AD9081/AD9082/AD9986/AD9988 RFIO Models
2.22 M
Keysight ADS workbook and s-parameter files for simulating the frequency response of the AD908x DAC, ADC, and CLK interfaces. See Application note AN-2065: Optimizing RF performance of the AD9081 and AD9082” for instructions on how to use the models.
設計ツール
MxFE JESD204 Mode Selector Tool (Rev. F)
The JESD204B/C Mode Selector Tool is a simple command line-based Windows executable that can be used to narrow down the number of JESD204x modes to only include those modes that support the user’s specific application use case. The tool guides the user through a use case description flow chart and gives the user a small list of applicable transmit and/or receive modes to choose from. This tool is applicable to the AD9081, AD9082, AD9177, AD9207, AD9209, AD9986, and AD9988.
Companion Transport Layer RTL Code Generator Tool (Rev. 1.0)
This command line executable tool generates a Verilog module which implements the JESD204 receive transport layer. The user specifies in a configuration file one or more modes to be supported by the transport layer module. These modes are defined as a set of JESD204 parameter values: L, M, F, S, N', and CF. The transport layer converts JESD204 lane data output from a JESD204 link layer IP to a data bus with a fixed width, containing interleaved virtual converter samples. Both JESD204B and JESD204C link layers are supported.
JESD204x Frame Mapping Table Generator
The JESD204x Frame Mapping Table Generator tool consists of two Windows executables that will allow the user to input any valid combination of JESD204x parameters (L, M, F, S, NP) in order to output a .csv file that illustrates the frame mapping of the JESD204x mode in table format. There is an executable that allows the user to input a single JESD204x mode and another, that allows the user to input the parameters for multiple JESD204x modes in a specified .csv format in order to output a .csv file that illustrates the frame mapping of each of the JESD204x modes that were input into separate tables.
ADIsimPLL™
アナログ・デバイセズの新しい高性能PLL製品を迅速かつ確実に評価できるツールです。現在利用できるツールの中で、最も総合的なPLLシンセサイザーの設計／シミュレーション・ツールです。実施されるシミュレーションには、主要な非線形効果が含まれており、これはPLLの性能に大きく影響を及ぼします。ADIsimPLLによって、設計プロセスの繰り返し作業が1つ以上排除されるため、設計から製品の市場投入までの期間が大幅に短縮することができます。
おすすめ製品
AD9209 コンパニオン製品
設計リソース
アナログ・デバイセズでは、最高レベルの品質と信頼性を備えた製品を提供することに最大の力を常に注いでいます。これを実現するため、製品およびプロセスの設計のあらゆる観点で品質と信頼性のチェックを行っています。そして、それは、製造工程においても同様です。アナログ・デバイセズは常に、出荷製品の「ゼロ・ディフェクト」を目指しています。詳細についてはアナログ・デバイセズの品質および信頼性プログラム/認定証をご覧ください。
| 製品番号 | 材料宣誓書（MD） | 信頼性データ | ピン/パッケージ図 | CADシンボル、フットプリント & 3Dモデル |
|---|---|---|---|---|
| AD9209BBPZ-4G | 材料宣誓書（MD） | 信頼性データ | 324-Ball BGA_ED (15mm x 15mm x 1.58mm) | |
| AD9209BBPZRL-4G | 材料宣誓書（MD） | 信頼性データ | 324-Ball BGA_ED (15mm x 15mm x 1.58mm) | |
| ウェハ・ファブリケーション・データ |
サポート ＆ ディスカッション
AD9209 Discussions
RE: Kernel boot failure when adding a new/custom devicetree with petalinux
2 週間前 Linux Software Drivers
RE: AD9209 Sampling / Channel
12 週間前 Speed ADCs
サンプル＆購入
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リードタイム
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評価用ボード
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analog.comサイトから購入できるボードは、最大で2枚までとなります。3枚以上の購入をご希望の場合は、正規販売代理店からご購入ください。
価格は1個当たりの米ドルで、米国内における販売価格（FOB）で表示されておりますので、予算のためにのみご使用いただけます。 また、その価格は変更されることがあります。米国以外のお客様への価格は、輸送費、各国の税金、手数料、為替レートにより決定されます。価格・納期等の詳細情報については、弊社正規販売代理店または担当営業にお問い合わせください。なお、 評価用ボードおよび評価用キットの表示価格は1個構成としての価格です。