概览

优势和特点

  • −3 dB 带宽≥ 7.5 GHz的缓冲输入
    • 满量程1.4 V p-p(RIN = 100 Ω)
    • 过载保护箝位
    • 支持具有共模反馈的直流耦合
  • fIN < 2.6 GHz时的交流性能
    • HD2 < −63 dBc和HD3 < −67 dBc
    • 小信号(−12 dBFS)噪声谱密度(NSD) = -153 dBFS/Hz
  • 低误码率 (CER) < 2 × −10−15
  • 灵活的ADC时钟选项
    • 片内PLL或外部RF时钟
  • 多种数字功能
  • 可配置数字下变频(DDC)
    • 每ADC 2个粗调复数DDC
    • 每ADC 4个精调复数DDC
  • 可编程192抽头FIR滤波器
  • 针对数字预失真(DPD)或IQ失配的整数/小数采样延迟
  • 功耗:~ 4 W至5.5 W
  • 具有专用AGC支持引脚的自动增益控制(AGC)支持
    • 快速检测,低延迟,用于实现快速的AGC控制
    • 检测缓慢AGC控制的信号监测器
  • 辅助功能
    • 快速跳频
    • 具有可选分频比的ADC时钟驱动器
    • 片内温度传感器
    • 可编程GPIO引脚
  • JESD204B/C(子类1)接口,8通道
    • JESD204B兼容最大15.5 Gbps的通道速率
    • JESD204C兼容最大24.75 Gbps的通道速率
    • 样本/位重复模式,用于接收通道速率匹配
    • 支持真正或复杂的数字数据(12位、16位或24位)
    • 多芯片同步
  • 0.8 mm间距、15 mm x 15 mm BGA封装

产品详情

AD9207是一款双通道、12位6 GSPS模数转换器(ADC)。ADC输入集成了具有过载保护的片内宽带缓冲器。该器件设计支持通信应用,能够实现高达7.5 GHz的宽带信号直接采样。可选低相位噪声锁相环(PLL)时钟频率合成器可用于生成ADC采样时钟,从而简化高频时钟信号的印刷电路板(PCB)分配。或者,可使用ADC采样时钟(当内部时钟分频器使能时,高达12 GHz的更高版本)直接启动该器件的CLKIN。可选CLKOUT缓冲器可用于将ADC采样时钟发送至其他器件。

应用

  • 分集多频段和多模数字接收器
  • 微波点对点、E频段和5G毫米波
  • 宽带通信系统
  • 相控阵雷达和电子战
  • 电子测试与测量系统

产品生命周期 icon-recommended 预发布

本产品为新品,工程验证可能仍在进行中。我们正在准备量产,数量可能有限,设计规格可能会改变。

评估套件 (2)

工具及仿真模型

设计工具

MxFE JESD204 Mode Selector Tool

The JESD204B/C Mode Selector Tool is a simple command line-based Windows executable that can be used to narrow down the number of JESD204x modes to only include those modes that support the user’s specific application use case. The tool guides the user through a use case description flow chart and gives the user a small list of applicable transmit and/or receive modes to choose from. This tool is applicable to the AD9081, AD9082, AD9177, AD9207, AD9209, AD9986, and AD9988.

Companion Transport Layer RTL Code Generator Tool (Rev. 1.0)

This command line executable tool generates a Verilog module which implements the JESD204 receive transport layer. The user specifies in a configuration file one or more modes to be supported by the transport layer module. These modes are defined as a set of JESD204 parameter values: L, M, F, S, N', and CF. The transport layer converts JESD204 lane data output from a JESD204 link layer IP to a data bus with a fixed width, containing interleaved virtual converter samples. Both JESD204B and JESD204C link layers are supported.

JESD204x Frame Mapping Table Generator

The JESD204x Frame Mapping Table Generator tool consists of two Windows executables that will allow the user to input any valid combination of JESD204x parameters (L, M, F, S, NP) in order to output a .csv file that illustrates the frame mapping of the JESD204x mode in table format. There is an executable that allows the user to input a single JESD204x mode and another, that allows the user to input the parameters for multiple JESD204x modes in a specified .csv format in order to output a .csv file that illustrates the frame mapping of each of the JESD204x modes that were input into separate tables.

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