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ADF4001

200 MHz 时钟发生器PLL

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替代器件

ADF4002

鉴相器/PLL频率合成器

概览

优势和特点
产品详情

优势和特点

200 MHz带宽
电源电压范围：2.7 V至5.5 V
可编程电荷泵电流

三线式串行接口
硬件和软件掉电模式
模拟和数字锁定检测

产品详情

ADF4001频率合成器可用来实现要求极低噪声、稳定基准信号的PLL的时钟源。它由低噪声数字鉴频鉴相器(PFD)、精密电荷泵、可编程参考分频器和可编程13位N分频器组成。此外，14位参考分频器（R分频器）允许PFD输入端的REFIN频率为可选值。如果频率合成器与外部环路滤波器和电压控制振荡器(VCO)或电压控制晶体振荡器(VCXO)一起使用，则可以实现完整的锁相环(PLL)。N的最小值为1，这为时钟产生提供了灵活性。

产品分类

时钟与定时
- 整数 N PLL

射频和微波
- 整数N分频PLL

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产品生命周期量产

该产品系列中至少有一个型号已量产并可供采购。该产品适合用于新设计，但也可能有更新的替代产品。

评估套件 (1)

EVAL-ADF4001

ADF4001 评估板

文档

数据手册 (1)

ADF4001: 200 MHz Clock Generator PLL Data Sheet (Rev. B)

应用笔记 (4)

AN-30: 应用工程师答问—30

AN-873: ADF4xxx系列PLL频率合成器的锁定检测 (Rev. 0)

AN-873: Lock Detect on the ADF4xxx Family of PLL Synthesizers (Rev. 0)

Ask the Applications Engineer - PLL Synthesizers (Rev. AN-30)

用户手册 (4)

UG-092: The PLL Frequency Synthesizer Evaluation Board for the ADF4001

UG-476: PLL Software Installation Guide

UG-476：PLL软件安装指南

UG-092: ADF4001 PLL频率合成器评估板

软件代码及系统需求

FPGA/HDL

BeMicro FPGA Project for ADF4001 with Nios driver

ADF4001 FMC-SDP Interposer & Evaluation Board / Xilinx KC705 Reference Design

工具及仿真模型

设计工具

ADIsimRF

ADI公司的ADIsimRF设计工具可以计算RF信号链内的大部分重要参数，包括级联增益、噪声系数、IP3、P1dB和总功耗。

ADIsimPLL™

ADIsimPLL 可以对ADI公司的最新高性能PLL产品进行快速、可靠的评估。它是目前最全面的PLL频率合成器设计和仿真工具，可实现所有对PLL性能有显著影响的重要非线性效应仿真。ADIsimPLL可以免去设计过程中的至少一项重复劳动，从而加快上市速度。

配套产品推荐

ADF4001 配套产品

推荐 Linear Regulators

For ultalow noise, 3V applications, 200 mA output: ADP151.
For ultralow noise, 3V applications,150 mA output: ADP150.
For high accuracy, 5V applications: ADP3334.
For a step up, 3V to 5V regulator: ADP1613.

推荐 Divide-by-4 Prescaler

For a low noise, low power, fixed RF block: ADF5001.

推荐 Modulators/Demodulators

For broadband quadrature IF/RF signals: ADL5375, ADL5380.

推荐 PLL Active Filter

For an ultralow noise, rail-to-rail amplifier: OP184.

推荐 RF Mixers

For 10 MHz to 6 GHz, high dynamic range active mixers: ADL5801, ADL5802.

参考资料

产品选型手册 (1)

RF和微波IC选型指南2015

技术文章 (1)

用于高频接收器和发射器的锁相环——第二部分

模拟对话 (4)

Ask the Applications Engineer—30: PLL Synthesizers

用于高频接收器和发射器的锁相环——第三部分

用于高频接收器和发射器的锁相环——第二部分

用于高频接收器和发射器的锁相环——第一部分

在线研讨会 (2)

Fundamentals of Frequency Synthesis, Part 1: Phased Locked Loops

Fundamentals of Frequency Synthesis, Part 2: Direct Digital Synthesis (DDS)

设计资源

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质量和可靠性

原理图符号和PCB封装

PCN-PDN信息

申请产品/工艺变更通知

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