LTC6950
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LTC6950

具有时钟分配功能的 1.4GHz 低相位噪声、低抖动 PLL

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产品详情
产品模型 1
特性
  • 低相位噪声和抖动
  • 附加抖动:18fsRMS (12kHz 至 20MHz)
  • 附加抖动:85fsRMS (10Hz 至 奈奎斯特频率)
  • EZSync 多芯片时钟边沿同步
  • 具有锁定指示器的完整 PLL 内核
  • -226dBc/Hz 归一化带内相位噪声层
  • -274dBc/Hz 归一化 1/f 相位噪声
  • 1.4GHz 最大 VCO 输入频率
  • 四个独立的低噪声 1.4GHz LVPECL 输出
  • 一个 LVDS/CMOS 可配置输出
  • 5 个可独立地编程的分频器 (覆盖从 1 至 63 的所有整数)
  • 5 个可独立地编程的 VCO 时钟周期延迟 (覆盖从 0 至 63 的所有整数)
  • -40°C 至 105°C 结温范围
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LTC®6950 是一款具时钟分配功能的低相位噪声整数 N 频率合成器内核。LTC6950 可提供高频、高分辨率数据采集系统中所需的低相位噪声时钟信号。

频率合成器包含一个完整的低噪声 PLL 内核,以及一个可编程基准分频器 (R)、一个可编程反馈分频器 (N)、一个相位 / 频率检测器 (PFD) 和一个低噪声充电泵 (CP)。LTC6950 的时钟分配部分提供了多达 5 个基于 VCO 输入的输出。每个输出进行个别编程,以利用从 1 至 63 的任何整数对 VCO 输入频率进行分频,并使输出延迟 0 至 63 个 VCO 时钟周期。其中的 4 个输出具有能够在高达 1.4GHz 频率下运作的非常低噪声、低偏斜 LVPECL 逻辑信号。第 5 个输出可选择为 LVDS (800MHz) 或 CMOS (250MHz) 逻辑类型。另外,还通过编程使该输出产生一个基于 VCO 输入或基准分频器输出的输出信号。


Applications
  • 对高速、高分辨率 ADC、DAC 和数据采集系统进行定时
  • 低抖动时钟产生和分配
产品模型 1

产品技术资料帮助

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参考资料

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产品型号 引脚/封装图-中文版 文档 CAD 符号,脚注和 3D模型
LTC6950IUHH#TRPBF
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软件和型号相关生态系统

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评估套件

评估套件 1

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DC1795A

LTC6950演示板|具有5路输出的整数N分频PLL(需要DC590或DC2026)

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DC1795A

LTC6950演示板|具有5路输出的整数N分频PLL(需要DC590或DC2026)

LTC6950演示板|具有5路输出的整数N分频PLL(需要DC590或DC2026)

产品详情

演示电路1795A内置具有时钟分配功能的1.4GHz低相位噪声、低抖动PLL LTC6950。为方便使用,DC1795A配备100MHz基准电压源以及具有正弦波输出的1GHz压控SAW振荡器VCSO。所有差分输入和输出均具有0.5"间距SMA连接器。DC1795A具有四个采用50Ω传输线路进行交流耦合的LVPECL输出,使其适合驱动50Ω阻抗仪器。LVDS/CMOS输出采用直流耦合。LTC6950通过转台和SMA连接器提供EZSync™功能。

工具和仿真

工具及仿真模型 2

Linduino

Linduino是ADI公司的Arduino兼容系统,用于开发和分配面向集成电路的固件库和示例代码。每个支持Linduino的产品包括示例主程序(在LTSketchbook/产品型号文件夹中定义)和驱动程序代码(在LTSketchbook/库文件夹中定义)。

GitHub上的Linduino代码存储库以及有关如何使用代码的说明

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