ADF4193
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ADF4193

低相位噪声、快速建立PLL频率合成器

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产品详情
特性
  • 新型快速建立小数N分频PLL结构
  • 单个PLL可取代乒乓式频率合成器
  • 在5 µs内完成整个GSM频段上的跳频,相位建立时间为20 µs
  • 相位误差:0.5°均方根值(2 GHz RF输出)
  • 数字可编程输出相位
  • RF输入范围最高可达3.5 GHz
  • 三线式串行接口
  • 片内低噪声差分放大器
  • 相位噪声品质因数:–216 dBc/Hz
  • 利用ADIsimPLL可实现环路滤波器设计
  • 通过汽车应用认证

更多细节
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ADF4193频率合成器可以用来在无线接收机和发射机的上变频和下变频部分实现本振,其结构经过特别设计,符合基站的GSM/EDGE锁定时间要求。它由低噪声数字鉴频鉴相器(PFD)和精密差分电荷泵组成。还有一个差分放大器,用来将电荷泵的差分输出转换为外部电压控制振荡器(VCO)的单端电压。

Σ-Δ型小数插值器与N分频器一起使用,能够实现可编程模数小数N分频。此外,4位参考(R)分频器和片内倍频器允许PFD输入端的参考信号(REFIN)频率为可选值。如果频率合成器与外部环路滤波器和VCO一起使用,则可以实现完整的锁相环(PLL)。开关结构确保PLL能在GSM时隙保护期间内建立,而无需第二PLL及相关的隔离开关。与以前的乒乓式GSM PLL结构相比,这种结构能节省成本,降低复杂度,减小PCB面积,并减少屏蔽和特性测试工作。

应用
- GSM/EDGE基站
- PHS基站
- 仪器仪表和测试设备

产品技术资料帮助

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ADI公司所提供的资料均视为准确、可靠。但本公司不为用户在应用过程中侵犯任何专利权或第三方权利承担任何责任。技术指标的修改不再另行通知。本公司既没有含蓄的允许,也不允许借用ADI公司的专利或专利权的名义。本文出现的商标和注册商标所有权分别属于相应的公司。

参考资料

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产品型号 引脚/封装图-中文版 文档 CAD 符号,脚注和 3D模型
ADF4193BCPZ
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ADF4193BCPZ-RL
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ADF4193BCPZ-RL7
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ADF4193WCCPZ-RL7
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产品生命周期

PCN

7月 5, 2022

- 21_0271

Qualification of an Alternate Adhesive Material and Molding Compound for Select LFCSP Packages

10月 18, 2016

- 16_0036

Assembly Relocation to Stats ChipPAC Jiangyin and Test Transfer to Stats ChipPAC Singapore of Select LFCSP Products

8月 6, 2014

- 13_0230

Assembly and Test Transfer of Select 3.5x3.5, 4x3, 4x4, and 5x5mm LFCSP Products to STATS ChipPAC China

3月 7, 2012

- 10_0241

Conversion of LFCSP package outline from Punch to Sawn of package sizes 4x4, 5x5, 6x6 and 7x7mm and a transfer of assembly site.

5月 4, 2016

- 14_0178

Conversion of 3x3mm, 4x4mm and 5x5mm LFCSP Package Outlines from Punch to Sawn and Transfer of Assembly Site to Amkor Philippines

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软件和型号相关生态系统

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评估套件

评估套件 1

EVAL-ADF4193

ADF4193 评估板

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EVAL-ADF4193

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产品详情

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该评估板需使用SDP控制器版以连接PC。SDP控制器板通过USB 2.0连接至PC。评估板将连接至SDP控制器板。评估板无法直接连接至PC。在PC上运行的评估软件通过SDP控制器板与评估板通信。SDP控制器板在以下订购指南中单独列出(EVAL-SDP-CS1Z)。如果以前未购买过SDP控制器板,请购买该产品以确保获得完整的评估设置。

工具和仿真

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