製品概要
機能と利点
- ノーミッシング・コードが保証された12ビット、2.5GSPSのADC
- SFDR=79dBc@AIN=~1GHz@2.5GSPS(-1dBFS)
- SFDR=77dBc@AIN=~1.8GHz@2.5GSPS(-1dBFS)
- SNR=57.6dBFS@AIN=~1GHz@2.5GSPS(-1dBFS)
- SNR=57dBFS@AIN=~1.8GHz@2.5GSPS(-1dBFS)
- ノイズ・スペクトラム密度=
-149.5dBFS/Hz@2.5GSPS - 差動アナログ入力:1.2V p-p
- 差動クロック入力
- アナログ入力帯域幅:3.2GHz(フルパワー)
- 高速6または8レーンのJESD-204Bシリアル出力、
サブクラス1:6.25Gbps@2.6GSPS - 10ビットNCOを持つ、8または16の、2つの独立したデシメーション・フィルタ
- 電源電圧:1.3V、2.5V
- 柔軟なデジタル出力モード
- 選択可能なデジタル・テスト・パターンを内蔵
- タイムスタンプ機能
- 変換誤差率:< 10−15
製品概要
AD9625は、12ビットのモノリシック・サンプリングA/Dコンバータ(ADC)で、秒あたり最大2.6ギガ・サンプル(GSPS)までの変換レートで動作します。この製品は、2ndナイキスト領域までの広帯域アナログ信号をサンプリングするために設計されています。AD9625の広い入力帯域幅、高いサンプリング・レートおよび優れた直線性の組み合わせは、スペクル・アナライザー、データ・アクイジション・システムおよびレーダや電子妨害システム(EMC)のような軍用電子アプリケーションにとって最適となっています。
アナログ入力、クロック並びにSYSREF±信号は、差動の入力となっています。JESD204Bベースの高速シリアル出力は、1、2、4、6レーンまたは8レーン配置のさまざまな構成が可能となっています。このデバイスは、工業用温度範囲-40℃~+85℃にわたって仕様規定されています。
製品のハイライト
- 高性能: 高サンプル・レートのアプリケーションでの並外れたSFDR、ダイレクト・サンプリングおよび内蔵リファレンス
- JESD204B仕様に基づいた、柔軟なデジタル・データ出力フォーマット
- 制御経路SPIインターフェース・ポートは、データのフォーマッティング、ゲインとオフセットの調整のような、さまざまな製品の特性と機能をサポート
アプリケーション
- スペクトル・アナライザ
- 軍用通信
- レーダ
- 高性能デジタル・ストレージ・オッシロスコープ(DSO)
- アクティブ電波妨害/対妨害システム
- 電子監視と防衛システム
製品カテゴリ
マーケット&テクノロジー
製品ライフサイクル
新規設計にお薦めします
発売済みの製品です。データシートには、最終的な仕様と動作条件がすべて記載されています。新規の設計には、これらの製品の使用を推奨します。
評価キット (6)
参考資料
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AD-FMCADC2-EBZ FMC Board User Guide1/19/2016WIKI
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シリアル・インターフェース標準規格JESD2043/5/2015
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Validating ADI Converters Inter-operability with Xilinx FPGA and JESD204B/C IP4/10/2017PDF510 K
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Altera AN-712 (AD9625 Stratix5)10/13/2014
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「マイクロウェーブ展」に出展9/20/2019
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高帯域幅とダイナミックレンジに対応する2.6GHz A/Dコンバータ「AD9625BBP-2.6」を発表9/20/2019
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2.5GSPSのA/Dコンバータ「AD9625-2.5」、ドライバ・アンプおよびプロトタイピング用FMCモジュールを発表9/20/2019
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業界最高性能を提供する2GSPSデータ・コンバータ「AD9625」を発表9/20/2019
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JESD204B サブクラス (パート2): サブクラス 1 対サブクラス2 システムの考慮事項10/1/2019
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JESD204B のサブクラス (パート1): JESD204B サブクラスとデターミニスティック・レーテンシーの紹介10/1/2019
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従来の半分のスペースでGSPSサンプリングADCに低ノイズ電源を供給するSilent Switcher μModuleレギュレータ11/2/2018
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アナログ・ヒント – ADCのデシメーション11/15/2017
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Use Noise Spectral Density to Evaluate ADCs in Software-Defined Systems6/1/2017
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デジタル・ダウンコンバータを理解する 【Part1】7/1/2016 アナログ・ダイアログ
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Aerospace and Defense Mobilize Insatiable Bandwidth Applications1/1/2016
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インターリーブADCの“謎”を解き明かす7/1/2015 アナログ・ダイアログ
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Taming the Wideband Conundrum with RF Sampling ADCs5/1/2015
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RFサンプリングADCの入力保護4/1/2015 アナログ・ダイアログ
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A Test Method for Synchronizing Multiple GSPS Converters2/1/2015
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GSPS Data Converters to the Rescue for Electronics Surveillance and Warfare Systems!12/1/2014
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Demystifying the Conversion Error Rate of High Speed ADCs12/1/2014
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Maximizing the Dynamic Range of Software-Defined Radio11/1/2014
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JESD204B の仕様における層を理解する − 高速 ADC の観点10/1/2014
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新たな課題を解決するGSPSレベルの高速ADC9/1/2014
-
広帯域 GSPS ADC のスプリアスフリー・ダイナミック・レンジを理解する8/1/2014
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The Demand for Digital: Challenges and Solutions for High Speed Analog to Digital Converters and Radar Systems6/1/2014
ソフトウェア & システム
評価用ソフトウェア
JESD204 Interface Framework
ツールおよびシミュレーション
Virtual Eval(仮想評価、 ベータ版)
Virtual Evalは、ADC、DAC、およびその応用製品評価を支援するウェブベースの設計ツールです。アナログ・デバイセズのサーバ上にあるモデルを使用して、重要な部品の性能特性をわずか数秒でシミュレートします。使用時は、入力トーンや外部ジッタなどの動作条件のほか、ゲインやデジタル・ダウンコンバージョンといったデバイス機能を設定してください。ノイズ、歪み、分解能、FFT、タイミング図、周波数応答プロット、その他さまざまな性能特性を確認することができます。

IBIS Models
MathWorks®
設計ツール
This command line executable tool generates a Verilog module which implements the JESD204 receive transport layer. The user specifies in a configuration file one or more modes to be supported by the transport layer module. These modes are defined as a set of JESD204 parameter values: L, M, F, S, N', and CF. The transport layer converts JESD204 lane data output from a JESD204 link layer IP to a data bus with a fixed width, containing interleaved virtual converter samples. Both JESD204B and JESD204C link layers are supported.
The JESD204x Frame Mapping Table Generator tool consists of two Windows executables that will allow the user to input any valid combination of JESD204x parameters (L, M, F, S, NP) in order to output a .csv file that illustrates the frame mapping of the JESD204x mode in table format. There is an executable that allows the user to input a single JESD204x mode and another, that allows the user to input the parameters for multiple JESD204x modes in a specified .csv format in order to output a .csv file that illustrates the frame mapping of each of the JESD204x modes that were input into separate tables.
VisualAnalog™は、高速ADCの選択や評価を行う設計者向けに、強力なシミュレーション/データ解析ツール・セットとユーザ・フレンドリなグラフィカル・インターフェースを組み合わせたソフトウェア・パッケージです。
アナログ・デバイセズのADIsimRF設計ツールは、カスケード・ゲインやノイズ指数、IP3、P1dB、総合消費電力などRFシグナル・チェーン内の最も重要なパラメータの計算を行います。
設計リソース
アナログ・デバイセズでは、最高レベルの品質と信頼性を備えた製品を提供することに最大の力を常に注いでいます。これを実現するため、製品およびプロセスの設計のあらゆる観点で品質と信頼性のチェックを行っています。そして、それは、製造工程においても同様です。アナログ・デバイセズは常に、出荷製品の「ゼロ・ディフェクト」を目指しています。詳細についてはアナログ・デバイセズの品質および信頼性プログラム/認定証をご覧ください。
製品番号 | 材料宣誓書(MD) | 信頼性データ | ピン/パッケージ図 | CADシンボル、フットプリント & 3Dモデル |
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AD9625BBP-2.5 | 材料宣誓書(MD) | 信頼性データ | 196-Ball BGA (12mm x 12mm) | |
AD9625BBP-2.6 | 材料宣誓書(MD) | 信頼性データ | 196-Ball BGA (12mm x 12mm) | |
AD9625BBPRL-2.5 | 材料宣誓書(MD) | 信頼性データ | 196-Ball BGA (12mm x 12mm) | |
AD9625BBPRL-2.6 | 材料宣誓書(MD) | 信頼性データ | 196-Ball BGA (12mm x 12mm) | |
AD9625BBPZ-2.0 | 材料宣誓書(MD) | 信頼性データ | 196-Ball BGA (12mm x 12mm) | |
AD9625BBPZ-2.5 | 材料宣誓書(MD) | 信頼性データ | 196-Ball BGA (12mm x 12mm) | |
AD9625BBPZ-2.6 | 材料宣誓書(MD) | 信頼性データ | 196-Ball BGA (12mm x 12mm) | |
AD9625BBPZRL-2.0 | 材料宣誓書(MD) | 信頼性データ | 196-Ball BGA (12mm x 12mm) | |
AD9625BBPZRL-2.5 | 材料宣誓書(MD) | 信頼性データ | 196-Ball BGA (12mm x 12mm) | |
AD9625BBPZRL-2.6 | 材料宣誓書(MD) | 信頼性データ | 196-Ball BGA (12mm x 12mm) | |
ウェハ・ファブリケーション・データ |
PCN-PDN情報
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AD9625 Discussions
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(*)価格は1Ku当たりの米ドルで、米国内における販売価格(FOB)で表示されておりますので、予算のためにのみご使用いただけます。また、その価格は変更されることがあります。米国以外のお客様への価格は、輸送費、各国の税金、手数料、為替レートにより決定されます。価格・納期等の詳細情報については、弊社正規販売代理店. または担当営業にお問い合わせください。なお、 評価用ボードおよび評価用キットの表示価格は1個構成としての価格です。
リードタイム
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評価用ボード
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analog.comサイトから購入できるボードは、最大で2枚までとなります。3枚以上の購入をご希望の場合は、正規販売代理店からご購入ください。
価格は1個当たりの米ドルで、米国内における販売価格(FOB)で表示されておりますので、予算のためにのみご使用いただけます。 また、その価格は変更されることがあります。米国以外のお客様への価格は、輸送費、各国の税金、手数料、為替レートにより決定されます。価格・納期等の詳細情報については、弊社正規販売代理店または担当営業にお問い合わせください。なお、 評価用ボードおよび評価用キットの表示価格は1個構成としての価格です。