AD6672

新規設計に推奨

IFレシーバ

データシート (Rev. C) 製品セレクション・テーブル
製品モデル
2
1Ku当たりの価格
最低価格：$56.75
利用上の注意

アナログ・デバイセズ社は、提供する情報が正確で信頼できるものであることを期していますが、その情報の利用に関して、あるいはその利用によって生じる第三者の特許やその他の権利の侵害に関して一切の責任を負いません。また、アナログ･デバイセズ社の特許または特許の権利の使用を明示的または暗示的に許諾するものでもありません。仕様は予告なしに変更する場合があります。本紙記載の商標および登録商標は、各社の所有に属します。


本データシートの英語以外の言語への翻訳はユーザの便宜のために提供されるものであり、リビジョンが古い場合があります。最新の内容については、必ず最新の英語版をご参照ください。

なお、日本語版のデータシートは基本的に「Rev.0」（リビジョン0）で作成されています。そのため、英語版が後に改訂され、複数製品のデータシートがひとつに統一された場合、同じ「Rev.0」の日本語版のデータシートが異なる製品のデータシートとして表示されることがあります。たとえば、「ADM3307E」の場合、日本語データシートをクリックすると「ADM3311E」が表示されます。これは、英語版のデータシートが複数の製品で共有できるように1本化され、「ADM3307E/ADM3310E/ADM3311E/ADM3312E/ADM3315E」（Rev.G）と改訂されたからで、決して誤ってリンクが張られているわけではありません。和文化されたデータシートを少しでも有効に活用していただくためにこのような方法をとっておりますので、ご了解ください。
Viewing:

製品の詳細

  • 11ビット、250MSPSの出力データレート
  • NSRイネーブル時の性能
    • SNR：250MSPSで185MHzまで55MHzバンドで75.2dBFS
    • SNR：250MSPSで185MHzまで82MHzバンドで72.8dBFS
  • NSRディスエーブル時の性能
    • SNR：250MSPSで185MHzまで66.4dBFS
    • SFDR：250MSPSで185MHzまで87dBc
  • 総合消費電力：250MSPSで358mW
  • 電源電圧：1.8V
  • LVDS（ANSI-644レベル）出力
  • 整数1～8の入力クロック分周器を内蔵（最大入力625MHz）
  • ADC用リファレンス電圧を内蔵
  • 柔軟なアナログ入力範囲：1.4Vp-p～2.0Vp-p（標準1.75Vp-p）
  • 350MHz帯域幅を持つ差動アナログ入力
  • シリアル・ポート制御
  • 省電力のパワーダウン・モード
  • ユーザー設定可能なビルトイン・セルフテスト（BIST）機能
AD6672
IFレシーバ
AD6672 Functional Block Diagram AD6672 Pin Configuration
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サポート

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ドキュメント

データシート 1

ユーザ・ガイド 2

アプリケーション・ノート 11

技術記事 1

評価用設計ファイル 1

よく聞かれる質問 1

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ソフトウェア・リソース

評価用ソフトウェア 1

JESD204x Frame Mapping Table Generator

The JESD204x Frame Mapping Table Generator tool consists of two Windows executables that will allow the user to input any valid combination of JESD204x parameters (L, M, F, S, NP) in order to output a .csv file that illustrates the frame mapping of the JESD204x mode in table format. There is an executable that allows the user to input a single JESD204x mode and another, that allows the user to input the parameters for multiple JESD204x modes in a specified .csv format in order to output a .csv file that illustrates the frame mapping of each of the JESD204x modes that were input into separate tables.

ハードウェア・エコシステム

製品モデル 製品ライフサイクル 詳細
クロック生成デバイス 6
AD9510
新規設計に推奨 クロック分配器、1.2 GHz、PLL内蔵、分周器内蔵、遅延調整、8出力
AD9511
新規設計に推奨 クロック分配器、800MHz、PLL内蔵、分周器内蔵、遅延調整、5出力
AD9512
新規設計に推奨 クロック分配IC、1.2GHz、2つの1.6GHz入力、分周器／遅延調整内蔵、5出力
AD9523
新規設計には非推奨 クロック・ジェネレータ、14出力、低ジッタ
AD9523-1
新規設計に推奨 クロック生成器、低ジッタ、14LVPECL/LVDS/HSTL/29LVCMOS出力
AD9524
新規設計には非推奨 クロック・ジェネレータ、6出力、デュアル・ループ
クロック分配器 （クロック・ディストリビューション） 3
AD9513
新規設計に推奨 クロック分配IC、800 MHz、分周機能、遅延調整機能、3出力
AD9514
新規設計に推奨 クロック分配IC、1.6GHz、分周器、遅延調整、3出力
AD9515
新規設計に推奨 1.6 GHZクロック分配IC、ドライバ、遅延調整、2出力
シングルエンド入力差動出力アンプ 2
ADA4927-1
新規設計に推奨 差動アンプ、ADC ドライバ、超低歪み、電流帰還型
ADA4938-1
新規設計に推奨 ADCドライバ、差動、超低歪み、シングル
デジタル制御VGA 2
ADL5202
製造中止 VGA（可変ゲイン・アンプ）、デジタル制御、広ダイナミック範囲、高速
AD8376
新規設計に推奨 VGA、デュアル、超低歪
完全差動アンプ 1
ADL5562
新規設計に推奨 RF/IF用差動アンプ、超低歪み、3.3 GHz
Modal heading
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ツールおよびシミュレーション

Virtual Eval（仮想評価、 ベータ版）

Virtual Evalは、ADC、DAC、およびその応用製品評価を支援するウェブベースの設計ツールです。アナログ・デバイセズのサーバ上にあるモデルを使用して、重要な部品の性能特性をわずか数秒でシミュレートします。使用時は、入力トーンや外部ジッタなどの動作条件のほか、ゲインやデジタル・ダウンコンバージョンといったデバイス機能を設定してください。ノイズ、歪み、分解能、FFT、タイミング図、周波数応答プロット、その他さまざまな性能特性を確認することができます。

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AD6672 IBIS Model 1

ADC Companion Transport Layer RTL Code Generator Tool

This command line executable tool generates a Verilog module which implements the JESD204 receive transport layer. The user specifies in a configuration file one or more modes to be supported by the transport layer module. These modes are defined as a set of JESD204 parameter values: L, M, F, S, N', and CF. The transport layer converts JESD204 lane data output from a JESD204 link layer IP to a data bus with a fixed width, containing interleaved virtual converter samples. Both JESD204B and JESD204C link layers are supported.

ツールを開く

Visual Analog

VisualAnalog™は、高速ADCの選択や評価を行う設計者向けに、強力なシミュレーション／データ解析ツール・セットとユーザ・フレンドリなグラフィカル・インターフェースを組み合わせたソフトウェア・パッケージです。

ツールを開く

Sパラメータ 1

評価用キット

EVAL-AD9642

AD9642 Evaluation Board

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機能と利点

  • Full featured evaluation board for the AD9642/AD9634/AD6672
  • SPI interface for setup and control
  • External or AD9523 clocking option
  • Balun/transformer or amplifier input drive option
  • LDO regulator power supply
  • VisualAnalog and SPI controller software interfaces

製品詳細

The AD9642, AD9634, and AD6672 evaluation board, which provides all of the support circuitry required to operate the AD9642, AD9634, and AD6672 in their various modes and configurations. The application software used to interface with the devices is also described.

The AD9642, AD9634, and AD6672 data sheets provide additional information and should be consulted when using the evaluation board. All documents and software tools are available at http://www.analog.com/fifo. For additional information or questions, send an email to highspeed.converters@analog.com.

eval board
schematic 1
HSC-ADC-EVALCZ

FPGAベースのデータ・キャプチャ・キット

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機能と利点

  • FIFO深さ：64kB
  • シングル/マルチ・チャンネルADCで動作
  • VisualAnalog® ソフトウェアで使用
  • Virtex-4 FPGAベースのキット
  • ADCの評価ボードによってはインターフェース用のアダプタが必要になる場合があります。
  • 各チャンネルによりSPI制御 最大644 MSPS SDR / 800MSPS DDRのエンコード・レートでのプログラムが可能
  • 各チャンネルはDDRのエンコード・レート

製品詳細

HSC-ADC-EVALCZ 高速コンバータ評価用プラットフォームは、アナログ・デバイセズの高速 A/D コンバータ（ADC）評価用ボードからのデジタル・データのブロックをキャプチャする FPGA ベースのバッファ・メモリ・ボードを使用しています。このボードは、USB ポートを介して PC に接続し、VisualAnalog® とともに使用して、高速 ADC の性能を短時間で評価します。この評価用キットはセットアップが容易です。その他の必要な装置には、アナログ・デバイセズの高速 ADC 評価用ボード、信号源、クロック源などがあります。キットを接続して電源を投入すると、PC で即座に評価することができます。

EVAL-AD6672

AD6672 Evaluation Board

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機能と利点

  • Full featured evaluation board for the AD6672
  • SPI interface for setup and control
  • External or AD9523 clocking option
  • Balun/transformer or amplifier input drive option
  • LDO regulator power supply
  • VisualAnalog and SPI controller software interfaces

製品詳細

This page contains evaluation board documentation and ordering information for evaluating the AD6672.
EVAL-AD9642
AD9642 Evaluation Board
HSC-ADC-EVALCZ
FPGAベースのデータ・キャプチャ・キット
High_Speed_ADC_evalboard_05
EVAL-AD6672
AD6672 Evaluation Board

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