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AD9514：クロック分配IC、1.6GHz、分周器、遅延調整、3出力 (Rev. 0)9/8/2008PDF1472 kB
製品概要
機能と利点
- 1.6GHz差動クロック入力
- 3つのプログラマブル分周器
- 1～32の整数に対応
- 位相選択で出力間の遅延粗調整を実現
- 2つの独立した1.6GHz LVPECLクロック出力
- LVPECL加法的広帯域出力ジッタ、225fs rms
- 独立した1つのLVDS/CMOS出力（800MHz/250MHz）
- LVDS/CMOS加法的広帯域出力ジッタ（300fs rms/290fs rms）
- 最大10nsの遅延
- デバイスを4レベルのロジック・ピンで設定
- 省スペース、32ピンLFCSP
製品概要
AD9514はマルチ出力クロック分配ICであり、データ・コンバータの性能を最大限に引き出すために低ジッタと低位相ノイズに重点を置いて設計されています。位相ノイズ／ジッタ条件の厳しいその他のアプリケーションでも、このデバイスの利点を活用できます。
独立した3つのクロック出力があり、2つはLVPECL出力、もう1つの出力はLVDSまたはCMOSレベルに設定できます。LVPECL出力は最大1.6GHzまで動作します。3つ目の出力はLVDSモードで800MHzまで、CMOSモードで250MHzまで動作します。
それぞれの出力にはプログラマブルな分周器があり、分周率を1～32の整数値を選択して設定できます。分周器の位相選択機能によって、1つのクロック出力の位相を他のクロック出力に関係付けて設定できます。この位相選択はタイミングの粗調整になります。
LVDS/CMOS出力には、3つの選択可能なフルスケール遅延値（1.5ns、5ns、10ns）による遅延機能があります。それぞれ16ステップの微調整が可能です。
AD9514には、動作／設定用のコントローラを外付けする必要はありません。4レベルのロジックを使って11ピン（S0～S10）でプログラムします。プログラム・ピンは、内部で⅓VSにバイアスされます。VREFピンは⅔VSのレベルを提供し、VS（3.3V）とGND（0V）は他の2つのロジック・レベルを提供します。
AD9514はデータ・コンバータ用のクロック・アプリケーションに最適であり、ピコ秒以下のジッタを持つエンコード信号でコンバータの最大性能を発揮します。
AD9514は32ピンのLFCSPパッケージで提供しており、3.3V単電源で動作します。温度範囲は、－40℃～＋85℃です。
アプリケーション
- 低ジッタ、低位相ノイズのクロック分配
- 高速ADC、DAC、DDS、DDC、DUC、MxFE用クロック
- 高性能無線トランシーバ
- 高性能計測器
- 広帯域インフラストラクチャ
- ATE
製品カテゴリ
マーケット＆テクノロジー
製品ライフサイクル
新規設計にお薦めします
発売済みの製品です。データシートには、最終的な仕様と動作条件がすべて記載されています。新規の設計には、これらの製品の使用を推奨します。
評価キット (1)
参考資料
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AN-769: Generating Multiple Clock Outputs from the AD9540 (Rev. 0)2/14/2015PDF0
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AN-823: Direct Digital Synthesizers in Clocking Applications Time (Rev. 0)2/14/2015PDF115 kB
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AN-939: 高い周波数のRF出力信号が得られるAD9912のスーパーナイキスト動作 (Rev. 0)11/16/2010PDF351 kB
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AN-0974: Multicarrier TD-SCMA Feasibility3/2/2010PDF634 kB
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AN-756: サンプル化システムに及ぼすクロック位相ノイズとジッタの影響 (Rev. 0)4/18/2008PDF359 kB
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AN-927: スプリアスとDDS / DACやその他の発生源（スイッチング電源など）との関係の判定 (Rev. 0)7/12/2007PDF327 kB
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AN-837: DAC再生フィルタ性能とDDS採用時のクロック・ジッタ性能の関係 (Rev. 0)12/28/2006PDF528 kB
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AN-873: ADF4xxx PLLシンセサイザ・ファミリーでのロック検出 (Rev. 0)12/6/2006PDF349 kB
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AN-501: アパーチャ不確定性とADCシステム性能 (Rev. A)11/29/2004PDF212 kB
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AN-741: 位相ノイズの知られざる特性 (Rev. 0)11/29/2004PDF1076 kB
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カタログ一覧7/25/2016
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Low-power direct digital synthesizer cores enable high level of integration2/20/2008
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Design A Clock-Distribution Strategy With Confidence4/27/2006
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Speedy A/Ds Demand Stable Clocks3/22/2004
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125MSPS/14ビットのデュアルA/Dコンバータ「AD9645」を発表9/20/2019
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クワッド（4チャンネル）16ビット125MSPS A/Dコンバータ「AD9653」を発表9/20/2019
ツールおよびシミュレーション
設計ツール
ADIsimCLK 設計・評価 ソフトウェア
ADIsimCLKはアナログ・デバイセズの超低ジッタのクロック分配器とクロック生成用製品向けに開発された設計ツールです。ADIsimCLKを使用すれば、ワイヤレス・インフラストラクチャ、計測器、ネットワーキング、ブロードバンド、ATE（自動試験装置）あるいはクロック性能が予測可能であることが求められるあらゆる分野のアプリケーションで、設計を迅速に開発、評価、最適化できます。
設計リソース
アナログ・デバイセズでは、最高レベルの品質と信頼性を備えた製品を提供することに最大の力を常に注いでいます。これを実現するため、製品およびプロセスの設計のあらゆる観点で品質と信頼性のチェックを行っています。そして、それは、製造工程においても同様です。アナログ・デバイセズは常に、出荷製品の「ゼロ・ディフェクト」を目指しています。
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