AD9515
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AD9515

1.6 GHZクロック分配IC、ドライバ、遅延調整、2出力

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製品モデル 2
1Ku当たりの価格 最低価格：$6.09
特長
  • 1.6 GHzの差動クロック入力
  • プログラマブルな1～32分周器を2個内蔵
    遅延粗調整用の位相選択
  • 1.6 GHzのLVPECLクロック出力
    LVPECLでの出力ジッタ増: 225 fs rms
  • 800 MHz/250 MHzのLVDS/CMOSクロック出力
    LVDS/CMOSでの出力ジッタ増: 300 fs rms/290 fs rms
    遅延時間:最大10 ns
  • 4レベル・ロジックのピンでデバイスを設定
  • 省スペースの32ピンLFCSPパッケージを採用
製品概要
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AD9515は、ジッタと位相ノイズを小さくしてデータ・コンバータの性能を向上させるデザイン内に2個の出力を持つクロック分配ICを内蔵しています。厳しい位相ノイズとジッタの条件を持つその他のアプリケーションでもこのデバイスを利用することができます。

独立なクロック出力が2個あります。1つの出力はLVPECLで、他の出力はLVDSレベルまたはCMOSレベルに設定することができます。LVPECL出力は、1.6 GHzまで動作することができます。他の出力は、LVDSモードでは800 MHzまで、CMOSモードでは250 MHzまで、それぞれ動作することができます。

各出力にはプログラマブル分周器があり、1～32の範囲から選択した整数で分周するよう設定できます。他のクロック出力に対する1つのクロック出力の位相は、タイミング粗調整として機能する分周器の位相選択機能を使って設定することができます。

LVDS/CMOS出力には遅延エレメントがあり、3種類のフルスケール遅延値(1.5 ns、5 ns、10 ns)を選択することができます。各々は16ステップで微調整することができます。

AD9515では、動作またはセットアップのために外付けコントローラは不要です。このデバイスは、4レベル・ロジックを使用する11本のピン(S0～S10)を使って設定します。設定ピンは⅓ VSに内部バイアスされています。VREFピンは⅔ VSレベルを、VS (3.3 V)とGND (0 V)はその他の2ロジック・レベルを、それぞれ提供します。

AD9515は、ピコ秒未満のジッタを持つエンコード信号によりコンバータの最大性能を実現するデータ・コンバータ・クロック駆動アプリケーションに最適です。

AD9515は32ピンLFCSPを採用し、3.3 V単電源で動作します。温度範囲は−40°C～+85°Cです。

アプリケーション

  • 低ジッタ、低位相ノイズのクロック分配
  • 高速ADC、DAC、DDS、DDC、DUC、MxFEのクロック駆動
  • 高性能ワイヤレス・トランシーバ
  • 高性能計装機器
  • ブロードバンド・インフラストラクチャ
  • ATE
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AD9515

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更新 09/28/2006
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AD9515: 1.6 GHz Clock Distribution IC, Dividers, Delay Adjust, Two Outputs Data Sheet (Rev.B)

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アプリケーション・ノート

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更新 02/14/2015
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AN-769: Generating Multiple Clock Outputs from the AD9540 (Rev.0) redirect icon

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更新 08/26/2010
中国語
AN-769: 基于AD9540产生多时钟输出 (Rev.0) redirect icon

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更新 02/14/2015
English
AN-823: Direct Digital Synthesizers in Clocking Applications Time (Rev.0) redirect icon

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更新 10/12/2006
中国語
AN-823: 时钟应用中的直接数字频率合成器[中文版] (Rev.0) redirect icon

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更新 02/14/2015
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AN-927: Determining if a Spur is Related to the DDS/DAC or to Some Other Source (For Example, Switching Supplies) (Rev.0) redirect icon

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更新 07/12/2007
中国語
AN-927: 确定杂散来源是DDS/DAC还是其他器件(例如开关电源)[中文版] (Rev.0) redirect icon

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更新 07/12/2007
日本語
AN-927: スプリアスとDDS / DACやその他の発生源（スイッチング電源など）との関係の判定 (Rev.0) redirect icon

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更新 02/14/2015
English
AN-939: Super-Nyquist Operation of the AD9912 Yields a High RF Output Signal (Rev.0) redirect icon

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更新 10/29/2007
中国語
AN-939: 利用AD9912的超奈奎斯特频率操作得到高RF输出信号 (Rev.0) redirect icon

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更新 11/17/2010
日本語
AN-939: 高い周波数のRF出力信号が得られるAD9912のスーパーナイキスト動作 (Rev.0) redirect icon

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更新 02/14/2015
English
AN-756: Sampled Systems and the Effects of Clock Phase Noise and Jitter (Rev.0) redirect icon

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更新 12/02/2004
中国語
AN-756: 系统采样以及时钟相位噪声和抖动的影响[中文版] (Rev.0) redirect icon

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更新 04/18/2008
日本語
AN-756: サンプル化システムに及ぼすクロック位相ノイズとジッタの影響 (Rev.0) redirect icon

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更新 03/02/2010
English
AN-0974: Multicarrier TD-SCMA Feasibility (Rev.0) redirect icon

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更新 03/26/2010
中国語
AN-0974: TD-SCMA多载波系统可行性研究 (Rev.0) redirect icon

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更新 09/04/2018
English
AN-1576: Low Jitter Sampling Clock Generator for High Performance ADCs Using the AD9958 500 MSPS DDS or the AD9858 1 GSPS DDS and the AD9515 Clock Distribution IC (Rev.A) redirect icon

148.77 K

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更新 12/06/2006
English
AN-873: Lock Detect on the ADF4xxx Family of PLL Synthesizers (Rev.0) redirect icon

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更新 09/25/2009
中国語
AN-873: ADF4xxx系列PLL频率合成器的锁定检测 (Rev.0) redirect icon

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更新 12/06/2006
日本語
AN-873: ADF4xxx PLLシンセサイザ・ファミリーでのロック検出 (Rev.0) redirect icon

349 kB

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更新 11/29/2004
English
AN-741: Little Known Characteristics of Phase Noise (Rev.0) redirect icon

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更新 11/29/2004
中国語
AN-741: 鲜为人知的相位噪声特性 redirect icon

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更新 11/29/2004
日本語
AN-741: 位相ノイズの知られざる特性 (Rev.0) redirect icon

1076 kB

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更新 02/14/2015
English
AN-501: Aperture Uncertainty and ADC System Performance (Rev.A) redirect icon

227.66 K

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更新 11/29/2004
中国語
AN-501: 孔径不确定度与ADC系统性能[中文版] (Rev.A) redirect icon

227 kB

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更新 11/29/2004
日本語
AN-501: アパーチャ不確定性とADCシステム性能 (Rev.A) redirect icon

212 kB

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HTML

更新 10/30/2020
English
AN-769: Generating Multiple Clock Outputs from the AD9540 redirect icon

技術記事

6

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更新 12/07/2004
English
Understand the Effects of Clock Jitter and Phase Noise on Sampled Systems redirect icon

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URL

更新 06/07/2006
English
ADI Buys Korean Mobile TV Chip Maker redirect icon

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URL

更新 03/22/2004
English
Speedy A/Ds Demand Stable Clocks redirect icon

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URL

更新 04/27/2006
English
Design A Clock-Distribution Strategy With Confidence redirect icon

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URL

更新 02/20/2008
English
Low-power direct digital synthesizer cores enable high level of integration redirect icon

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更新 09/01/2006
English
Improved DDS Devices Enable Advanced Comm Systems redirect icon

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アナログ・デバイセズ社は、提供する情報が正確で信頼できるものであることを期していますが、その情報の利用に関して、あるいはその利用によって生じる第三者の特許やその他の権利の侵害に関して一切の責任を負いません。また、アナログ･デバイセズ社の特許または特許の権利の使用を明示的または暗示的に許諾するものでもありません。仕様は予告なしに変更する場合があります。本紙記載の商標および登録商標は、各社の所有に属します。


本データシートの英語以外の言語への翻訳はユーザの便宜のために提供されるものであり、リビジョンが古い場合があります。最新の内容については、必ず最新の英語版をご参照ください。

なお、日本語版のデータシートは基本的に「Rev.0」（リビジョン0）で作成されています。そのため、英語版が後に改訂され、複数製品のデータシートがひとつに統一された場合、同じ「Rev.0」の日本語版のデータシートが異なる製品のデータシートとして表示されることがあります。たとえば、「ADM3307E」の場合、日本語データシートをクリックすると「ADM3311E」が表示されます。これは、英語版のデータシートが複数の製品で共有できるように1本化され、「ADM3307E/ADM3310E/ADM3311E/ADM3312E/ADM3315E」（Rev.G）と改訂されたからで、決して誤ってリンクが張られているわけではありません。和文化されたデータシートを少しでも有効に活用していただくためにこのような方法をとっておりますので、ご了解ください。

ドキュメント

技術資料 18
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データシート 1

AD9515: 1.6 GHz Clock Distribution IC, Dividers, Delay Adjust, Two Outputs Data Sheet (Rev.B)

アプリケーション・ノート 11

AN-927: スプリアスとDDS / DACやその他の発生源（スイッチング電源など）との関係の判定 (Rev.0)
AN-939: 高い周波数のRF出力信号が得られるAD9912のスーパーナイキスト動作 (Rev.0)
AN-756: サンプル化システムに及ぼすクロック位相ノイズとジッタの影響 (Rev.0)
AN-873: ADF4xxx PLLシンセサイザ・ファミリーでのロック検出 (Rev.0)
AN-741: 位相ノイズの知られざる特性 (Rev.0)
AN-501: アパーチャ不確定性とADCシステム性能 (Rev.A)
AN-769: Generating Multiple Clock Outputs from the AD9540 (Rev.0)
AN-823: Direct Digital Synthesizers in Clocking Applications Time (Rev.0)
AN-0974: Multicarrier TD-SCMA Feasibility (Rev.0)
AN-1576: Low Jitter Sampling Clock Generator for High Performance ADCs Using the AD9958 500 MSPS DDS or the AD9858 1 GSPS DDS and the AD9515 Clock Distribution IC (Rev.A)
AN-769: Generating Multiple Clock Outputs from the AD9540

技術記事 6

Understand the Effects of Clock Jitter and Phase Noise on Sampled Systems
ADI Buys Korean Mobile TV Chip Maker
Speedy A/Ds Demand Stable Clocks
Design A Clock-Distribution Strategy With Confidence
Low-power direct digital synthesizer cores enable high level of integration
Improved DDS Devices Enable Advanced Comm Systems
アナログ・デバイセズは、最高レベルの品質と信頼性を満たす製品を供給することを常に最重要視しています。これを実現するため、製品、プロセス設計、更には製造プロセスに対しあらゆる観点から品質と信頼性のチェックを行っています。アナログ・デバイセズでは出荷製品に対する「ゼロ・ディフェクト」を常に目指しています。詳細については、アナログ・デバイセズの品質および信頼性プログラム、認証のページを参照してください。
製品モデル ピン／パッケージ図 資料 CADシンボル、フットプリント、および3Dモデル
AD9515BCPZ 32-Lead LFCSP (5mm x 5mm w/ EP) external-link
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  • Material Declaration external-link
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AD9515BCPZ-REEL7 32-Lead LFCSP (5mm x 5mm w/ EP) external-link
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CANCELLED: Conversion of Select 4x4, 5x5, 6x6 and 7x7mm LFCSP Package Outlines from Punch to Sawn and Transfer of Assembly Site to ASE Korea.

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