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2854: 5V、E1/T1/J1线路接口 Data Sheet (Rev. 4)1/1/1900PDF1M
概览
优势和特点
- Complete E1, T1, or J1 line interface unit (LIU)
- Supports both long- and short-haul trunks
- Internal software-selectable receive-side termination for 75Ω/100Ω/120Ω
- 5V power supply
- 32-bit or 128-bit crystal-less jitter attenuator requires only a 2.048MHz master clock for both E1 and T1 with option to use 1.544MHz for T1
- Generates the appropriate line build outs, with and without return loss, for E1 and DSX-1 and CSU line build outs for T1
- AMI, HDB3, and B8ZS, encoding/decoding
- 16.384MHz, 8.192MHz, 4.096MHz, or 2.048MHz clock output synthesized to recovered clock
- Programmable monitor mode for receiver
- Loopbacks and PRBS pattern generation/ detection with output for received errors
- Generates/detects in-band loop codes, 1 to 16 bits including CSU loop codes
- 8-bit parallel or serial interface with optional hardware mode
- Multiplexed and nonmultiplexed parallel bus supports Intel or Motorola
- Detects/generates blue (AIS) alarms
- NRZ/bipolar interface for TX/RX data I/O
- Transmit open-circuit detection
- Receive Carrier Loss (RCL) indication (G.775)
- High-Z State for TTIP and TRING
- 50mA (rms) current limiter
产品详情
产品分类
产品生命周期
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评估套件 (2)
参考资料
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DS2148 Reliability Data1/12/2023PDF19K
-
Using RCLK in a BITS/SSU Application2/4/2002
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T1/E1 Network Interface Design11/27/2001
-
可不使用微控制器配置Maxim的LIU11/21/2005
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Bit Error Rate Testing the DS314x Series of DS3/E3 Framers9/16/2003
-
Power-Fault Protection Layout6/6/2003
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DS2148/DS21348 Hardware Mode6/6/2003
-
Additional Pulse Amplitude Settings for DS2148, DS21348, DS21Q48, DS21Q348 and DS214483/21/2003
-
J1 Japanese Standards9/4/2002
-
Using DS2148/DS21348 as Repeater5/29/2002
-
Telecom Application Notes Index8/10/2001
工具及仿真模型
IBIS模型
IBS
DS2148G_33 IBIS Model
59.38K
IBS
DS2148T_5 IBIS Model
58.97K
IBS
DS2148G_5 IBIS Model
59.11K
IBS
DS2148T_33 IBIS Model
59.24K
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