AD6643
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AD6643

双通道中频接收机

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产品模型 4
特性
  • 每个通道11位、250 MSPS输出数据速率
  • NSR使能时的性能
    • NR:74.5 dBFS(55 MHz频段、最高90 MHz、250 MSPS)
    • SNR:72.0 dBFS(82 MHz频段、最高90 MHz、250 MSPS)
  • NSR禁用时的性能
    • SNR:66.2 dBFS(最高90 MHz、250 MSPS)
    • SFDR:85 dBc(最高185 MHz、250 MSPS)
  • 总功耗:706 mW (200 MSPS)
  • 1.8 V电源电压
  • LVDS(ANSI-644电平)输出
  • 1至8整数输入时钟分频器(最大输入频率625 MHz)
  • ADC内部基准电压源
  • 灵活的模拟输入范围
    • 1.4 V p-p至2.0 V p-p(标称值1.75 V p-p)
  • 差分模拟输入、400 MHz带宽
  • 95 dB通道隔离/串扰
  • 串行端口控制
  • 节能的关断模式
更多细节
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AD6643是一款11位、200 MSPS/250 MSPS、双通道中频(IF)接收机,专门针对要求高动态范围性能、低功耗和小尺寸的电信应用中支持多通道系统而设计。

该器件包括两个高性能模数转换器(ADC)和噪声整形再量化器(NSR)数字模块。每个ADC由多级、差分流水线架构组成,并集成了输出纠错逻辑,每个ADC差分流水线的第一级包含一个宽带宽开关电容采样网络。集成基准电压源可简化设计考量。占空比稳定器(DCS)补偿ADC时钟占空比的波动,使转换器保持出色的性能。

各ADC的输出内部连接到NSR模块。集成NSR电路能够提高奈奎斯特带宽内较小频段的信噪比(SNR)性能。该器件支持两种不同的输出模式,通过SPI可以选择输出模式。如果使能NSR特性,则在处理ADC的输出时,AD6643可以在有限的部分奈奎斯特带宽内实现更高的SNR性能,同时保持11位输出分辨率。

可以对NSR模块进行编程,以提供采样时钟22%或33%的带宽。例如,当采样时钟速率为185 MSPS时,在22%模式下,AD6643可以在40 MHz带宽内实现最高75.5 dBFS的SNR;在33%模式下,它可以在60 MHz带宽内实现最高73.7 dBFS的SNR。

禁用NSR模块时,ADC数据直接以11位的分辨率提供给输出端。这种工作模式下,AD6643能够在整个奈奎斯特带宽内实现最高66.5 dBFS的SNR。因此,AD6643可以用于电信应用,例如要求更宽带宽的数字预失真观测路径。

经过数字信号处理后,多路复用输出数据路由至一个11位输出端口,最大数据速率为400 Mbps (DDR)。这些输出设置为LVDS,支持ANSI-644电平。

AD6643接收器能够对很宽的中频频谱进行数字化处理。各接收机设计用于同步接收不同的天线。该IF采样架构与传统的模拟技术或较低集成度的数字方法相比,能大幅度降低元件的成本和复杂度。

灵活的掉电选项可以明显降低功耗。器件设置与控制的编程利用三线式SPI兼容型串行接口来完成;该接口提供多种工作模式,支持电路板级系统测试。

AD6643采用64引脚无铅9 mm × 9 mm引脚架构芯片级封装(LFCSP_VQ),符合RoHS标准,额定温度范围为−40°C至+85°C工业温度范围。该产品受美国专利保护。

产品聚焦

  1. 两款ADC均采用节省空间的9 mm × 9 mm × 0.85 mm、64引脚LFCSP小型封装。
  2. 引脚可选的噪声整形再量化器(NSR)功能,能够在185 MSPS下带宽降低至最大60 MHz时提高信噪比。
  3. LVDS数字输出接口针对低成本FPGA系列而配置。
  4. 采用1.8 V单电源供电。
  5. 标准串行端口接口(SPI)支持各种产品特性和功能,例如:数据格式化(偏移二进制或二进制补码)、NSR、掉电、测试模式以及基准电压模式。
  6. 片内1到8整数输入时钟分频器和多芯片同步功能支持广泛的时钟方案和多通道子系统。

应用

  • 通信
  • 分集无线电和智能天线(MIMO)系统
  • 多模式数字接收器(3G)
    • WCDMA, LTE, CDMA2000
    • WiMAX, TD-SCDMA
  • I/Q解调系统
  • 通用软件无线电
产品模型 4

产品技术资料帮助

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参考资料

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产品型号 引脚/封装图-中文版 文档 CAD 符号,脚注和 3D模型
AD6643BCPZ-200
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AD6643BCPZ-250
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AD6643BCPZRL7-200
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6月 26, 2023

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AD6643BCPZ-200

量产

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7月 27, 2020

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评估套件

评估套件 2

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HSC-ADC-EVALCZ

基于FPGA的数据采集套件

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HSC-ADC-EVALCZ

基于FPGA的数据采集套件

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特性和优点

  • 64kB FIFO深度
  • 适用于单通道和多通道ADC
  • 与VisualAnalog®软件配合使用
  • 基于Virtex-4 FPGA
  • 可能需要适配器,才能与某些ADC评估板接口
  • 允许对SPI控制进行编程 每个通道的DDR编码速率高达644 MSPS SDR / 800MSPS
  • 每个通道的DDR编码速率

产品详情

HSC-ADC-EVALCZ高速转换器评估平台使用基于FPGA的缓冲存储器板,采集来自ADI高速模数转换器(ADC)评估板的数字数据块。该板通过USB端口连接到PC,并与VisualAnalog®软件配合使用来快速评估高速ADC的性能。该评估套件设置简单。所需的额外设备包括ADI高速ADC评估板、信号源和时钟源。一旦连接该套件并上电,PC便立即开始评估。

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EVAL-AD6643

AD6643 评估板

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EVAL-AD6643

AD6643 评估板

AD6643 评估板

特性和优点

  • 用于设置和控制的SPI接口
  • 外部或AD9523时钟选项
  • 巴伦/变压器或放大器输入驱动选项
  • LDO调节器电源
  • VisualAnalog和SPI控制器软件接口

产品详情

AD6643-250EBZ用于评估双通道11位混合信号IF接收器ADC AD6643。本参考设计提供在各种模式和配置下运行器件所需的全部支持电路。它设计为可直接与HSC-ADC-EVALCZ的数据捕获卡进行接口,允许用户下载捕获的数据用于分析。Visual Analog软件包用来与器件的硬件部分实现接口,允许用户下载捕获的数据并通过用户友好型图形界面进行分析。同时,SPI控制器软件包也兼容硬件部分,允许用户使用AD6643的SPI可编程功能。

AD6643数据手册提供了更多有关器件配置和性能的信息,在使用这些工具时应加以参考。所有文档、Visual Analog软件以及SPI控制器均可在高速ADC评估板页面上找到。欲了解更多信息,或有任何疑问,请发送电子邮件至highspeed.converters@analog.com

工具和仿真

工具及仿真模型 5

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