AD9511
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1.2 GHz时钟分配IC，PLL内核，分频器，延迟调整，5路输出

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特性
  • 低相位噪声锁相环内核
    • 最高250 MHz的参考输入频率
    • 可编程双模预分频器
    • 可编程电荷泵(CP)电流
    • 独立的CP电源(VCP)可扩展调整范围
  • 两路1.6 GHz差分时钟输入
  • 5个可编程分频器，1至32整数分频比
  • 用于输出到输出延迟粗调的相位选择
  • 3路独立的1.2 GHz LVPECL输出
    • 加性输出抖动：225 fs RMS
  • 2路独立的800 MHz/250 MHz LVDS/CMOS输出
    • 加性输出抖动：275 fs RMS
    • 一路输出提供延迟精调，5位延迟字
  • 串行控制端口
  • 节省空间的48引脚LFCSP封装
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AD9511提供多路输出时钟分配功能，并集成一个片内锁相环(PLL)内核。它具有低抖动和低相位噪声特性，能够极大地提升数据转换器的时钟性能。3路独立的LVPECL时钟输出和2路LVDS时钟输出工作频率分别为1.2 GHz和800 MHz。可选的CMOS时钟输出工作频率为250 MHz。

PLL部分由可编程参考分频器(R)、低噪声鉴频鉴相器(PFD)、精密电荷泵(CP)和可编程反馈分频器(N)组成。将外部VCXO或VCO连接到CLK2和CLK2B引脚时，最高达1.6 GHz的PLL输出频率可以与输入参考REFIN同步。

时钟分配部分提供LVPECL输出和可编程为LVDS或CMOS的输出。每路输出都有一个可编程分频器，可以旁路该分频器或者设置最高32的整数分频比。

用户可以通过各分频器改变一路时钟输出相对于其它时钟输出的相位，这种相位选择功能可用于时序粗调。一路输出还提供可编程延迟特性，具有最长10 ns的用户可选满量程延迟值。该精调延迟模块通过一个5位字进行编程，提供32个可用的延迟时间供用户选择。

AD9511非常适合数据转换器时钟应用，利用亚皮秒抖动编码信号，可实现优质的转换器性能。

AD9511提供48引脚LFCSP封装，额定温度范围为-40°C至+85°C，可以采用3.3 V单电源供电。如果用户希望扩展外部VCO的电压范围，可以利用最高达5.5V的电荷泵电源VCP。

应用

  • 低抖动、低相位噪声时钟分配
  • 为高速ADC、DAC、DDS、DDC、DUC、MxFE™转换器提供时钟
  • 无线基础设施收发器
  • 高性能仪器仪表
  • 宽带基础设施
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AD9511

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数据手册

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更新 12/03/2020
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AD9511: 1.2 GHz Clock Distribution IC, PLL Core, Dividers, Delay Adjust, Five Outputs Data Sheet (Rev.B)

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更新 04/27/2006
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更新 12/07/2004
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Understand the Effects of Clock Jitter and Phase Noise on Sampled Systems redirect icon

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更新 06/07/2006
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ADI Buys Korean Mobile TV Chip Maker redirect icon

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更新 03/22/2004
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Speedy A/Ds Demand Stable Clocks redirect icon

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更新 02/20/2008
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Low-power direct digital synthesizer cores enable high level of integration redirect icon

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更新 09/01/2006
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Improved DDS Devices Enable Advanced Comm Systems redirect icon

评估设计文件

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更新 06/28/2007
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AD9511/AD9512 All Layers (Rev.B) redirect icon

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更新 06/28/2007
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AD9511/AD9512所有层 (Rev.B) redirect icon

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AD9511/AD9512 Gerber Files (Rev.B) redirect icon

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应用笔记

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更新 03/02/2010
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AN-0974: Multicarrier TD-SCMA Feasibility (Rev.0) redirect icon

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更新 03/26/2010
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AN-0974: TD-SCMA多载波系统可行性研究 (Rev.0) redirect icon

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更新 02/14/2015
英文
AN-939: Super-Nyquist Operation of the AD9912 Yields a High RF Output Signal (Rev.0) redirect icon

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更新 10/29/2007
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AN-939: 利用AD9912的超奈奎斯特频率操作得到高RF输出信号 (Rev.0) redirect icon

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更新 11/17/2010
日文
AN-939: 高い周波数のRF出力信号が得られるAD9912のスーパーナイキスト動作 (Rev.0) redirect icon

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更新 02/14/2015
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AN-927: Determining if a Spur is Related to the DDS/DAC or to Some Other Source (For Example, Switching Supplies) (Rev.0) redirect icon

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更新 07/12/2007
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AN-927: 确定杂散来源是DDS/DAC还是其他器件(例如开关电源)[中文版] (Rev.0) redirect icon

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更新 07/12/2007
日文
AN-927: スプリアスとDDS / DACやその他の発生源（スイッチング電源など）との関係の判定 (Rev.0) redirect icon

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更新 12/06/2006
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AN-873: Lock Detect on the ADF4xxx Family of PLL Synthesizers (Rev.0) redirect icon

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更新 09/25/2009
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AN-873: ADF4xxx系列PLL频率合成器的锁定检测 (Rev.0) redirect icon

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更新 12/06/2006
日文
AN-873: ADF4xxx PLLシンセサイザ・ファミリーでのロック検出 (Rev.0) redirect icon

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更新 02/14/2015
英文
AN-769: Generating Multiple Clock Outputs from the AD9540 (Rev.0) redirect icon

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更新 08/26/2010
中文
AN-769: 基于AD9540产生多时钟输出 (Rev.0) redirect icon

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更新 02/14/2015
英文
AN-501: Aperture Uncertainty and ADC System Performance (Rev.A) redirect icon

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更新 11/29/2004
中文
AN-501: 孔径不确定度与ADC系统性能[中文版] (Rev.A) redirect icon

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更新 11/29/2004
日文
AN-501: アパーチャ不確定性とADCシステム性能 (Rev.A) redirect icon

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更新 02/14/2015
英文
AN-756: Sampled Systems and the Effects of Clock Phase Noise and Jitter (Rev.0) redirect icon

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更新 12/02/2004
中文
AN-756: 系统采样以及时钟相位噪声和抖动的影响[中文版] (Rev.0) redirect icon

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更新 04/18/2008
日文
AN-756: サンプル化システムに及ぼすクロック位相ノイズとジッタの影響 (Rev.0) redirect icon

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更新 11/29/2004
英文
AN-741: Little Known Characteristics of Phase Noise (Rev.0) redirect icon

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更新 11/29/2004
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AN-741: 鲜为人知的相位噪声特性 redirect icon

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更新 11/29/2004
日文
AN-741: 位相ノイズの知られざる特性 (Rev.0) redirect icon

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更新 02/14/2015
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AN-823: Direct Digital Synthesizers in Clocking Applications Time (Rev.0) redirect icon

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更新 10/12/2006
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AN-823: 时钟应用中的直接数字频率合成器[中文版] (Rev.0) redirect icon

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更新 10/30/2020
英文
AN-769: Generating Multiple Clock Outputs from the AD9540 redirect icon

常见问题

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更新 10/25/2019
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参考资料

参考资料

技术文档 20
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数据手册 1

AD9511: 1.2 GHz Clock Distribution IC, PLL Core, Dividers, Delay Adjust, Five Outputs Data Sheet (Rev.B)

应用笔记 10

AN-0974: TD-SCMA多载波系统可行性研究 (Rev.0)
AN-939: 利用AD9912的超奈奎斯特频率操作得到高RF输出信号 (Rev.0)
AN-927: 确定杂散来源是DDS/DAC还是其他器件(例如开关电源)[中文版] (Rev.0)
AN-873: ADF4xxx系列PLL频率合成器的锁定检测 (Rev.0)
AN-769: 基于AD9540产生多时钟输出 (Rev.0)
AN-501: 孔径不确定度与ADC系统性能[中文版] (Rev.A)
AN-756: 系统采样以及时钟相位噪声和抖动的影响[中文版] (Rev.0)
AN-741: 鲜为人知的相位噪声特性
AN-823: 时钟应用中的直接数字频率合成器[中文版] (Rev.0)
AN-769: Generating Multiple Clock Outputs from the AD9540

技术文章 6

Design A Clock-Distribution Strategy With Confidence
Understand the Effects of Clock Jitter and Phase Noise on Sampled Systems
ADI Buys Korean Mobile TV Chip Maker
Speedy A/Ds Demand Stable Clocks
Low-power direct digital synthesizer cores enable high level of integration
Improved DDS Devices Enable Advanced Comm Systems

评估设计文件 2

AD9511/AD9512所有层 (Rev.B)
AD9511/AD9512 Gerber 文件 (Rev.B)

常见问题 1

FAQ

ADI 始终高度重视提供符合最高质量和可靠性水平的产品。我们通过将质量和可靠性检查纳入产品和工艺设计的各个范围以及制造过程来实现这一目标。出货产品的“零缺陷”始终是我们的目标。查看我们的质量和可靠性计划和认证以了解更多信息。

产品型号 引脚/封装图-中文版 文档 CAD 符号，脚注和 3D模型
AD9511BCPZ 48-Lead LFCSP (7mm x 7mm x 0.85mm w/ EP) external-link
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AD9511BCPZ-REEL7 48-Lead LFCSP (7mm x 7mm x 0.85mm w/ EP) external-link
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部分模型 产品周期 描述

高速比较器（传播延迟<100ns）1
LTC6957
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低相位噪声、双输出缓冲器 / 驱动器 / 逻辑转换器

整数N分频PLL1
ADF4002
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鉴相器/PLL频率合成器

评估套件

评估套件 1

EVAL-AD9511

AD9511 评估板

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EVAL-AD9511
AD9511 评估板
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AD9511评估板是一款紧凑、易于使用的平台，可用来评估AD9511的全部特性。该评估软件提供图形用户界面(GUI)，以便与AD9511的各种片内功能轻松接口。这样可以全面了解和评估AD9511的工作情况、性能和功能。请注意将AD9511评估板连接到PC之前，应先安装AD9511评估板软件。

AD9511是一款高度复杂的性能时钟分配器件，具有多种用户可编程功能。要正确使用该评估板，请参考AD9511的当前数据手册。

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AD9511/AD9512所有层 (Rev.B) Download

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AD9511/AD9512原理图 (Rev.B) Download

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AD9511 Evaluation Software Installer, Rev. 2.1.1 Download

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AD9510/AD9511/AD9512 Evaluation Board USB Flash Programmer Readme Download

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评估套件1

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