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AD9512: 1.2 GHz Clock Distribution IC, 1.6 GHz Inputs, Dividers, Delay Adjust, Five Outputs Data Sheet (Rev. B)11/5/2020PDF509 K
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AD9512-EP: Enhanced Product Data Sheet (Rev. A)9/30/2015PDF318K
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AD9512-DSCC: Military Data Sheet9/30/2015
概览
优势和特点
- 两路1.6 GHz差分时钟输入
- 5个可编程分频器，1至32整数分频比
- 用于输出到输出延迟粗调的相位选择
- 3路独立的1.2 GHz LVPECL输出
加性输出抖动：225 fs均方根值 - 2路独立的800 MHz/250 MHz LVDS/CMOS输出
加性输出抖动：275 fs均方根值
1路输出提供延迟精调，5位延迟字 - 4线式或3线式串行控制端口
- 节省空间的48引脚LFCSP封装
- 下载 AD9512-EP 数据手册 (pdf)
- 军用温度范围
（−55°C至+85℃） - 受控制造基线
- 唯一封装/测试厂
- 唯一制造厂
- 增强型产品变更通知
- 认证数据可应要求提供
- V62/12656 DSCC图纸号
产品详情
AD9512提供多路输出时钟分配功能，输入信号最高可达1.6 GHz。它具有低抖动和低相位噪声特性，能够极大地提升数据转换器的时钟性能。
3路独立的LVPECL时钟输出和2路LVDS时钟输出工作频率分别为1.2 GHz和800 MHz。可选的CMOS时钟输出工作频率为250 MHz。每路输出都有一个可编程分频器，可以旁路该分频器或者设置最高32的整数分频比。
用户可以通过各分频器改变一路时钟输出相对于其它时钟输出的相位，这种相位选择功能可用于时序粗调。1路输出还提供可编程延迟特性，具有最长10 ns的用户可选满量程延迟值。该精调延迟模块通过一个5位字进行编程，提供32个可用的延迟时间供用户选择。
AD9512非常适合数据转换器时钟应用，利用亚皮秒抖动编码信号，可实现优质的转换器性能。
AD9512提供48引脚LFCSP封装，额定温度范围为-40°C至+85°C，可以采用3.3 V单电源供电。
应用
- 低抖动、低相位噪声时钟分配
- 为高速ADC、DAC、DDS、DDC、DUC、MxFE™转换器提供时钟
- 无线基础设施收发器
- 高性能仪器仪表
- 宽带基础设施
产品生命周期
推荐新设计使用
本产品已上市。数据手册包含所有最终性能规格和工作条件。ADI公司推荐新设计使用这些产品。
评估套件 (1)
参考资料
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AN-769: 基于AD9540产生多时钟输出 (Rev. 0)8/26/2010PDF130 kB
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AN-0974: TD-SCMA多载波系统可行性研究 (Rev. 0)3/26/2010PDF772 kB
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AN-873: ADF4xxx系列PLL频率合成器的锁定检测 (Rev. 0)9/25/2009PDF0
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AN-939: 利用AD9912的超奈奎斯特频率操作得到高RF输出信号 (Rev. 0)10/29/2007PDF0
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AN-927: 确定杂散来源是DDS/DAC还是其他器件(例如开关电源)[中文版] (Rev. 0)7/12/2007PDF234 kB
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AN-837: 基于DDS的时钟抖动性能与DAC重构滤波器性能的关系[中文版] (Rev. 0)12/28/2006PDF416 kB
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AN-823: 时钟应用中的直接数字频率合成器[中文版] (Rev. 0)10/12/2006PDF303 kB
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AN-756: 系统采样以及时钟相位噪声和抖动的影响[中文版] (Rev. 0)12/2/2004PDF808 kB
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AN-501: 孔径不确定度与ADC系统性能[中文版] (Rev. A)11/29/2004PDF227 kB
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AN-741: 鲜为人知的相位噪声特性11/29/2004PDF359 kB
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AD9511/AD9512原理图 (Rev. B)6/28/2007PDF323 kB
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FAQs3/10/2020
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ADIsimCLK™ Reference Design Files10/20/2015
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CN-010911/9/2010PDF114 kB
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Low-power direct digital synthesizer cores enable high level of integration2/20/2008
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Improved DDS Devices Enable Advanced Comm Systems9/1/2006
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ADI Buys Korean Mobile TV Chip Maker6/7/2006
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Design A Clock-Distribution Strategy With Confidence4/27/2006
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Understand the Effects of Clock Jitter and Phase Noise on Sampled Systems12/7/2004
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Speedy A/Ds Demand Stable Clocks3/22/2004
工具及仿真模型
设计工具
ADIsimCLK设计与评估软件
ADIsimCLK是一款专门针对ADI公司的超低抖动时钟分配和时钟产生产品系列而开发的设计工具。无论是在无线基础设施、仪器仪表、网络、宽带、自动测试设备领域，还是在其它要求可预测时钟性能的应用，ADIsimCLK都能帮助您迅速开发、评估和优化设计。
设计资源
ADI始终把满足您可靠性水平的产品放在首要位置。我们通过在所有产品、工艺设计和制造过程中引入高质量和可靠性检查实践这一承诺。发运的产品实现“零缺陷”始终是我们的目标。
| Part Number | Material Declaration | Reliability Data | Pin/Package Drawing | CAD Symbols, Footprints & 3D Models |
|---|---|---|---|---|
| AD9512BCPZ | 材料声明 | 质量和可靠性 | 48-Lead LFCSP (7mm x 7mm x 0.85mm w/ EP) | |
| AD9512BCPZ-REEL7 | 材料声明 | 质量和可靠性 | 48-Lead LFCSP (7mm x 7mm x 0.85mm w/ EP) | |
| AD9512UCPZ-EP | 材料声明 | 质量和可靠性 | 48-Lead LFCSP (7mm x 7mm x 0.75mm w/ EP) | |
| AD9512UCPZ-EP-R7 | 材料声明 | 质量和可靠性 | 48-Lead LFCSP (7mm x 7mm x 0.75mm w/ EP) | |
| Wafer Fabrication Data |
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