概览

优势和特点

  • 锁相环(PLL)内核
    参考输入频率达250 MHz
    可编程双模预分频器
    可编程电荷泵(CP)电流
    独立的CP电源(VCP)可扩展调整范围
  • 两路1.6 GHz差分时钟输入
  • 8 个可编程分频器,1至32整数分频比
  • 用于输出到输出延迟粗调的相位选择
  • 4路独立的1.2 GHz LVPECL输出
    加性输出抖动:225 fs RMS
  • 4路独立的800 MHz/250 MHz LVDS/CMOS输出
    加性输出抖动:275 fs RMS
    2路输出提供延迟精调,5位延迟字
  • 串行控制端口
  • 节省空间的64引脚LFCSP封装

产品详情

AD9510提供多路输出时钟分配功能,并集成一个片内锁相环(PLL)内核。它具有低抖动和低相位噪声特性,能够极大地提升数据转换器的时钟性能。4路独立的LVPECL时钟输出和4路LVDS时钟输出工作频率分别为1.2 GHz和800 MHz。可选的CMOS时钟输出工作频率为250 MHz。

PLL部分由可编程参考分频器(R)、低噪声鉴频鉴相器(PFD)、精密电荷泵(CP)和可编程反馈分频器(N)组成。将外部VCXO或VCO连接到CLK2和CLK2B引脚时,最高达1.6 GHz的PLL输出频率可以与输入参考REFIN同步。

时钟分配部分提供LVPECL输出和可编程为LVDS或CMOS的输出。每路输出都有一个可编程分频器,可以旁路该分频器或者设置最高32的整数分频比。

用户可以通过各分频器改变一路时钟输出相对于其它时钟输出的相位,这种相位选择功能可用于时序粗调。某些输出还提供可编程延迟特性,具有最长10 ns的用户可选满量程延迟值。该精调延迟模块通过一个5位字进行编程,提供32个可用的延迟时间供用户选择。

AD9510非常适合数据转换器时钟应用,利用亚皮秒抖动编码信号,可实现最佳的转换器性能。

AD9510提供64引脚LFCSP封装,额定温度范围为-40°C至+85°C,可以采用3.3 V单电源供电。如果用户希望扩展外部VCO的电压范围,可以利用最高达5.5V的电荷泵电源VCP。

应用

  • 低抖动、低相位噪声时钟分配
  • 为高速ADC、DAC、DDS、DDC、DUC、MxFE™转换器提供时钟
  • 无线基础设施收发器
  • 高性能仪器仪表
  • 宽带基础设施

产品生命周期 icon-recommended 推荐新设计使用

本产品已上市。数据手册包含所有最终性能规格和工作条件。ADI公司推荐新设计使用这些产品。

评估套件 (1)

文档

应用笔记 (24)

常见问题解答 (1)

工具及仿真模型

IBIS模型

AD9510 IBIS Models

设计工具

ADIsimCLK设计与评估软件

ADIsimCLK是一款专门针对ADI公司的超低抖动时钟分配和时钟产生产品系列而开发的设计工具。无论是在无线基础设施、仪器仪表、网络、宽带、自动测试设备领域,还是在其它要求可预测时钟性能的应用,ADIsimCLK都能帮助您迅速开发、评估和优化设计。

设计资源

ADI始终把满足您最高可靠性水平的产品放在首要位置。我们通过在所有产品、工艺设计和制造过程中引入高质量和可靠性检查实践这一承诺。发运的产品实现“零缺陷”始终是我们的目标。

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