フェーズ・ロック・ループ（PLL）シンセサイザ & トランスレーション・ループ
業界をリードするアナログ・デバイセズのフェーズ・ロック・ループ（PLL）シンセサイザ・ファミリーは、高性能、低ジッタのクロック生成および分配デバイスで構成されています。この広範な PLL ファミリーには、高データ・レート、低ジッタのクロック・アプリケーション向けに最適化された 100 以上の製品がありますが、その数はさらに拡大していいます。同期、クロック分配、位相ノイズ性能が求められるクロッキング・アプリケーション向けの PLL、PLL/VCO、分配チップを提供しています。アナログ・デバイセズは、業界をリードする PLL を内蔵した回路製品の設計およびテストに関して 25 年以上の実績があります。業界で最も広範な PLL 製品によって、お客様のほぼすべての PLL のニーズに対応できます。
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ADIsimPLL™アナログ設計ツール
ADIsimPLLはフェーズ・ロック・ループ（PLL）回路の設計および評価ツールであり、RFシステムの評価、設計、トラブルシューティングに役立ちます。このツールは、アナログ・デバイセズのPLLシンセサイザ・ファミリを使用しています。
最新情報
技術記事
- 16チャンネルのデモ用ボードを使用し、マルチチャンネルのシステムにおける位相ノイズのモデルの有用性を実証する
- 位相ノイズ性能の高いDACを利用した周波数合成器、高速ホッピングを必要とするマイクロ波アプリケーションに対応
- DAC/ADCとDSPの統合ICにより、広帯域マルチチャンネル・システムの性能を改善する
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RFシグナル・チェーンに関する論考――特性と性能指標
アナログ・ダイアログ
- 完全統合型のトランスレーション・ループ・デバイスは、なぜ最高の位相ノイズ性能を実現できるのか？
アプリケーション・ノート
プレス・リリース
デザイン・ノート
リファレンス設計
- CN0228: Single Supply Powers a 28 V, High Voltage Phase-Locked Loop (PLL) Synthesizer PDF
- CN0320: An IQ Demodulator-Based IF-to-Baseband Receiver with IF and Baseband Variable Gain and Programmable Baseband Filtering PDF
- CN-0239: グルーレスなローカル発振器インターフェースを内蔵した広帯域6GHzアクティブ・ミキサー (Rev. 0) PDF
- CN0285: 高帯域、低エラーベクトル振幅（EVM）、ダイレクト・コンバージョン送信器 PDF
- CN0294: 低ジッタのLVPECLファンアウト・バッファによるクロック源からの出力数の増加 PDF
技術誌・書籍
ウェブキャスト
- RF Front End Design for the ADRV9002 Narrow/Wideband Transceiver
- Unified Communications Platform for Next Gen Conferencing products
- Multi-Channel System Improvements Using Hardened DSP in Digitizer ICs
- Latest Developments in Analog Devices PLL Portfolio
- Explaining Phase Noise
ビデオ
- フェーズド・アレイ・レーダー／EW向けのプロトタイピング用プラットフォーム、16チャンネルの送受信とL/Sバンドに対応
- ミリ波に対応する送信用シグナル・チェーン、計測器グレードの高い性能を実現
- X-Microwaveのモジュラー型ドロップイン・コンポーネント、アナログ・デバイセズの製品を搭載
- LiDAR向けのモジュール式プロトタイピング用プラットフォーム、市場投入までの期間を短縮
- RF向けA/Dコンバータと高速クロック