製品概要
機能と利点
- 低位相ノイズ、フェーズ・ロック・ループ（PLL）
内蔵VCOのチューニング範囲：1.75GHz～2.25GHz
オプションの外付けVCO/VCXO（最大2.4GHz）
1個の差動／2個のシングルエンド・リファレンス入力
リファレンス監視機能
自動および手動のリファレンス切替え／ホールドオーバー・モード
最大250MHzのLVPECL、LVDS、またはCMOSリファレンスが入力可能
PFDへのパスのプログラマブルな遅延
デジタルまたはアナログのロック検出（選択可能）
- 1.6GHzのLVPECL出力の3つのペア
各ペアでコース位相遅延を設定できる1～32分周器を共用
追加出力ジッタ：225fs rms
チャンネル間スキュー・ペア出力：<10 ps - 電源投入時にすべての出力が自動同期
- 手動出力同期が可能
- 48ピンLFCSPで供給
製品概要
AD9518-3*は、ピコ秒以下のジッタ性能のマルチ出力クロック分配機能を備えており、PLLとVCOを内蔵しています。VCOのチューニング周波数レンジは1.75～2.25GHzです。オプションとして、外付けのVCO/VCXO（最大2.4GHz）を使用できます。
AD9518-3は、低ジッタと低位相ノイズに重点を置き、データ・コンバータの性能を最大限に高めます。位相ノイズ／ジッタ条件の厳しいその他のアプリケーションでも、このデバイスが役に立ちます。
AD9518-3には、6つのLVPECL出力（3つのペア）があります。LVPECL出力は1.6GHzまで動作します。
更に追加の出力を必要とするようなアプリケーションに対しては、クリスタル・リファレンス入力、ゼロ遅延またはスタートアップ時の自動構成用のEEPROMを備えたAD9520とAD9522が用意されています。さらにAD9516とAD9517はAD9518と同等の製品ですが、異なる出力の組み合わせを備えています。
それぞれの出力ペアには分周器があり、分周比とコース遅延（または位相）の両方を設定できます。LVPECL出力の分周比の指定範囲は1～32です。
AD9518-3は48ピンLFCSPを採用しており、3.3V単電源で動作します。外付けのVCOには拡張電圧範囲が必要ですが、チャージ・ポンプ電源（VCP）を5Vに接続にすることで対応できます。LVPECLには、2.5～3.3V（公称値）の別電源を利用できます。
AD9518-3の動作は－40～＋85℃の工業用温度範囲で仕様が規定されています。
- 低ジッタ、低位相ノイズ・クロックの分配
- 10/40/100Gbネットワーキング・ライン・カード（SONET、同期式イーサーネット、OTU2/3/4など）
- フォーワード・エラー・コレクション（G.710）
- 高速ADC、DAC、DDS、DDC、DUC、MxFE用クロック
- 高性能無線トランシーバ
- ATEおよび高性能計測器
* このデータシートでは、AD9518と記載されている場合、すべてのAD9518ファミリ製品を意味します。ただし、AD9518-3と記載されている場合は、AD9518ファミリの特定の製品を意味します。
製品カテゴリ
製品ライフサイクル
新規設計にお薦めします
発売済みの製品です。データシートには、最終的な仕様と動作条件がすべて記載されています。新規の設計には、これらの製品の使用を推奨します。
評価キット (1)
参考資料
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AN-769: Generating Multiple Clock Outputs from the AD9540 (Rev. 0)2/14/2015PDF0
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AN-823: Direct Digital Synthesizers in Clocking Applications Time (Rev. 0)2/14/2015PDF115 kB
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AN-939: 高い周波数のRF出力信号が得られるAD9912のスーパーナイキスト動作 (Rev. 0)11/16/2010PDF351 kB
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AN-0974: Multicarrier TD-SCMA Feasibility3/2/2010PDF634 kB
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AN-756: サンプル化システムに及ぼすクロック位相ノイズとジッタの影響 (Rev. 0)4/18/2008PDF359 kB
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AN-927: スプリアスとDDS / DACやその他の発生源（スイッチング電源など）との関係の判定 (Rev. 0)7/12/2007PDF327 kB
-
AN-837: DAC再生フィルタ性能とDDS採用時のクロック・ジッタ性能の関係 (Rev. 0)12/28/2006PDF528 kB
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AN-835: 高速A/Dコンバータ（ADC）のテストと評価について (Rev. 0)12/11/2006PDF1039 kB
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AN-873: ADF4xxx PLLシンセサイザ・ファミリーでのロック検出 (Rev. 0)12/6/2006PDF349 kB
-
AN-501: アパーチャ不確定性とADCシステム性能 (Rev. A)11/29/2004PDF212 kB
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AN-741: 位相ノイズの知られざる特性 (Rev. 0)11/29/2004PDF1076 kB
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高速A/Dコンバータ（ADC）のテストと評価について (Rev. AN-835)1/1/2000PDF
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UG-075: AD9516-x, AD9517-x, and AD9518-x Evaluation Board User Guide1/30/2010PDF1089 kB
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FAQ7/26/2017
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RF/マイクロ波/ミリ波IC セレクション・ガイド11/2/2022PDF7 M
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Low-power direct digital synthesizer cores enable high level of integration2/20/2008
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Improved DDS Devices Enable Advanced Comm Systems9/1/2006
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複数のクロック・エッジに注意！8/1/2010
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コモンモードを共通にしておく4/1/2009
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そのフィルタ、ちゃんとフィルタリングしてますか？2/1/2009
ツールおよびシミュレーション
設計ツール
ADIsimCLK 設計・評価 ソフトウェア
ADIsimCLKはアナログ・デバイセズの超低ジッタのクロック分配器とクロック生成用製品向けに開発された設計ツールです。ADIsimCLKを使用すれば、ワイヤレス・インフラストラクチャ、計測器、ネットワーキング、ブロードバンド、ATE（自動試験装置）あるいはクロック性能が予測可能であることが求められるあらゆる分野のアプリケーションで、設計を迅速に開発、評価、最適化できます。
設計リソース
アナログ・デバイセズでは、最高レベルの品質と信頼性を備えた製品を提供することに最大の力を常に注いでいます。これを実現するため、製品およびプロセスの設計のあらゆる観点で品質と信頼性のチェックを行っています。そして、それは、製造工程においても同様です。アナログ・デバイセズは常に、出荷製品の「ゼロ・ディフェクト」を目指しています。詳細についてはアナログ・デバイセズの品質および信頼性プログラム/認定証をご覧ください。
| 製品番号 | 材料宣誓書（MD） | 信頼性データ | ピン/パッケージ図 | CADシンボル、フットプリント & 3Dモデル |
|---|---|---|---|---|
| AD9518-3ABCPZ | 材料宣誓書（MD） | 信頼性データ | 48-Lead LFCSP (7mm x 7mm x 0.85mm w/ EP) | |
| AD9518-3ABCPZ-RL7 | 材料宣誓書（MD） | 信頼性データ | 48-Lead LFCSP (7mm x 7mm x 0.85mm w/ EP) | |
| AD9518-3BCPZ | 材料宣誓書（MD） | 信頼性データ | 48-Lead LFCSP (7mm x 7mm w/ EP) | |
| AD9518-3BCPZ-REEL7 | 材料宣誓書（MD） | 信頼性データ | 48-Lead LFCSP (7mm x 7mm w/ EP) | |
| ウェハ・ファブリケーション・データ |
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リードタイム
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評価用ボード
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analog.comサイトから購入できるボードは、最大で2枚までとなります。3枚以上の購入をご希望の場合は、正規販売代理店からご購入ください。
価格は1個当たりの米ドルで、米国内における販売価格（FOB）で表示されておりますので、予算のためにのみご使用いただけます。 また、その価格は変更されることがあります。米国以外のお客様への価格は、輸送費、各国の税金、手数料、為替レートにより決定されます。価格・納期等の詳細情報については、弊社正規販売代理店または担当営業にお問い合わせください。なお、 評価用ボードおよび評価用キットの表示価格は1個構成としての価格です。