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HMC1033 Data Sheet4/22/2015
概览
优势和特点
- 仅适用于3.3 V单电源轨操作
- 输出频率范围：25 MHz - 550 MHz
- 整数或小数N分频模式频率转换
- 可配置LVDS兼容或LVPECL型差分输出
- “电源优先级”和“性能优先级”模式
- <99 fs RMS抖动产生（12 kHz-20 MHz、350MHz、典型值）
- -163 dBc/Hz相位噪底可提高ADC/DAC SNR性能（最大输出摆幅电平）
- PLL环路带宽通过外部滤波器可调
- 输出禁用/静音控制
- 锁定检测信号
- 精确频率模式以实现参考频率调谐和0 Hz频率误差
- 40引脚6x6mm SMT封装： 36mm²
产品详情
HMC1033LP6GE是一款具有小数N分频锁相环(PLL)的低噪声、宽带3.3 V时钟发生器IC，集成了电压控制振荡器(VCO)。 该器件提供频率范围为25 MHz至550 MHz的差分时钟输出。 HMC1033LP6GE由低噪声鉴相器(PD)和Σ-Δ型调制器组成，工作频率范围高达100 MHz，提供较宽的环路带宽和出色的杂散性能。
HMC1033LP6GE在整个工作范围内提供业界领先的相位噪声和抖动性能，可改善链路级抖动性能、误码率(BER)和眼图指标。 出色的噪底(<-162 dBc/Hz)使HMC1033LP6GE非常适合各种应用，如高速数据转换器、物理层器件(PHY)、串行器/解串器(SER DES)电路、FPGA和处理器的参考时钟。 HMC1033LP6GE也可用作10G/40G/100G光学模块和应答器的LO，以及10G/40G/100G线路卡、抖动衰减和频率转换的主参考时钟。
HMC1033LP6GE的差分输出可设置为LVPECL或LVDS兼容模式，增进的输出摆幅使该器件能够灵活满足各种信号电平要求。 该输出可内部端接以减少器件数并降低成本。 在LVPECL模式下，采用标准方法（如接地电阻）可外部端接这些输出。 用户利用输出静音功能可关闭输出，如板测试或调试的需求。 LVPECL/LVDS、振幅选择和输出静音功能均采用可编程SPI串行编程。
HMC1033LP6GE设计用于选择电源优先级或性能优先级模式。 电源优先级设置可降低器件功耗，而性能优先级设置可提高抖动和相位噪声性能。
24位Σ-Δ型调制器进一步增强了Hittite的精确频率模式，用户能够在很多应用中产生误差为0 Hz的输出频率。
应用
- 10G/40G/100G光学模块、应答器、线路卡
- OTN和SONET /SDH应用
- 数据转换器、采样时钟产生
- 蜂窝/4G基础设施
- 高频处理器/FPGA时钟
- 任何频率时钟速率产生应用
- 替代低抖动SAW振荡器
- 替代DDS
- 频率转换
- 频率裕量微调
产品生命周期
最后一次采购
该系列中的所有产品将很快停产。请联系ADI公司销售部或代理商安排最后一次采购，并阅读“停产信息”以了解最后下单和收货的时限。
评估套件 (1)
参考资料
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PLL & PLLVCO Serial Programming Interface Mode Selection Application Note2/29/2016
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Power-Up & Brown-Out Design Considerations for RF PLL+VCO Products Application Note2/29/2016
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Wideband RF PLL+VCO and Clock Generation Products FAQs2/29/2016
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Frequency Hopping with Hittite PLLVCOs Application Note2/29/2016
配套产品推荐
HMC1033 配套产品
设计资源
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| Part Number | Material Declaration | Reliability Data | Pin/Package Drawing | CAD Symbols, Footprints & 3D Models |
|---|---|---|---|---|
| HMC1033LP6GE | 材料声明 | 质量和可靠性 | 40-Lead QFN (6mm x 6mm w/ EP) | |
| HMC1033LP6GETR | 材料声明 | 质量和可靠性 | 40-Lead QFN (6mm x 6mm w/ EP) | |
| Wafer Fabrication Data |
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