概览
优势和特点
- 传播延迟：95 ps
- 反转率：7.5 GHz
- 典型输出上升/下降：60 ps
- 随机抖动(RJ)：60 fs
- 两个输入引脚上均有片内端电极
- 扩展工业温度范围：−40°C至+125°C
- 电源：2.5 V至3.3 V (VCC – VEE)
产品详情
ADCLK905（单输入/单输出）、ADCLK907（双通道单输入/单输出）和ADCLK925（单输入/双输出）为超高速时钟/数据缓冲器，采用ADI公司专有的XFCB3硅锗(SiGe)双极性工艺制造。ADCLK905/ADCLK907/ADCLK925内置全摆幅射极耦合逻辑（ECL）输出驱动器。对于PECL（正ECL）工作模式，将VCC偏置至正电源，将VEE 偏置至接地。对于NECL(负ECL)工作，VCC偏置至接地，VEE 偏置到负电源。
缓冲器具备95 ps的传播延迟、7.5 GHz的触发率、10 Gbps的数据速率以及60 fs的随机抖动(RJ)。
输入含有100 Ω的中心抽头片内端接电阻。提供VREF引脚用于偏置交流耦合输入。
ECL输出级旨在从各端将800 mW直接驱动至端接于VCC − 2 V的50 Ω负载，从而获得1.6 V的总差分输出摆幅
ADCLK905/ADCLK907/ADCLK925提供16引脚LFCSP封装。
应用
产品生命周期
推荐新设计使用
本产品已上市。数据手册包含所有最终性能规格和工作条件。ADI公司推荐新设计使用这些产品。
评估套件 (1)
参考资料
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AN-769: 基于AD9540产生多时钟输出 (Rev. 0)8/26/2010PDF130 kB
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AN-873: ADF4xxx系列PLL频率合成器的锁定检测 (Rev. 0)9/25/2009PDF0
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AN-939: 利用AD9912的超奈奎斯特频率操作得到高RF输出信号 (Rev. 0)10/29/2007PDF0
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AN-927: 确定杂散来源是DDS/DAC还是其他器件(例如开关电源)[中文版] (Rev. 0)7/12/2007PDF234 kB
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AN-837: 基于DDS的时钟抖动性能与DAC重构滤波器性能的关系[中文版] (Rev. 0)12/28/2006PDF416 kB
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AN-823: 时钟应用中的直接数字频率合成器[中文版] (Rev. 0)10/12/2006PDF303 kB
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AN-756: 系统采样以及时钟相位噪声和抖动的影响[中文版] (Rev. 0)12/2/2004PDF808 kB
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AN-501: 孔径不确定度与ADC系统性能[中文版] (Rev. A)11/29/2004PDF227 kB
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AN-741: 鲜为人知的相位噪声特性11/29/2004PDF359 kB
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UG-582: Evaluating the EVAL-CN0290-SDPZ9/4/2013PDF306 kB
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UG-006：设置ADCLK905/ADCLK907/ADCLK925评估板9/11/2009PDF335 kB
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FAQs3/10/2020
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MT-008: 将振荡器相位噪声转换为时间抖动3/5/2009PDF123 kB
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RF、微波和毫米波IC选型指南7/13/2018PDF3 M
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CN-0290：扩展高性能锁相环的低频范围6/12/2014PDF406 kB
工具及仿真模型
设计工具
ADIsimCLK设计与评估软件
ADIsimCLK是一款专门针对ADI公司的超低抖动时钟分配和时钟产生产品系列而开发的设计工具。无论是在无线基础设施、仪器仪表、网络、宽带、自动测试设备领域，还是在其它要求可预测时钟性能的应用，ADIsimCLK都能帮助您迅速开发、评估和优化设计。
参考电路 (1)
设计资源
ADI始终把满足您可靠性水平的产品放在首要位置。我们通过在所有产品、工艺设计和制造过程中引入高质量和可靠性检查实践这一承诺。发运的产品实现“零缺陷”始终是我们的目标。
| Part Number | Material Declaration | Reliability Data | Pin/Package Drawing | CAD Symbols, Footprints & 3D Models |
|---|---|---|---|---|
| ADCLK925BCPZ-R2 | 材料声明 | 质量和可靠性 | 16-Lead LFCSP (3mm x 3mm w/ EP) | |
| ADCLK925BCPZ-R7 | 材料声明 | 质量和可靠性 | 16-Lead LFCSP (3mm x 3mm w/ EP) | |
| ADCLK925BCPZ-WP | 材料声明 | 质量和可靠性 | 16-Lead LFCSP (3mm x 3mm w/ EP) | |
| Wafer Fabrication Data |
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