概览
优势和特点
- JESD204B（子类 1）编码串行数字输出
- 每通道支持高达16 Gbps的通道速率
- 3 GSPS时总功耗：2 W（默认设置）
- −2 dBFS 幅度时性能（2.6 GHz输入）
- SFDR = 70 dBFS
- SNR = 57.2 dBFS
- −9 dBFS 幅度时性能（2.6 GHz输入）
- SFDR = 78 dBFS
- SNR = 59.5 dBFS
- 集成输入缓冲器
- 噪声密度 = -152 dBFS/Hz
- 0.975 V、1.9 V和2.5 V直流电源供电
- 模拟输入全功率带宽：9 GHz (−3 dB)
- 幅度检测位支持实现高效AGC
- 4个集成式数字下变频器
- 48 位 NCO
- 4 个级联半带滤波器
- 相位相干NCO开关
- 最多提供4个通道
- 串行端口控制
- 具有2和4分频选项的整数时钟
- 灵活的JESD204B通道配置
- 片内扰动
- 通过AEQ-Q100汽车应用认证
产品详情
AD9699是一款单通道、14位3 GSPS模数转换器(ADC)。该器件内置片内缓冲器和采样保持电路，专门针对低功耗、小尺寸和易用性而设计。该产品设计支持能够对高达5 GHz的宽带宽模拟信号进行直接采样的应用。ADC输入的−3 dB带宽为9 GHz。AD9699针对宽输入带宽、高采样速率、出色的线性度和小封装低功耗而优化。
这款ADC内核采用多级、差分流水线架构，并集成了输出纠错逻辑。该ADC具有宽带宽输入，支持用户可选的各种输入范围。集成基准电压源可简化设计考量。模拟输入和时钟信号均为差分输入信号。ADC数据输出通过纵横多路复用器内部连接到四个数字下变频器(DDC)。各DDC最多由五个级联信号处理级组成：48位频率转换器、（数控振荡器(NCO)），以及最多四个半带抽取滤波器。NCO可以选择通用输入/输出(GPIO)引脚范围内的预设频带，支持选择最多三个频带。AD9699的DDC工作模式可通过串行外设接口(SPI)可编程配置文件选择。
除了DDC模块，AD9699还具备其他功能，能够简化通信接收器的自动增益控制(AGC)功能。利用ADC的寄存器0x0245中的快速检测控制位，可编程阈值检测器可以监控输入信号功率。如果输入信号电平超过可编程阈值，快速检测指示器就会变为高电平。由于该阈值指示器的延迟极短，因此用户能够快速调低系统增益，从而避免ADC输入端出现超量程现象。除了快速检测输出外，AD9699还具有信号监控能力。信号监控模块可提供ADC进行数字化处理信号的其它信息。
用户可将JESD204B子类1的高速串行输出设置为各种单通道、双通道、四通道和八通道配置，具体取决于接收逻辑器件的DDC配置和可接受通道速率。通过SYSREF±和SYNCINB±输入引脚，可支持多器件同步。
AD9699具有灵活的关断选项，在需要时可以大幅降低功耗。所有这些特性均可通过三线式SPI进行编程。
AD9699采用12 mm × 12 mm、196引脚无铅BGA封装，额定温度范围为−40°C至+85°C环境温度范围。该产品受美国专利保护。
请注意，在整篇数据手册中，多功能引脚（如FD/GPIO_A0）由整个引脚名称或引脚的单个功能表示；例如FD即表示仅与此功能相关。
产品特色
- 9 GHz的宽输入−3 dB带宽支持约5 GHz的直接RF信号采样。
- 四个集成式宽带抽取滤波器和NCO模块支持多频段接收器。
- 快速NCO开关通过GPIO引脚使能。
- SPI控制各种产品特性和功能，满足特定系统要求。
- 可编程快速超量程检测和信号监控。
- 用于系统热管理的片内温度二极管。
- 12 mm × 12 mm、196引脚BGA封装。
应用
- 分集多频段和多模数字接收器
- 3G/4G、TD-SCDMA、W-CDMA、GSM、LTE-A
- 电子测试与测量系统
- 相控阵雷达和电子战
- DOCSIS 3.0 CMTS上游接收路径
- HFC数字反向路径接收器
- LIDAR
产品生命周期
推荐新设计使用
本产品已上市。数据手册包含所有最终性能规格和工作条件。ADI公司推荐新设计使用这些产品。
评估套件 (2)
参考资料
-
RF、微波和毫米波IC选型指南7/13/2018PDF3 M
工具及仿真模型
IBIS模型
IBS
AD9208 IBIS Model
90.41 K
S参数
设计工具
Virtual Eval - BETA
在工作条件下仿真ADC和DAC的性能。
ZIP
AD9208 Delphi Model
1.25 K
Companion Transport Layer RTL Code Generator Tool (Rev. 1.0)
This command line executable tool generates a Verilog module which implements the JESD204 receive transport layer. The user specifies in a configuration file one or more modes to be supported by the transport layer module. These modes are defined as a set of JESD204 parameter values: L, M, F, S, N', and CF. The transport layer converts JESD204 lane data output from a JESD204 link layer IP to a data bus with a fixed width, containing interleaved virtual converter samples. Both JESD204B and JESD204C link layers are supported.
JESD204x Frame Mapping Table Generator
The JESD204x Frame Mapping Table Generator tool consists of two Windows executables that will allow the user to input any valid combination of JESD204x parameters (L, M, F, S, NP) in order to output a .csv file that illustrates the frame mapping of the JESD204x mode in table format. There is an executable that allows the user to input a single JESD204x mode and another, that allows the user to input the parameters for multiple JESD204x modes in a specified .csv format in order to output a .csv file that illustrates the frame mapping of each of the JESD204x modes that were input into separate tables.
设计资源
ADI始终把满足您可靠性水平的产品放在首要位置。我们通过在所有产品、工艺设计和制造过程中引入高质量和可靠性检查实践这一承诺。发运的产品实现“零缺陷”始终是我们的目标。
| Part Number | Material Declaration | Reliability Data | Pin/Package Drawing | CAD Symbols, Footprints & 3D Models |
|---|---|---|---|---|
| AD9699BBPZ-3000 | 材料声明 | 质量和可靠性 | 196-Ball BGA (12mm x 12mm x 1.42mm w/ EP) | |
| AD9699BBPZRL-3000 | 材料声明 | 质量和可靠性 | 196-Ball BGA (12mm x 12mm x 1.42mm w/ EP) | |
| AD9699WBBPZ-3000 | 材料声明 | 质量和可靠性 | 196-Ball BGA (12mm x 12mm x 1.42mm w/ EP) | |
| AD9699WBBPZRL-3000 | 材料声明 | 质量和可靠性 | 196-Ball BGA (12mm x 12mm x 1.42mm w/ EP) | |
| Wafer Fabrication Data |
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