クロック分配器

クロック分配器は、さまざまなアプリケーションに対応したアナログ・デバイセズの製品からぜひお選びください。ワイヤレス・インフラストラクチャ、計測器、ブロードバンドおよびATE ( 半導体自動テスタ ) など、ピコ・セカンド以下のジッタ性能が要求される高性能なアプリケーション向けに、超低ジッタのクロック分配器とクロック発生器を提供しています。

アナログ・デバイセズのクロック分配器製品は低ジッタ、低位相ノイズ、低スプリアスを実現しており、高性能なA/Dコンバータ ( ADC ) やD/Aコンバータ ( DAC ) を理想的にクロッキングできます。さらにPLLコア、分周器、位相オフセット機能、スキュー調整そしてクロック・ドライバ回路を、小型のチップ・スケール・パッケージに収納しています。

クロック分配器、クロック発生器の製品一覧はこちらです。ご希望のスペックからお選びいただけます。あらゆるアプリケーションで迅速な設計を可能にするADIsimCLKは、専用に開発された設計ツールです。ダウンロードしてご利用ください。アプリケーション・ノート、ホワイトペーパーやビデオなど技術資料もぜひご覧ください。

Circuit from the lab アナログ・デバイセズの技術者が開発してテスト済。すぐにお使い頂けます。

製品セレクションテーブル

Clock Generation/Distribution

Part#Clock FunctionOutput FrequencyNumber of OutputsOn-Chip VCO or DCOJitterConfig/Programming InterfaceOutput LogicVsupply (min)Vsupply (max)
AD9554-1 Frequency Translation 941 MHz 4 Yes 106 fs I2C CMOS 1.47 2.625
AD9554 Frequency Translation 941 MHz 4 Yes 116 fs I2C CMOS 1.47 2.625
AD9508 Clock Buffer 1.65 GHz 4 No 41 fs I2C CMOS 2.375 3.465
AD9525 Generation 3.6 GHz 8 Yes 63 fs Serial CMOS 3.135 3.465
AD9559 Frequency Translation 1.25 GHz 4 Yes - I2C CMOS 3.135 3.465
AD9577 Generation 637.5 MHz 8 Yes - I2C CMOS 3 3.6
AD9558 Clean Up 1.25 GHz 6 Yes - I2C CMOS 3.135 3.465
AD9557 Clean Up 1.25 GHz 4 Yes - I2C LVCMOS 1.71 3.465
AD9550 Frequency Translation 810 MHz 2 Yes 440 fs Pin Select CMOS 3.135 3.465
AD9523-1 Distribution 1 GHz 14 Yes 124 fs I2C CMOS 1.71 3.465
AD9524 Distribution 1 GHz 14 Yes 125 fs Serial CMOS 1.71 3.465
AD9523 Distribution 1 GHz 14 Yes 125 fs LVDS CMOS 1.71 3.465
ADN4670 Clean Up 1.1 GHz 10 No 111 fs Serial LVDS 2.375 2.625
ADCLK944 Clock Buffer 7 GHz 4 No 50 fs Serial CMOS 2.375 3.63
AD9553 Frequency Translation 810 MHz 2 Yes 440 fs Pin Select CMOS 3.135 3.465
AD9575 Generation 312.5 MHz 2 Yes 360 fs Serial CMOS 3 3.6
AD9571 Generation 156.25 MHz 10 Yes 225 fs Serial CMOS 3 3.6
ADCLK950 Distribution 4.8 GHz 10 No 75 fs Serial CMOS 2.97 3.63
ADCLK948Reference Circuit Available Distribution 4.8 GHz 8 No 75 fs Serial CMOS 2.97 3.63
ADCLK846Reference Circuit Available Clock Buffer 1.2 GHz 6 No 150 fs Pin Select CMOS 1.71 1.89
AD9573 Generation 100 MHz 2 Yes 540 fs LVDS LVDS 3 3.6
AD9572 Generation 125 MHz 7 Yes 167 fs Serial LVDS 3 3.6
AD9552Reference Circuit Available Frequency Translation 900 MHz 2 Yes 600 fs Pin Select CMOS 3.135 3.465
AD9547 Generation 725 MHz 4 Yes 310 fs I2C CMOS 1.71 3.465
ADCLK954 Clock Buffer 4.8 GHz 12 No 75 fs Pin Select LVPECL 2.97 3.63
ADCLK946 Clock Buffer 4.8 GHz 6 No 75 fs Pin Select LVPECL 2.97 3.63
ADCLK854Reference Circuit Available Clock Buffer 1.2 GHz 12 No 150 fs Pin Select CMOS 1.71 1.89
AD9551 Frequency Translation 900 MHz 2 Yes 600 fs Pin Select CMOS 3.135 3.465
AD9548 Clean Up 450 MHz 4 Yes 500 fs Serial CMOS 1.71 3.465
AD9522-5 Clean Up 2.4 GHz 12 No 242 fs Serial CMOS 3.135 3.465
AD9522-2 Clean Up 2.335 GHz 12 Yes 242 fs Serial CMOS 3.135 3.465
AD9522-1 Clean Up 2.65 GHz 12 Yes 242 fs Serial CMOS 3.135 3.465
AD9516-5 Clean Up 2.4 GHz 14 No 400 fs Serial CMOS 3.135 3.465
ADCLK914 Clock Buffer 7.5 GHz 1 No 110 fs - HVDS 2.97 3.63
AD9522-4 Clean Up 1.6 GHz 12 Yes 242 fs Serial CMOS 3.135 3.465
AD9522-3 Clean Up 2.25 GHz 12 Yes 245 fs Serial CMOS 3.135 3.465
AD9522-0 Clean Up 2.95 GHz 12 Yes 242 fs Serial CMOS 3.135 3.465
AD9520-5Reference Circuit Available Clean Up 2.4 GHz 12 No 225 fs Serial CMOS 3.135 3.465
AD9520-4Reference Circuit Available Clean Up 1.8 GHz 12 Yes 225 fs Serial CMOS 3.135 3.465
AD9520-3Reference Circuit Available Clean Up 2.25 GHz 12 Yes 225 fs Serial CMOS 3.135 3.465
AD9520-2Reference Circuit Available Clean Up 2.335 GHz 12 Yes 225 fs Serial CMOS 3.135 3.465
AD9520-1Reference Circuit Available Clean Up 2.65 GHz 12 Yes 225 fs Serial CMOS 3.135 3.465
AD9520-0Reference Circuit Available Clean Up 1.6 GHz 12 Yes 225 fs Serial CMOS 3.135 3.465
AD9549 Clean Up 750 MHz 2 Yes 600 fs Serial CMOS 1.71 3.465
AD9518-4 Clean Up 1.8 GHz 6 Yes 400 fs Serial LVPECL 3.135 3.465
AD9518-3 Clean Up 2.25 GHz 6 Yes 400 fs Serial LVPECL 3.135 3.465
AD9518-2 Clean Up 2.335 GHz 6 Yes 400 fs Serial LVPECL 3.135 3.465
AD9518-1 Clean Up 2.65 GHz 6 Yes 400 fs Serial LVPECL 3.135 3.465
AD9518-0 Clean Up 2.95 GHz 6 Yes 400 fs Serial LVPECL 3.135 3.465
ADCLK925Reference Circuit Available Clock Buffer 7.5 GHz 2 No 60 fs - ECL 2.375 3.63
ADCLK907 Clock Buffer 7.5 GHz 2 No 60 fs - ECL 2.375 3.63
ADCLK905Reference Circuit Available Clock Buffer 7.5 GHz 1 No 60 fs - ECL 2.375 3.63
AD9517-4Reference Circuit Available Clean Up 1.8 GHz 12 Yes 400 fs Serial CMOS 3.135 3.465
AD9517-3 Clean Up 2.25 GHz 12 Yes 400 fs Serial CMOS 3.135 3.465
AD9517-2 Clean Up 2.335 GHz 12 Yes 400 fs Serial CMOS 3.135 3.465
AD9517-1 Clean Up 2.65 GHz 12 Yes 400 fs Serial CMOS 3.135 3.465
AD9517-0 Clean Up 2.95 GHz 12 Yes 400 fs Serial CMOS 3.135 3.465
AD9516-3Reference Circuit Available Clean Up 2.25 GHz 14 Yes 400 fs Serial CMOS 3.135 3.465
AD9516-2Reference Circuit Available Clean Up 2.335 GHz 14 Yes 400 fs Serial CMOS 3.135 3.465
AD9516-4Reference Circuit Available Clean Up 1.8 GHz 14 Yes 400 fs Serial CMOS 3.135 3.465
AD9516-1Reference Circuit Available Clean Up 2.65 GHz 14 Yes 400 fs Serial CMOS 3.135 3.465
AD9516-0Reference Circuit Available Clean Up 2.95 GHz 14 Yes 400 fs Serial CMOS 3.135 3.465
AD9515Reference Circuit Available Distribution 1.6 GHz 2 No 225 fs Pin Select CMOS 3.135 3.465
AD9513Reference Circuit Available Distribution 800 MHz 3 No 300 fs Pin Select CMOS 3.135 3.465
AD9514Reference Circuit Available Distribution 1.6 GHz 3 No 225 fs Pin Select CMOS 3.135 3.465
AD9512Reference Circuit Available Clean Up 1.2 GHz 5 No 225 fs Serial CMOS 3.135 3.465
AD9511 Clean Up 1.2 GHz 5 No 225 fs Serial CMOS 3.135 3.465
AD9510 Clean Up 1.2 GHz 8 No 225 fs Serial CMOS 3.135 3.465
AD9540 Clean Up 655 MHz 1 Yes 700 fs Serial CML 1.71 1.89
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新製品

  • AD9578- シンセサイザ、デュアルPLL、高精度

    AD9578は高性能通信装置、ネットワークキング、データ保存、シリアライザ / ディシリアライザ(SERDES)、物理層(PHY)などのアプリケーションの中のジッタ減衰、非同期クロッックのアプリケーション向けに開発されたプログラマブル・シンセサイザです。デバイスには、0.1ppb以上の精度で任意の周波数を提供する2個の低ジッタPLLが内蔵されていますが、各PLLは2つの別々の出力デバイダを備え合計4つのプログラマブル出力として最大の柔軟性とジッタ性能を提供します。各出力は独立にプログラマブル可能で、強固なサプライ・チェーンが可能な小型、低コスト、基本波モード水晶(XTAL)を利用して<410fs typ rmsジッタ(12kHz~20kHz)で最大919MHzの周波数を提供します。整数周波数合成を使用することにより、AD9578は290fs程度に低いrmsジッタを達成することができます。 続きを見るRead more

    AD9578 機能ブロック図
  • AD9528- ロック・ジェネレータ、14 LVDS / HSTL出力、JESD204B対応

    AD9528は2段PLLで、複数デバイスの同期用にJESD204B SYSREF発生器を内蔵しています。1段目のフェーズ・ロック・ループ(PLL)(PLL1)は処理システム・クロックに存在するジッタを低減して入力リファレンスの調整を行います。2段目のPLL(PLL2)は、高周波クロックを提供しますが、クロック出力ドライバからのクロックは低内部ジッタ、低広域ノイズを実現します。満足な性能を得るために必要な位相ノイズとジッタに対する厳しい要求を実現するために、外部VCXOはPLL2に必要な低ノイズ・リファレンスを提供します。オンチップのVCOは、3.450GHz~4.025GHz間でチューニングできます。内蔵SYSREF発生器はPLL1とPLL2出力に同期した単一ショット、Nショット又は連続信号を出力して複数デバイスの時間を合わせます。

    AD9528は最大周波数1.25GHzの 続きを見るRead more

    AD9528 機能ブロック図
  • ADCLK925S- Aerospace Ultrafast SiGe ECL Clock/Data Buffers

    The ADCLK925S (one input, two outputs) is a ultrafast clock/data buffer fabricated on the Analog Devices, Inc., proprietary XFCB3 silicon germanium (SiGe) bipolar process.

    The ADCLK925S features full-swing emitter coupled logic (ECL) output drivers. For PECL (positive ECL) operation, bias VCC to the positive supply and VEE to ground. For NECL (negative ECL) operation, bias VCC to ground 続きを見るRead more

    ADCLK925S Functional Block Diagram
  • AD9574- クロック・ジェネレータ、イーサーネット / ギガビット・イーサーネット用

    AD9574は、専用のフェーズ・ロック・ループ(PLL)コアから成るマルチ出力のクロック生成機能を提供し、イーサーネットやギガビット・イーサーネットのライン・カード・アプリケーション向けに最適化されています。このインテジャ-NのPLL設計は、高性能、低ジッタの周波数シンセサイザーの製品ラインを提供してきたアナログ・デバイセズの技術に基づいており、ネットワーク性能を最大化します。又、AD9574は低位相ノイズと低ジッタ性能を必要とするその他のアプリケーションにも、有効性があります。

    適切なピン・プログラム・リーダー・ピン(PPRx)に外付けプルアップ抵抗あるいはプルダウン抵抗を接続するだけでAD9574を特定のアプリケーション向けに回路構成することができます。希望の周波数変換、クロック出力機能、入力リファレンス機能を確定するために、これらのピンを利用して内蔵デバイダを制御しま 続きを見るRead more

    AD9574 機能ブロック図
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