最新情報 (1)
製品概要
機能と利点
- デュアル・トランスミッタ
- デュアル・レシーバー
- デュアル入力共有オブザベーション・レシーバー
- 最大 Rx BW:200 MHz
- チューニング可能 Tx シンセシス最大帯域幅:450 MHz
- 最大オブザベーション Rx 帯域幅:450 MHz
- 完全に内蔵されたフラクショナルー N RF シンセサイザ
- 完全に内蔵されたクロック・シンセサイザ
- RF LO およびベースバンド・クロック用マルチチップ位相同期
- JESD204B データ・パス・インターフェース
- チューニング範囲(中心周波数):75 MHz ~ 6000 MHz
製品概要
ADRV9009は高度に集積化されたラジオ周波数(RF)アジャイル・トランシーバーで、デュアル・トランスミッタとレシーバー、集積化されたシンセサイザおよびデジタル信号処理回路を搭載しています。このICは、3Gと4Gのマクロ・セルTDD基地局のアプリケーションに要求される、高性能と低消費電力の様々な組み合わせを実現します。
受信パスは、最先端のダイナミック・レンジを持つ2つの独立、広帯域幅ダイレクト・コンバージョン・レシーバーで構成されています。この部品は、TDDアプリケーションの中で使用される広帯域幅の時間共有オブザベーション・パス・レシーバーもサポートします。全機能内蔵型レシーブ・サブシステムは、自動/マニュアル減衰制御、DC オフセット補正回路、直交誤差補正回路(QEC)、およびデジタル・フィルタリングを内蔵しているため、デジタル・ベースバンドにこれらの機能は不要です。PAとRFフロント・エンド制御用ADC、DACおよびGPIOといったいくつかの補助機能も内蔵されています。
自動AGCに加えて、柔軟性のある外部ゲイン制御モードも備えているため、システム・レベル・ゲインをダイナミックに設定する大幅な柔軟性を実現しています。
受信した信号は、固有のアンチエイリアシングを提供する4個の高ダイナミック・レンジ連続時間シグマ-デルタADCによってデジタル化されます。帯域外イメージ・ミクシングから影響を受けないダイレクト・コンバージョン・アーキテクチャの組合わせ、およびエイリアシングがないことで、従来のIFレシーバーに比べてRFフィルタの要件が緩和されます。
トランスミッタは、高い変調精度を例外的な低ノイズで実現する革新的なダイレクト・コンバージョン変調器を使用します。
観測パスは、最先端のダイナミック・レンジを持つ広帯域幅ダイレクト・コンバージョン・レシーバーで構成されています。
トランスミッタは、高い変調精度を例外的な低ノイズで実現する革新的なダイレクト・コンバージョン変調器を使用します。
全機能内蔵のフェーズロック・ループ(PLL)は、トランスミッタとレシーバー信号パスに対して高性能で低消費電力のフラクショナル N-RF 周波数シンセシスを提供します。追加のシンセサイザーは、コンバータ、デジタル回路およびシリアル・インターフェースに必要なクロックを発生します。高性能基地局のアプリケーションに必要な絶縁を与えるため、特別な予防策をとります。電圧制御発振器(VCO)とループ・フィルタの全ての構成要素が内蔵されています。
高速のJESD204Bインターフェースは、最大 12.288 Gbpsまでのレーン・レートをサポートし、トランスミッタ当たり2レーン、および最高広帯域幅モードではレシーバー当たり1レーンを実現します。インターフェースは、低帯域幅用にインターリーブ・モードもサポートしていて、高速データ・インターフェース・レーンの総数を1個に削減しています。固定小数点と浮動小数点両方のデータ・フォーマットをサポートしています。浮動小数点フォーマットは、内部AGCを復調器デバイスに見えないようにできます。フォーマットの詳細は、デバイス・ユーザ・ガイドの中にあります。
ADRV9009のコアは、1.3Vと1.8Vのレギュレータから直接給電でき、標準4線式シリアル・ポートで制御します。通常使用の消費電力を最小化するため、包括的パワーダウン・モードが含まれています。ADRV9009 は、12mm × 12mm、196 ボールのチップ・スケール・ボール・グリッド・アレイ(CSP_BGA)パッケージを採用しています。
アプリケーション
- 3G/4G/5G TDD マクロ・セル基地局
- TDDのアクティブ・アンテナ・システム
- Massive MIMO
- フェーズド・アレイ・レーダー
- 電子戦
- 防衛用通信
- 携帯試験装置
製品ライフサイクル
新規設計にお薦めします
発売済みの製品です。データシートには、最終的な仕様と動作条件がすべて記載されています。新規の設計には、これらの製品の使用を推奨します。
評価キット (4)
参考資料
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Find the Right Balance: Power Supply Noise vs RF Signal Chain Performance (EngineerZone)8/2/2023
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Designing Power Solutions for RF Signal Chain Applications (EngineerZone)6/20/2022
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Multi-Channel Phase And Frequency Synchronization Made Easy2/7/2019
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The Four Pillars of Optimizing Analog Integration9/19/2018
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RF Technology for 5G mmWave Radios8/30/2018
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Design Challenges for Aerospace and Defense SDR6/7/2018
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RF/マイクロ波/ミリ波IC セレクション・ガイド11/2/2022
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RadioVerseファミリのトランシーバー「ADRV9009」、その機能/性能を概観する10/31/2019
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「ADRV9009」用の評価キット4/5/2019
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RadioVerseの新要素「ADRV9009」の概要3/18/2019
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「2019 Microwave Workshop & Exhibition」に出展12/10/2021
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デジタル・プリディストーションの微調整とトラブルシューティングのための完全ガイド2/18/2022
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RF PLL位相同期機能を備えたSDRをMassive MIMOシステムやフェーズド・アレイ・システムに使用してアンテナ・キャリブレーションを簡素化1/7/2022
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フラットパネル型フェーズド・アレイ・アンテナの設計を可能にするIC技術9/1/2020
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トランシーバーの位相ノイズ分析からわかる外部LO使用時の性能10/1/2019
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フェーズド・アレイ・レーダー向けの小型 プラットフォームに最適なトランシーバーIC6/1/2019
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フェーズド・アレイ・アプリケーション用のRFエレクトロニクス1/1/2019
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次世代の防衛用通信に向けて解決すべき課題12/1/2018
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5Gに対応する通信技術、その現状と未来11/1/2018
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RFトランシーバーICにより、デジタル・ビームフォーミング方式のフェーズド・アレイにおけるスプリアスの相関を排除8/1/2018
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ソフトウェア & システム
評価ソフトウェア
Wideband RF Transceiver Evaluation Software
ツールおよびシミュレーション
設計ツール
This site contains the device documentation packages for the SDR Integrated Transceivers including user guides, IBIS models, and PCB files.
アナログ・デバイセズのADIsimRF設計ツールは、カスケード・ゲインやノイズ指数、IP3、P1dB、総合消費電力などRFシグナル・チェーン内の最も重要なパラメータの計算を行います。
設計リソース
アナログ・デバイセズでは、最高レベルの品質と信頼性を備えた製品を提供することに最大の力を常に注いでいます。これを実現するため、製品およびプロセスの設計のあらゆる観点で品質と信頼性のチェックを行っています。そして、それは、製造工程においても同様です。アナログ・デバイセズは常に、出荷製品の「ゼロ・ディフェクト」を目指しています。詳細についてはアナログ・デバイセズの品質および信頼性プログラム/認定証をご覧ください。
製品番号 | 材料宣誓書(MD) | 信頼性データ | ピン/パッケージ図 | CADシンボル、フットプリント & 3Dモデル |
---|---|---|---|---|
ADRV9009BBCZ | 材料宣誓書(MD) | 信頼性データ | 196-Ball CSPBGA (12mm x 12mm) | |
ADRV9009BBCZ-REEL | 材料宣誓書(MD) | 信頼性データ | 196-Ball CSPBGA (12mm x 12mm) | |
ウェハ・ファブリケーション・データ |
サポート & ディスカッション
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