概览
优势和特点
- 4 个差分变送器
- 4 个差分接收器
- 2 个观察接收器，各带 2 个输入
- 中心频率
- 650 MHz 至 3800 MHz (ADRV9010BBCZ)
- 650 MHz 至 6000 MHz (ADRV9010BBCZ-A)
- 最大接收器带宽：200 MHz
- 最大变送器带宽：200 MHz
- 最大变送器合成带宽：450 MHz
- 最大观察接收器带宽：450 MHz
- 完全集成的独立小数 N 射频频率合成器
- 完全集成的时钟频率合成器
- 适用于所有本地振荡器和基带时钟的多芯片相位同步
- JESD204B/JESD204C 数字接口
产品详情
ADRV9010是一款高度集成的射频(RF)捷变收发器，提供四个独立控制的发射器、用于监测每个发射器通道的专用观测接收器输入、四个独立控制的接收器、集成式频率合成器和数字信号处理功能，形成了完整的收发器解决方案。该器件提供蜂窝基础设施应用所需的较高无线电性能和低功耗，例如基于TDD的小型蜂窝基站无线电，宏3G/4G/5G TDD系统和基于TDD的大规模多入/多出(MIMO)基站。ADRV9010BBCZ工作频率范围为650 MHz至3800 MHz，涵盖大部分特许执照和免执照蜂窝频段。ADRV9010BBCZ-A的工作频率范围为650 MHz至6000 MHz。
接收器子系统由四个独立的宽带宽、直接变频接收器组成，具有出色的动态范围。四个独立的发射器采用创新的直接变频调制器，可实现高调制精度和极低噪声。ADRV9010器件还包括两个宽带宽时间共享观测路径接收器，每个接收器具有两路输入，用于监测发射器输出。
完整的收发器子系统包括自动和手动衰减控制、直流失调校正、正交误差校正(QEC)和数字滤波功能，因此数字基带中不再需要这些功能。它还集成了其他辅助功能，例如模数转换器(ADC)、数模转换器(DAC)，以及用于提供各种数字控制选项的通用输入/输出(GPIO)。
为了实现较高的RF性能水平，该收发器包含五个完全集成的锁相环(PLL)。两个PLL为发射器和接收器信号路径提供高性能、低功耗的小数N分频RF频率合成。还有一个完全集成的PLL，支持观测接收器的独立本振(LO)模式。另一个PLL生成转换器和数字电路所需的时钟，第五个PLL则为串行数据接口提供时钟。多芯片同步机制可在多个ADRV9010芯片之间同步所有LO相位和基带时钟。该器件集成了所有压控振荡器(VCO)和环路滤波器元件，并可通过数字控制接口进行调整。
串行数据接口包括八个串行器通道和八个解串器通道。该接口支持JESD204B和JESD204C标准，能以高达16.22016 Gbps的数据速率运行。该接口还支持针对更低带宽的交错模式，从而将高速数据接口通道数降至1。它还支持固定和浮点两种数据格式。浮点格式使内部自动增益控制(AGC)对解调器器件不可见。
ADRV9010可以直接由1.0 V、1.3 V和1.8 V稳压器供电，并通过一个标准串行外设接口(SPI)进行控制。全面的节电模式可将正常使用情况下的功耗降至最低。ADRV9010采用14 mm × 14 mm、289引脚芯片级球栅阵列(CSP_BGA)封装。
应用
- 3G/4G/5G TDD宏蜂窝和小型蜂窝基站
- 用于先进的LTE和5G的TDD有源天线系统
如需技术支持，请直接将问题发布在ADRV9010 EngineerZone® 论坛 或给adrv9010_support@analog.com发送电子邮件。请注意，对于通过电子邮件发送的问题，将在 ADRV9010 EngineerZone® 论坛上予以解答。
产品生命周期
推荐新设计使用
本产品已上市。数据手册包含所有最终性能规格和工作条件。ADI公司推荐新设计使用这些产品。
评估套件 (2)
参考资料
-
RF、微波和毫米波IC选型指南7/13/2018
软件代码及系统需求
评估软件
ADRV9010 Released Software SW4.1.0.84
The ADRV9010 software package contains the GUI software, the API source code, the firmware file, and the gain tables. The GUI software enables transceiver testing using the evaluation board and the Windows GUI. The API source code is intended for use in a customer system and can be integrated with the rest of the customer code and compiled for the target system. The firmware file in binary format is used by the ARM® processor on the transceivers. The gain tables include the receiver gain tables and transmitter attenuation table. Note that the files within the zip must be used together. For example, the ARM files from one zip file cannot be used with the API files from another version.
PDF
68.47 K
ADRV9010 Release Build Software Release Notes (PDF) SW4.1.0.84
The SW4.1.0.84 release build provides ARM firmware, stream files, API, and GUI software to support the ADRV9010.
工具及仿真模型
设计工具
ADIsimRF
ADIsimRF是一款简单易用的RF信号链计算工具。可以计算和导出多达50级的信号链级联增益、噪声、失真和功耗并绘制其曲线。ADIsimRF还包括丰富的ADI射频和混合信号元件的器件模型数据库。
ZIP
ADRV9010 Design File Package (Last Updated 1/2021)
1.01 M
The Design File Package includes the IBIS models, BSDL models, JCOM models, and S-parameters.
设计资源
ADI始终把满足您可靠性水平的产品放在首要位置。我们通过在所有产品、工艺设计和制造过程中引入高质量和可靠性检查实践这一承诺。发运的产品实现“零缺陷”始终是我们的目标。
| Part Number | Material Declaration | Reliability Data | Pin/Package Drawing | CAD Symbols, Footprints & 3D Models |
|---|---|---|---|---|
| ADRV9010BBCZ | 材料声明 | 质量和可靠性 | 289-Ball CSPBGA (14 mm x 14 mm x 1.34 mm) | |
| ADRV9010BBCZ-A | 材料声明 | 质量和可靠性 | 289-Ball CSPBGA (14 mm x 14 mm x 1.34 mm) | |
| ADRV9010BBCZ-REEL | 材料声明 | 质量和可靠性 | 289-Ball CSPBGA (14 mm x 14 mm x 1.34 mm) | |
| Wafer Fabrication Data |
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