AD9852

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CMOS 300 MSPS 完整 DDS

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概述

  • 300 MHz 内部时钟频率
  • FSK、BPSK、PSK、线性调频、AM 操作
  • 双集成式 12 位数模转换器
  • 超高速比较器、3 ps rms 抖动
  • 出色的动态性能
    • 100 MHz (±1 MHz) AOUT时 SFDR 为 80 dB
  • 4× 至 20× 可编程基准时钟倍频器
  • 双 48 位可编程频率寄存器
  • 双 14 位可编程相位偏移寄存器
  • 12 位可编程幅度调制和开/关输出形状调整键控功能
  • 单引脚 FSK 和 BPSK 数据接口
  • 通过 I/O 接口提供 PSK 功能
  • 具有单引脚频率保持功能的线性或非线性 FM 调频功能
  • 频率斜升 FSK
  • 在时钟发生器模式下总抖动 <25 ps rms
  • 自动双向扫频
  • Sin(x)/x 校正
  • 简化的控制接口
    • 兼容 SPI 的 10 MHz 串行 2 线或 3 线
    • 100 MHz 并行 8 位编程
  • 3.3 V 单电源
  • 多种关断功能
  • 单端或差分输入基准时钟
  • 具有裸焊盘的小外形 80 引脚 LQFP 或 TQFP 封装

AD9852 数字频率合成器是一款高度集成的套件，该套件使用高级 DDS 技术，外加内部高速、高性能数模转换器，构成可数字化编程的捷变频频率合成器功能。在以精确时钟源为基准时，AD9852 可生成高度稳定的频率、相位和幅度可编程余弦输出，在通信、雷达和许多其他应用中用作捷变 LO。AD9852 的创新型高速 DDS 内核提供 48 位频率分辨率（使用 300 MHz SYSCLK 时，调谐分辨率为 1 μHz）。为相位-幅度转换保持 16 位分辨率可确保出色的无杂散动态范围 (SFDR)。

AD9852 的电路架构允许以高达 150 MHz 的频率生成输出信号，并且能够以高达每秒 1 亿次的新频率对这些输出信号进行数字化调谐。可以针对捷变时钟发生器应用，通过内部比较器将（外部滤波的）余弦波输出转换为方波。此套件提供两个 14 位相位寄存器和单个引脚用于 BPSK 操作。

对于更高阶的 PSK 操作，可以将 I/O 接口用于相变。12 位余弦 DAC 与创新型 DDS 架构结合后，可以提供出色的宽带和窄带输出 SFDR。在配置有比较器的情况下，12 位控制 DAC 有助于在高速时钟发生器应用中实现静态占空比控制。

12 位数字倍频器允许对余弦 DAC 输出进行可编程幅度调制、开/关输出形状调整键控和精密幅度控制。还针对宽带宽扫频应用包括了线性调频功能。AD9852 可编程 4× 至 20× REFCLK 倍频器电路可在内部从较低频率的外部基准时钟生成 300 MHz 的系统时钟。这可省去用户实施 300 MHz 系统时钟源的费用和困难。

直接 300 MHz 时钟还适应单端或差分输入。支持斜升 FSK 的单引脚传统 FSK 和增强频谱质量。AD9852 使用高级 0.35 μ CMOS 技术，在使用单一 3.3 V 电源的情况下提供这一高级功能。

AD9852 与 AD9854 单音频率合成器之间具有引脚兼容性。AD9852 可在 −40°C 至 +85°C 的扩展工业温度范围内工作。

应用

  • 捷变 LO 频率合成
  • 可编程时钟发生器
  • 用于雷达和扫描系统的 FM 线性调频源
  • 测试与测量设备
  • 商用和业余 RF 激励器
AD9852
CMOS 300 MSPS 完整 DDS
AD9852 Functional Block Diagram AD9852 Pin Configuration
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工具及仿真模型

ADIsimDDS（直接数字频率合成）

ADIsimDDS利用数学公式模拟和显示选定器件的整体性能。ADIsimDDS根据参考时钟频率和所需的输出频率计算所需的FTW。该工具还对整体频谱性能估算进行模拟，允许用户探讨外部重建滤波器的效应。

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7 年前
基于AD9852产生固定频率通过AD8354后不正确
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