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ADRF5730

推荐用于新设计

0.5 dB LSB、6位硅数字衰减器，100 MHz至40 GHz

数据手册 (Rev. A) 产品选型表
产品技术资料帮助

ADI公司所提供的资料均视为准确、可靠。但本公司不为用户在应用过程中侵犯任何专利权或第三方权利承担任何责任。技术指标的修改不再另行通知。本公司既没有含蓄的允许，也不允许借用ADI公司的专利或专利权的名义。本文出现的商标和注册商标所有权分别属于相应的公司。
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概述

  • 超宽带频率范围：100 MHz至 40 GHz
  • 衰减范围：0.5 dB 步进至 31.5 dB
  • 具有阻抗匹配的低插入损耗
    • 2.1 dB，最高为 18 GHz
    • 2.9 dB，最高为 26 GHz
    • 4.8 dB，最高为 40 GHz
  • 具有阻抗匹配的衰减精度
    • ±（0.10+1.0% 的衰减状态），最高 18 GHz
    • ±（0.15+0.8% 的衰减状态），最高 26 GHz
    • ±（0.35+2.5% 的衰减状态），最高 40 GHz
  • 具有阻抗匹配的典型步进误差
    • ± 0.18 dB，最高为 18 GHz
    • ± 0.23 dB，最高为 26 GHz
    • ± 0.51 dB，最高为 40 GHz
  • 高输入线性度
    • P0.1dB 插入损耗状态：30 dBm
    • P0.1dB 其他衰减状态：27 dBm
    • IP3：50 dBm（典型值）
  • 高RF输入功率处理：27 dBm 平均值，30 dBm 峰值
  • 相对相位中的紧凑分布
  • 无低频开关杂散
  • SPI 和并行模式控制，CMOS / LVTTL 兼容
  • RF建立时间（0.1 dB 最终 RF 输出）：250 ns
  • 24 引脚、4 mm × 4 mm LGA 封装
  • 与ADRF5720引脚兼容，低频截止版本

ADRF5730 是一款硅、6 位数字衰减器，以 0.5 dB 步长提供 31.5 dB 的衰减控制范围。

该器件的工作频率范围为 100 MHz 至 40 GHz，提供优于 4.8 dB 的插入损耗和出色的衰减精度。在所有状态下，ADRF5730 具有 27 dBm（平均值）和 30 dBm（峰值）的射频(RF)输入功率处理能力。

ADRF5730 需要 +3.3 V 和 −3.3 V 双电源电压供电。该器件具有串行外设接口(SPI)、并行模式控制和互补金属氧化物半导体(CMOS)/低压晶体管对晶体管逻辑(LVTTL)兼容控制特性。

ADRF5730与ADRF5720引脚兼容，低频截止版本，工作频率范围为 9 kHz 至 40 GHz。

ADRF5730 RF 端口设计用于匹配 50 Ω 的特征阻抗。对于宽带应用，RF 传输线路上的阻抗匹配可以进一步优化高频插入损耗、回波损耗和衰减精度特性。

ADRF5730 采用符合 RoHS 标准的 24 引脚、4 mm × 4 mm、基板栅格阵列(LGA)封装，工作温度范围为 −40°C 至 +105°C。

应用

  • 工业扫描仪
  • 测试和仪器仪表
  • 蜂窝基础设施：5G毫米波
  • 军用无线电、雷达、电子对抗(ECM)
  • 微波无线电和甚小孔径终端(VSAT)
ADRF5730
0.5 dB LSB、6位硅数字衰减器，100 MHz至40 GHz
ADRF5730 Functional Block Diagram ADRF5730 Pin Configuration
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参考资料

数据手册 1

技术文章 2

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软件资源

器件驱动器 1

硬件生态系统

部分模型 产品周期 描述
ADRF5720
推荐用于新设计 0.5 dB LSB、6 位硅数字衰减器、9 kHz 到 40 GHz
ADRF5721
推荐用于新设计 2 dB LSB、4位硅数字衰减器，9 kHz至40 GHz
ADRF5731
推荐用于新设计 2 dB LSB、4位硅数字衰减器，100 MHz至40 GHz
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工具及仿真模型

ADIsimRF

ADIsimRF是一款简单易用的RF信号链计算工具。可以计算和导出多达50级的信号链级联增益、噪声、失真和功耗并绘制其曲线。ADIsimRF还包括丰富的ADI射频和混合信号元件的器件模型数据库。

打开工具

IBIS 模型 1

S-参数 1

评估套件

eval board
schematic 1
schematic 2
schematic 3
EVAL-ADRF5730

ADRF5730评估板

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产品详情

ADRF5730-EVALZ是一款4层评估板。每个铜层厚0.7 mil（0.5盎司），由电介质材料隔开。


所有RF和直流走线布设在顶部铜层上，而内层和底层均为接地层，为RF传输线路提供实心接地层。顶部电介质材料为8 mil Rogers RO4003，提供优质高频性能。中间和底部电介质材料可提供机械强度。电路板总厚度为62 mil，以便在板边缘连接2.4 mm RF启动器。

ADXBAND16EBZ

16Tx/16Rx Direct X-Band Sampled Phased-Array/RADAR/SATCOM Development Platform

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特性和优点

ADXBAND16EBZ Digitizing Card
  • Multi-Channel, Wideband System Development Platform Using Apollo (AD9084)
  • Mates With Xilinx VCU118 Evaluation Board (Not Included)
  • 16x RF Receive (Rx) Channels
    • Total 16x 8GSPS to 20GSPS ADC
    • Digital Down Converters (DDCs), Each Including Complex Numerically-Controlled Oscillators (NCOs)
    • Programmable Finite Impulse Response Filters (pFIRs)
    • Complex Finite Impulse Response Filters (CFIRs)
  • 16x RF Transmit (Tx) Channels
    • Total 16x 8GSPS to 28GSPS DAC
    • Digital Up Converters (DUCs), Each Including Complex Numerically-Controlled Oscillators (NCOs)
    • Programmable Finite Impulse Response Filters (pFIRs)
    • Complex Finite Impulse Response Filters (CFIRs)
  • Flexible Rx & Tx RF Front-Ends
    • Rx: Filtering, Amplification, Digital Step Attenuation for Gain Control
    • Tx: Filtering, Amplification
  • Flexible Clock Distribution
    • On-Board Clock Distribution from Single External 400MHz Reference
    • Support for External Converter Clock per AD9084 via solder rework
  • On-Board Power Regulation from Single 12V Power Adapter (Included)
16Tx / 16Rx Calibration Board
  • Mates to ADXBAND16EBZ Digitizing Card & VCU118 PMOD Interface (Cable Included)
  • Provides Both Individual Adjacent Channel Loopback and Combined Channel Loopback Options
  • Combined Tx Channels Out Option
  • Combined Rx Channels In Option
Software Features and Benefits

Easy Control Tools and Platform Interfaces to Simplify Software Framework Developments:

  • IIO Oscilloscope GUI
  • MATLAB Add-Ons & Example Scripts
  • Example HDL Builds including JESD204C Bring-Up
  • Embedded Software Solutions for Linux and Device Drivers
Software Reference Design Examples for ADEF Applications to Reduce Prototyping Time:
  • Multi-Chip Synchronization for Power-Up Phase Determinism
  • System-Level Amplitude/Phase Alignment Using NCOs
  • Low-Latency ADC-to-DAC Loopback Bypassing JESD Interface
  • pFIR Control for Broadband Channel-to-Channel Amplitude/Phase Alignment
  • Fast-Frequency Hopping

产品详情

The ADXBAND16EBZ contains four AD9084 mixed‑signal front‑end devices, including the RF front end, clocking, and power circuitry. The ADXBAND16EBZ serves as a complete system solution targeting common applications such as phased‑array radars, wideband systems, and ground‑based SATCOM. Its primary target application is a 16‑Tx/16‑Rx direct X‑band sampling phased array.

The platform is intended as a testbed for demonstrating multi‑chip synchronization, as well as implementing system‑level calibrations, beamforming algorithms, and other signal‑processing techniques. The system is designed to interface with the VCU118 Evaluation Board from Xilinx®, which features the Virtex® UltraScale+™ XCVU9P FPGA, along with provided reference software, HDL code, and MATLAB system‑level interfaces.

A 16‑Tx/16‑Rx Calibration Board can be used to develop system‑level calibration algorithms, including demonstrations of power‑up phase determinism. The Calibration Board provides improvements in combined‑channel dynamic range, spurious performance, and phase noise, and can be controlled via a MATLAB add‑on when connected to the PMOD interface of the VCU118.
EVAL-ADRF5730
ADRF5730评估板
ADRF5730 Evaluation Board - Angle View ADRF5730 Evaluation Board - Top View ADRF5730 Evaluation Board - Bottom View
ADXBAND16EBZ
16Tx/16Rx Direct X-Band Sampled Phased-Array/RADAR/SATCOM Development Platform

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