ADF4193:  PLL、低位相ノイズ、高速セトリング

周波数シンセサイザADF4193でLO（局部発振器）を実現し、ワイヤレス環境におけるRF信号のアップコンバージョンとダウンコンバージョンに利用できます。このアーキテクチャは、特に基地局のGSM/EDGEロック時間要件を満たすよう設計されています。

ADF4193は、低ノイズのデジタルPFD（位相周波数検出器）、高精度の差動チャージ・ポンプを備えています。また、差動チャージ ...続きを見る

ADF4193:  PLL、低位相ノイズ、高速セトリング

製品概要

周波数シンセサイザADF4193でLO（局部発振器）を実現し、ワイヤレス環境におけるRF信号のアップコンバージョンとダウンコンバージョンに利用できます。このアーキテクチャは、特に基地局のGSM/EDGEロック時間要件を満たすよう設計されています。

ADF4193は、低ノイズのデジタルPFD（位相周波数検出器）、高精度の差動チャージ・ポンプを備えています。また、差動チャージ・ポンプ出力を外部VCO（電圧制御発振器）用のシングルエンド電圧に変換する差動アンプ（Diff AMP）も備えています。ΣΔベースのフラクショナル・インタポレータとN分周器を組み合わせて使用すれば、係数を設定してフラクショナルN分周を実行できます。また、4ビットのリファレンス（R）カウンタとオンチップの周波数逓倍器により、PFD入力におけるリファレンス信号（REFIN）の周波数を選択できます。

シンセサイザを外付けのループ・フィルタおよびVCOと組み合わせて使用すれば、完全なPLL（位相ロック・ループ）になります。ADF4913のスイッチング・アーキテクチャにより、PLLの整定時間はGSMタイムスロット・ガード期間内に収まるため、別のPLLや関連のアイソレーション・スイッチは不要です。このため、従来のピンポン方式GSM PLLアーキテクチャに基づくシールディングや特性評価、コスト、複雑さ、PCB領域などを節減できます。

特長

  • 新しい高速セトリング、フラクショナルN型PLLアーキテ
    クチャ
  • 5μsでGSMバンド全体にわたり周波数ホッピング、20μsで位相整定
  • ピンポン・シンセサイザに代わるシングルPLL
  • 2GHz RF出力で0.5度のRMS位相誤差
  • デジタル・プログラマブルな出力位相
  • 最大3.5GHzのRF入力範囲
  • オンチップの低ノイズ差動アンプ
  • 位相ノイズ性能指数：－216dBc/Hz
  • アナログ・デバイセズのループ・フィルタ等の設計をサポートするSimPLLの使用可能

Diagrams

ADF4193 Diagram
Functional Block Diagram for ADF4193

仕様

Type Fast Settling PLL
Max RF Input (MHz) 3500MHz
Norm Phase Noise (dBc/Hz) -216dBc
Max REFin (MHz) 300MHz
RF Prescalers 4/5,8/9
Package 32-Lead CSP

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ADF4350 - Wideband Synthesizer with Integrated VCO

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Part# Type Max RF Input (MHz) Output Frequency Range Norm Phase Noise (dBc/Hz) Max REFin (MHz) RF Prescalers Supply Current (max) Package Price* (1000-4999)
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ADF4112 Single Integer-N 3000 - -215 104 16/17, 32/33, 64/65, 8/9 6.5 16-Lead TSSOP, 20-Lead CSP $2.28
ADF4113 Single Integer-N 4000 - -215 104 16/17, 32/33, 64/65, 8/9 8.5 16-Lead TSSOP, 20-Lead CSP $2.28
ADF4113HV Single Integer-N 4000 - -212 104 16/17, 32/33, 64/65, 8/9 11 16-Lead TSSOP, 20-Lead CSP $2.49
ADF4116 Single Integer-N 550 - -211 100 8/9 4.5 16-Lead TSSOP $2.28
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ADF4154 Single Fractional-N 4000