1. 製品
  2. A/Dコンバータ(ADC)
  3. 高速A/Dコンバータ>10MSPS
  4. 標準の高速A/Dコンバータ
  5. AD9691


製品概要

機能と利点

  • JESD204B(サブクラス1)にコード化されたシリアル・デジタル出力
  • チャンネルあたりの全電力1.9 W(デフォルト設定)
  • SFDR = 77 dBFS @ 340 MHz
  • SNR=63.4 dBFS @ 340 MHz
    (AIN = −1.0 dBFS)
  • ノイズ密度=-152.6 dBFS/Hz
  • DC動作電源電圧:1.25 V、2.50 V、3.3 V
  • ノーミス・コード
  • 差動フルスケール入力電圧:
    1.58 V p-p
  • 柔軟性ある終端インピーダンス
  • 400 Ω、 200 Ω、 100 Ω、50 Ω差動
  • 使用可能なアナログ入力フルパワー帯域幅:1.5 GHz
  • チャンネル・アイソレーション/クロストーク:95 dB

    詳細はデータシートをご参照ください。

製品概要

AD9691は、デュアル、14ビット、1.25 MSPSのA/Dコンバータ(ADC)です。このデバイスはバッファとサンプル&ホールド回路を内蔵しており、低消費電力、小型、使い易さを考慮して設計されています。この製品は最大1.5 GHzの広帯域アナログ信号をサンプリングできるように設計されています。 

デュアルのADCコアはマルチステージの差動パイプライン・アーキテクチャを採用し、出力誤差補正ロジックを内蔵しています。各ADCの入力は広帯域になっており、ユーザー選択可能な、多様な入力範囲に対応します。リファレンス電圧を内蔵しているので回路設計が容易です。 

各ADCのデータ出力はオプションで内部的に2つのデジタル・ダウン・コンバータ(DDC)に接続されています。各DDCは直列接続の4つの信号処理段で構成されています:12ビット周波数変換器(NCO)、4つのハーフバンド・デシメーション・フィルタ。 

AD9691はレシーバDDC回路の他に、通信用レシーバ内に自動ゲイン制御(AGC)機能を簡素化する複数の機能を備えています。さらに、スレッショールドが可変の検出器を使うと、ADCの高速検出出力ビットを使って着信信号電力をモニタすることができます。入力信号レベルが可変のスレッショールドを超えると、高速検出インジケータがハイ・レベルになります。このスレッショールド・インジケータの待ち時間は小さいため、ユーザーは迅速にシステム・ゲインを下げてADC入力でのオーバーレンジ状態を回避することができます。 

DDCの構成と受信ロジック・デバイスの許容レーン・レートに応じて、サブクラス1 JESD204Bに基づく高速シリアル出力を1レーン、2レーン、または4レーンの多様なレーン構成にすることができます。複数個のデバイス同期は、SYNCINB±入力ピンを通してサポートされています。 

AD9691は88ピンの鉛フリーLFCSPパッケージを採用し、-40°C~+85°Cの工業温度範囲で仕様を規定しています。 

製品のハイライト

  1. 低消費電力アナログ・コア、14ビット、チャンネル当り1.9 Wの1.25 GSPS デュアルA/Dコンバータ(ADC)。
  2. 広いフルパワー帯域幅は、最大1.5 GHZまでの信号のIFサンプリングをサポートします。
  3. プログラマブル入力終端を持ったバッファ入力は、フィルタの設計と導入を簡素化します。
  4. 柔軟なシリアル・ポート・インターフェース(SPI)は、個別のシステム要求を満たすために製品の各種特性と機能を制御します。
  5. プログラマブルな高速オーバーレンジ検出機能
  6. 12 mm×12 mmの88ピンLFCSP。

アプリケーション
  • 通信関連(広帯域レシーバとデジタル・プリディストーション)
  • 計測機器(スペクトラム・アナライザ、ネットワーク・アナライザ、内蔵RFテスト回路)
  • DOCSIS 3.x CMTSアップストリーム・レシーバ・パス
  • 高速データ・アクイジション・システム



製品ライフサイクル icon-recommended 新規設計にお薦めします

発売済みの製品です。データシートには、最終的な仕様と動作条件がすべて記載されています。新規の設計には、これらの製品の使用を推奨します。

評価キット (1)

ツールおよびシミュレーション

設計ツール

ADC Companion Transport Layer RTL Code Generator Tool (Rev. 1.0)

This command line executable tool generates a Verilog module which implements the JESD204 receive transport layer. The user specifies in a configuration file one or more modes to be supported by the transport layer module. These modes are defined as a set of JESD204 parameter values: L, M, F, S, N', and CF. The transport layer converts JESD204 lane data output from a JESD204 link layer IP to a data bus with a fixed width, containing interleaved virtual converter samples. Both JESD204B and JESD204C link layers are supported.

JESD204x Frame Mapping Table Generator

The JESD204x Frame Mapping Table Generator tool consists of two Windows executables that will allow the user to input any valid combination of JESD204x parameters (L, M, F, S, NP) in order to output a .csv file that illustrates the frame mapping of the JESD204x mode in table format. There is an executable that allows the user to input a single JESD204x mode and another, that allows the user to input the parameters for multiple JESD204x modes in a specified .csv format in order to output a .csv file that illustrates the frame mapping of each of the JESD204x modes that were input into separate tables.

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設計リソース

アナログ・デバイセズでは、最高レベルの品質と信頼性を備えた製品を提供することに最大の力を常に注いでいます。これを実現するため、製品およびプロセスの設計のあらゆる観点で品質と信頼性のチェックを行っています。そして、それは、製造工程においても同様です。アナログ・デバイセズは常に、出荷製品の「ゼロ・ディフェクト」を目指しています。詳細についてはアナログ・デバイセズの品質および信頼性プログラム/認定証をご覧ください。

製品番号 材料宣誓書(MD) 信頼性データ ピン/パッケージ図 CADシンボル、フットプリント & 3Dモデル
AD9691BCPZ-1250 材料宣誓書(MD) 信頼性データ 88-Lead LFCSP (12mm x 12mm w/ EP)
AD9691BCPZRL7-1250 材料宣誓書(MD) 信頼性データ 88-Lead LFCSP (12mm x 12mm w/ EP)
ウェハ・ファブリケーション・データ

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サンプル&購入


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評価用ボード

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