AD9559

新規設計に推奨

クロック変換器、デュアルPLL・クワッド入力、マルチサービス・ライン・カードに適応

データシート (Rev. D) 製品セレクション・テーブル
利用上の注意

本データシートの英語以外の言語への翻訳はユーザの便宜のために提供されるものであり、リビジョンが古い場合があります。最新の内容については、必ず最新の英語版をご参照ください。

なお、日本語版のデータシートは基本的に「Rev.0」（リビジョン0）で作成されています。そのため、英語版が後に改訂され、複数製品のデータシートがひとつに統一された場合、同じ「Rev.0」の日本語版のデータシートが異なる製品のデータシートとして表示されることがあります。たとえば、「ADM3307E」の場合、日本語データシートをクリックすると「ADM3311E」が表示されます。これは、英語版のデータシートが複数の製品で共有できるように1本化され、「ADM3307E/ADM3310E/ADM3311E/ADM3312E/ADM3315E」（Rev.J）と改訂されたからで、決して誤ってリンクが張られているわけではありません。和文化されたデータシートを少しでも有効に活用していただくためにこのような方法をとっておりますので、ご了解ください。

アナログ・デバイセズ社は、提供する情報が正確で信頼できるものであることを期していますが、その情報の利用に関して、あるいはその利用によって生じる第三者の特許やその他の権利の侵害に関して一切の責任を負いません。また、アナログ・デバイセズ社の特許または特許の権利の使用を明示的または暗示的に許諾するものでもありません。仕様は予告なしに変更する場合があります。本紙記載の商標および登録商標は、各社の所有に属します。
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製品の詳細

  • ホルドオーバー・モードでGR-1244 Stratum 3の安定化をサポート
  • 出力位相の乱れなしに、スムースなリファレンス・スイッチオーバーをサポート
  • Telcordia GR-253ジッタ生成、伝送をサポート、最大OC-192システムまでのSONET / SDHを許容可能
  • ITU-T・G.8262同期式イーサーネット・スレーブ・クロックをサポート
  • ITU-T・G.823、G.824、G.825およびG.8261をサポート
  • 自動 / 手動のホールドオーバーとリファレンス・スイッチオーバー
  • 適応型クロッキングによるフィードバック・デバイダのダイナミック調整が可能、OTNマッピング / デマッピング・アプリケーションで有効
  • 4つのリファレンス入力（シングルエンドまたは差動）を持つデュアル・デジタルPLLアーキテクチャ
  • 4×2のクロスポイントによってどのリファレンス入力でも各PLLのドライブが可能
  • 2kHz～1,250MHzの入力リファレンス周波数
  • リファレンスの検証と周波数モニタリング（2ppm）

    詳細はデータシートをご参照ください。
AD9559
クロック変換器、デュアルPLL・クワッド入力、マルチサービス・ライン・カードに適応
AD9559 Functional Block Diagram AD9559 Pin Configuration
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ハードウェア・エコシステム

製品モデル 製品ライフサイクル 詳細
クロックIC 4
AD9512
新規設計に推奨 クロック分配IC、1.2GHz、2つの1.6GHz入力、分周器／遅延調整内蔵、5出力
AD9513
新規設計に推奨 クロック分配IC、800 MHz、分周機能、遅延調整機能、3出力
AD9514
新規設計に推奨 クロック分配IC、1.6GHz、分周器、遅延調整、3出力
AD9515
新規設計に推奨 1.6 GHZクロック分配IC、ドライバ、遅延調整、2出力
スイッチング・レギュレータ ＆ コントローラ 1
ADP1829
製造中 降圧DC/DCコントローラ、トラッキング入力付き、デュアル、インターリーブ動作
ファンアウト・バッファ ＆ スプリッタ 5
ADCLK925
新規設計に推奨 ECLクロック / データ・バッファ、超高速SiGe
ADCLK944
新規設計に推奨 クロック・ファンアウト・バッファ、4出力、LVPECL、2.5V／3.3V、シリコン・ゲルマニューム（SiGe）
ADCLK948
新規設計に推奨 クロック・ファンアウト・バッファ、2つの選択可能入力、8LVPECL出力、SiGe
ADCLK854
新規設計に推奨 クロック・ファンアウト・バッファ、1.8V、低消費、12LVDS/24CMOS出力
ADCLK846
新規設計に推奨 クロック・ファンアウト・バッファ、1.8V、低消費、6LVDS/12CMOS出力
リニア・レギュレータ 1
ADP150
製造中 リニア・レギュレータ、150mA、超低ノイズ、CMOS
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ツールおよびシミュレーション

IBISモデル 1

評価用キット

eval board
schematic 1
EVAL-AD9559

AD9559 Evaluation Board

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製品詳細

The AD9559 is a low loop bandwidth clock multiplier that provides jitter cleanup and synchronization for many systems, including synchronous optical networks (SONET/SDH). The AD9559 generates two completely independent output clocks that are synchronized to up to four external input references. The digital PLL allows for reduction of input time jitter or phase noise associated with the external references. The digitally controlled loop and holdover circuitry of the AD9559 continuously generates a low jitter output clock even when all reference inputs have failed.

For convenience, detailed information from the AD9559 data sheet has been included here. Use this user guide in conjunction with the AD9559 data sheet and software documenta¬tion available at www.analog.com.


Features
  • Simple power connection using 6 V wall adapter and on-board LDO voltage regulators
  • LDOs are easily bypassed for power measurements
  • 4 ac-coupled differential output SMA connectors (which can be reconfigured for up to 8 single-ended outputs.
  • 4 inputs SMA connectors that accept either single-ended or differential signals
  • USB connection to PC
  • Microsoft Windows-based evaluation software with simple graphical user interface and support for both 64-bit and 32-bit operating systems.
  • Easy access to digital I/O and diagnostic signals via I/O header
  • Status LEDs for diagnostic signals
EVAL-AD9559
AD9559 Evaluation Board

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