AD9609
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AD9609

10位、20 MSPS/40 MSPS/65 MSPS/80 MSPS、1.8 V模数转换器

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产品模型 8
特性
  • 1.8 V 模拟电源供电
  • 1.8 V 至3.3 V输出电源
  • SNR
    61.5 dBFS（9.7 MHz输入）
    61.0 dBFS（200 MHz输入）
  • 无杂散动态范围(SFDR)：
    75 dBc（9.7 MHz输入）
    73 dBc（200 MHz输入）
  • 低功耗：
    45 mW (20 MSPS)
    76 mW (80 MSPS)
  • 差分输入、700 MHz带宽
  • 片内基准电压源和采样保持电路
  • 2 V P-P 差分模拟输入
  • DNL = ±0.10 LSB
  • 串行端口控制选项
    偏移二进制、格雷码或二进制补码数据格式
    可选时钟占空比稳定器
    1至8整数输入时钟分频器
  • 内置可选数字测试码生成功能
  • 节能的关断模式
  • 带可编程时钟和数据对准功能的数据时钟输出
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AD9609是一款单芯片、单通道、10位、20/40/65/80 MSPS模数转换器(ADC)，采用1.8 V电源供电。内置高性能采样保持电路和片内基准电压源。

该产品采用多级差分流水线架构，内置输出纠错逻辑，在80 MSPS数据速率时可提供10位精度，并保证在整个工作温度范围内无失码。

该ADC内置多种功能特性，可使器件的灵活性达到较佳、系统成本较低，例如可编程时钟与数据对准、生成可编程数字测试码等。可获得的数字测试码包括内置固定码和伪随机码，以及通过串行端口接口(SPI)输入的用户自定义测试码。

采用一个具有内部可选1至8分频比的差分时钟输入来控制所有内部转换周期。可选的占空比稳定器(DCS)用来补偿较大的时钟占空比波动，同时保持出色的ADC总体性能。

数字输出数据格式为偏移二进制、格雷码或二进制补码。一个数据输出时钟(DCO)用来确保接收逻辑具有正确的锁存时序。支持1.8 V和3.3 V CMOS电平。

AD9609采用32引脚LFCSP封装，符合RoHS标准，额定温度范围为−40°C至+85°C工业温度范围。

应用

  • 通信
  • 分集无线电系统
  • 多模式数字接收器
    GSM、EDGE、W-CDMA、LTE、CDMA2000、WiMAX、TD-SCDMA
  • 智能天线系统
  • 电池供电仪表
  • 手持式示波器
  • 便携式医疗成像
  • 超声
  • 雷达/LIDAR
  • PET/SPECT成像

产品聚焦

  1. AD9609采用1.8 V单模拟电源供电，而数字输出驱动器采用独立的电源供电，以适应1.8 V至3.3 V逻辑。
  2. 采样保持电路在最高200 MHz的输入频率下仍保持出色的性能，而且成本低、功耗低、易于使用。
  3. 标准串行端口接口支持各种产品特性和功能，例如：数据输出格式化、内部时钟分频器、省电模式、DCO和数据输出（D9至D0）时序和偏移调整、以及基准电压源模式等。
  4. AD9609采用32引脚LFCSP封装，符合RoHS标准，与12位ADC AD9629和14位ADC AD9649引脚兼容，因此采样速率为20 MSPS至80 MSPS的10位和14位转换器可轻松实现升级。
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AD9609

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更新 10/29/2009
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AD9609: 10-Bit, 20 MSPS/40 MSPS/65 MSPS/80 MSPS, 1.8 V Analog-to-Digital Converter Data Sheet (Rev.C)

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更新 01/08/2013
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Evaluating the AD9266/AD9649/AD9629/AD9609 Analog-to-Digital Converters redirect icon

应用笔记

22

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更新 09/20/2006
英文
AN-812: MicroController-Based Serial Port Interface (SPI) Boot Circuit (Rev.0) redirect icon

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更新 09/20/2006
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AN-812: 基于微控制器的串行端口接口(SPI®)启动电路 (Rev.0) redirect icon

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更新 12/19/2014
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CDMA2000多载波系统可行性研究 (Rev.AN-808) redirect icon

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更新 11/09/2007
英文
AN-807: Multicarrier WCDMA Feasibility (Rev.0) redirect icon

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更新 11/09/2007
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AN-807: 多载波WCDMA的可行性 (Rev.0) redirect icon

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更新 11/09/2007
英文
AN-808: Multicarrier CDMA2000 Feasibility (Rev.0) redirect icon

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更新 11/09/2007
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Multicarrier CDMA2000 Feasibility (Rev.AN-808) redirect icon

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更新 02/14/2015
英文
AN-586: LVDS Outputs for High Speed A/D Converters (Rev.0) redirect icon

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更新 09/22/2006
中文
AN-586: 高速模数转换器的LVDS数据输出[中文版] (Rev.0) redirect icon

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更新 09/22/2006
日文
AN-586: 高速A/DコンバータのためのLVDSデータ出力 (Rev.0) redirect icon

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更新 03/20/2018
英文
AN-878: High Speed ADC SPI Control Software (Rev.A) redirect icon

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更新 11/13/2007
中文
AN-878: 高速ADC SPI控制软件[中文版] (Rev.A) redirect icon

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更新 11/13/2007
日文
AN-878: 高速ADC SPIコントロール・ソフトウェア (Rev.A) redirect icon

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更新 02/14/2015
英文
AN-827: A Resonant Approach to Interfacing Amplifiers to Switched-Capacitor ADCs (Rev.0) redirect icon

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更新 11/09/2007
中文
AN-827: 放大器与开关电容ADC接口的匹配方法[中文版] (Rev.0) redirect icon

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更新 11/09/2007
日文
AN-827: 共振方式によるアンプとスイッチド・キャパシタADCのインターフェース (Rev.0) redirect icon

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更新 01/12/2012
英文
AN-1142: Techniques for High Speed ADC PCB Layout redirect icon

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更新 01/12/2012
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AN-1142:高速ADC PCB布局布线技巧 redirect icon

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更新 01/12/2012
日文
AN-1142: 高速 ADC 用プリント基板のレイアウト・テクニック redirect icon

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更新 09/01/2007
英文
AN-935: Designing an ADC Transformer-Coupled Front End redirect icon

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更新 09/01/2007
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AN-935:ADC 变压器耦合前端设计 redirect icon

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更新 09/01/2007
日文
AN-935:ADC トランス結合フロントエンドの設計 redirect icon

技术文章

1

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更新 03/26/2010
英文
Improve The Design Of Your Passive Wideband ADC Front-End Network redirect icon

评估设计文件

4

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更新 08/19/2011
英文
AD9266/AD9649/AD9629/AD9609 Schematics redirect icon

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更新 08/19/2011
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AD9649/AD9629/AD9609 原理图 redirect icon

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参考资料

参考资料

技术文档 14
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数据手册 1

AD9609: 10-Bit, 20 MSPS/40 MSPS/65 MSPS/80 MSPS, 1.8 V Analog-to-Digital Converter Data Sheet (Rev.C)

用户手册 1

Evaluating the AD9266/AD9649/AD9629/AD9609 Analog-to-Digital Converters

应用笔记 9

AN-812: 基于微控制器的串行端口接口(SPI®)启动电路 (Rev.0)
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CDMA2000多载波系统可行性研究 (Rev.AN-808)
AN-807: 多载波WCDMA的可行性 (Rev.0)
Multicarrier CDMA2000 Feasibility (Rev.AN-808)
AN-586: 高速模数转换器的LVDS数据输出[中文版] (Rev.0)
AN-878: 高速ADC SPI控制软件[中文版] (Rev.A)
AN-827: 放大器与开关电容ADC接口的匹配方法[中文版] (Rev.0)
AN-1142:高速ADC PCB布局布线技巧
AN-935:ADC 变压器耦合前端设计

技术文章 1

Improve The Design Of Your Passive Wideband ADC Front-End Network

评估设计文件 2

AD9649/AD9629/AD9609 原理图
AD9649/AD9629/AD9609 Gerber文件

ADI 始终高度重视提供符合最高质量和可靠性水平的产品。我们通过将质量和可靠性检查纳入产品和工艺设计的各个范围以及制造过程来实现这一目标。出货产品的“零缺陷”始终是我们的目标。查看我们的质量和可靠性计划和认证以了解更多信息。

产品型号 引脚/封装图-中文版 文档 CAD 符号，脚注和 3D模型
AD9609BCPZ-20 32-Lead LFCSP (5mm x 5mm x 0.85mm w/ EP) external-link
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AD9609BCPZ-40 32-Lead LFCSP (5mm x 5mm x 0.85mm w/ EP) external-link
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AD9609BCPZ-65 32-Lead LFCSP (5mm x 5mm x 0.85mm w/ EP) external-link
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AD9609BCPZ-80 32-Lead LFCSP (5mm x 5mm x 0.85mm w/ EP) external-link
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AD9609BCPZRL7-20 32-Lead LFCSP (5mm x 5mm x 0.85mm w/ EP) external-link
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AD9609BCPZRL7-40 32-Lead LFCSP (5mm x 5mm x 0.85mm w/ EP) external-link
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AD9609BCPZRL7-65 32-Lead LFCSP (5mm x 5mm x 0.85mm w/ EP) external-link
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AD9609BCPZRL7-80 32-Lead LFCSP (5mm x 5mm x 0.85mm w/ EP) external-link
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PCN

2月 1, 2024

- 24_0009

Qualification of alternative Wafer Fab for TSMC 0.18um Mixed Signal CMOS Process

AD9609BCPZ-20

量产

AD9609BCPZ-40

量产

AD9609BCPZ-65

量产

AD9609BCPZ-80

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AD9609BCPZRL7-20

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AD9609BCPZRL7-65

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AD9609BCPZRL7-80

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Qualification Results Summary

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3月 13, 2017

- 17_0035

Power Down Sequence and DRVDD Voltage Restriction for AD9649, AD9629 and AD9609.

AD9609BCPZ-20

量产

AD9609BCPZ-40

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11月 10, 2014

- 14_0047

Conversion of 5x5mm body Size LFCSP Package Outlines from Punch to Sawn and Transfer of Assembly Site to Amkor Philippines.

AD9609BCPZ-20

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AD9609BCPZ-40

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AD9609BCPZRL7-80

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PCN

2月 1, 2024

- 24_0009

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Qualification of alternative Wafer Fab for TSMC 0.18um Mixed Signal CMOS Process

AD9609BCPZ-20

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3月 13, 2017

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Power Down Sequence and DRVDD Voltage Restriction for AD9649, AD9629 and AD9609.

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Conversion of 5x5mm body Size LFCSP Package Outlines from Punch to Sawn and Transfer of Assembly Site to Amkor Philippines.

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软件和型号相关生态系统

软件和型号相关生态系统

部分模型 产品周期 描述

单端转差分放大器2
ADA4937-1
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推荐新设计使用

超低失真差分ADC驱动器(单通道)

ADA4938-1
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推荐新设计使用

超低失真差分ADC驱动器（单通道）

全差分放大器2
ADL5561
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推荐新设计使用

2.9 GHz超低失真射频/中频差分放大器

ADL5562
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2.6GHz 超低失真RF/IF差分放大器

时钟产生器件3
AD9510
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推荐新设计使用

1.2 GHz时钟分配IC，PLL内核，分频器，延迟调整，8路输出

AD9511
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推荐新设计使用

1.2 GHz时钟分配IC，PLL内核，分频器，延迟调整，5路输出

AD9512
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1.2 GHz时钟分配IC、2路1.6 GHz输入、分频器、延迟调整、5路输出

时钟分配器件3
AD9513
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推荐新设计使用

800 MHz时钟分配IC，分频器，延迟调整，三路输出

AD9514
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推荐新设计使用

1.6 GHz时钟分配IC、分频器、延迟调整、3路输出

AD9515
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推荐新设计使用

1.6 GHz时钟分配IC，分频器，延迟调整，两路输出

数字控制VGA2
AD8370
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750 MHz 数字控制式可变增益放大器

AD8375
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超低失真IF VGA

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评估套件

评估套件 2

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HSC-ADC-EVALCZ

基于FPGA的数据采集套件

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HSC-ADC-EVALCZ

基于FPGA的数据采集套件

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HSC-ADC-EVALCZ
基于FPGA的数据采集套件

特性和优点

  • 64kB FIFO深度
  • 适用于单通道和多通道ADC
  • 与VisualAnalog®软件配合使用
  • 基于Virtex-4 FPGA
  • 可能需要适配器，才能与某些ADC评估板接口
  • 允许对SPI控制进行编程 每个通道的DDR编码速率高达644 MSPS SDR / 800MSPS
  • 每个通道的DDR编码速率

立即购买 更多内容

产品详情

HSC-ADC-EVALCZ高速转换器评估平台使用基于FPGA的缓冲存储器板，采集来自ADI高速模数转换器(ADC)评估板的数字数据块。该板通过USB端口连接到PC，并与VisualAnalog®软件配合使用来快速评估高速ADC的性能。该评估套件设置简单。所需的额外设备包括ADI高速ADC评估板、信号源和时钟源。一旦连接该套件并上电，PC便立即开始评估。

资料

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High Speed ADC USB FPGA Evaluation Kit, EVALC Download

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软件

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High Speed ADC SPI Control Software Download

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EVALC PC Board Gerber File reference design link

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Microsoft .NET Framework 3.5 reference design link

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EVAL-AD9609

AD9609 评估板

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EVAL-AD9609

AD9609 评估板

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EVAL-AD9609
AD9609 评估板
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本页提供评估AD9609的评估板文档和订购信息。

AD9609-80EBZ用于评估单通道10位ADC AD9609。本参考设计提供在各种模式和配置下运行器件所需的全部支持电路。它设计为可直接与HSC-ADC-EVALCZ的数据捕获卡进行接口，允许用户下载捕获的数据用于分析。Visual Analog软件包用来与器件的硬件部分实现接口，允许用户下载捕获的数据并通过用户友好型图形界面进行分析。同时，SPI控制器软件包也兼容硬件部分，允许用户使用AD9609的SPI可编程功能。

AD9609数据手册提供了更多有关器件配置和性能的信息，在使用这些工具时应加以参考。所有文档、Visual Analog软件以及SPI控制器均可在高速ADC评估板页面上找到。欲了解更多信息，或有任何疑问，请发送电子邮件至highspeed.converters@analog.com。

资料

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Evaluating the AD9266/AD9649/AD9629/AD9609 Analog-to-Digital Converters reference design link

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AD9649/AD9629/AD9609 原理图 Download

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AD9649/AD9629/AD9609 Gerber文件 Download

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评估套件2

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HSC-ADC-EVALCZ

基于FPGA的数据采集套件
evaluation kit item images

EVAL-AD9609

AD9609 评估板
工具和仿真

工具及仿真模型 5

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