新产品 (1)
概览
优势和特点
- JESD204B(子类 1)编码串行数字输出
- 支持每线高达 16 Gbps 的线速
- 3 GSPS 时每通道的总功率为 1.65 W(默认设置)
- −2 dBFS 幅度、2.6 GHz 输入时的性能
- SFDR = 70 dBFS
- SNR = 57.2 dBFS
- −9 dBFS 幅度、2.6 GHz 输入时的性能
- SFDR = 78 dBFS
- SNR = 59.5 dBFS
- 集成式输入缓冲器
- 噪声密度 = −152 dBFS/Hz
- 0.975 V、1.9 V 和 2.5 V 直流电源供电
- 9 GHz 模拟输入全功率带宽 (−3 dB)
- 用于高效 AGC 实施的幅度检测位
- 每个通道具有 2 个集成式宽带数字处理器
- 48 位 NCO
- 4 个级联半带滤波器
- 相位相干 NCO 切换
- 提供多达 4 个通道
- 串口控制
- 具有除以 2 和除以 4 选项的整数时钟
- 灵活的 JESD204B 线配置
- 片內抖动
产品详情
AD9208 是一款双通道、14 位、3 GSPS 模数转换器 (ADC)。该器件具有片内缓冲器和采样保持电路,确保实现较低的功耗、较小的封装尺寸和出色的易用性。该产品经过专门设计,支持那些可对高达 5 GHz 带宽的模拟信号进行直接采样的通信应用场合。ADC 输入的 −3 dB 带宽为 9 GHz。AD9208 经过了全面优化,采用小巧紧凑的封装,可以提供宽泛的输入带宽、快速的采样速率、卓越的线性度以及较低的功耗。
双通道 ADC 内核采用具有集成式输出纠错逻辑的多级差分流水线架构。每个 ADC 都配备了宽泛的带宽输入,支持各种用户可选的输入范围。集成基准电压源简化了设计考虑事项。模拟输入和时钟信号是差分输入。ADC 数据输出通过交叉复用器从内部连接到四个数字下变频器 (DDC)。每个 DDC 包括多达五个级联信号处理级:48 位变频器(数控振荡器 (NCO)),以及多达四个半带抽取滤波器。NCO 允许在通用输入/输出 (GPIO) 引脚上选择预置频段(最多可以选择三个频段)。通过 SPI 可编程配置文件,可以在多个 DDC 模式之间选择 AD9208 的操作。
除了 DDC 模块外,AD9208 还配备了其他多种功能以简化通信接收器中的自动增益控制 (AGC) 功能。通过使用 ADC 的寄存器 0x0245 中的快速检测控制位,可编程阈值检测器可以监测传入信号的功率。如果输入信号电平超过可编程阈值,快速检测指示器会变高。由于此阈值指示器具有较低的延迟,用户可以迅速调低系统增益,从而避免 ADC 输入处出现超范围状态。除了快速检测输出功能外,AD9208 还具有信号监测能力。信号监测模块提供正由 ADC 数字化的信号的附加信息。
用户可以根据 DDC 配置和接收逻辑器件的可接受线速,在各种单线、双线、四线和八线配置中配置基于子类 1 JESD204B 的高速串行化输出。此外,还通过 SYSREF± 和 SYNCINB± 输入引脚支持多器件同步。
AD9208 还提供了灵活的功耗减低选项,可以在必要时大幅度降低功耗。所有这些功能均可通过一个 3 线串口接口 (SPI) 进行编程。
AD9208 提供不含铅的 196 球状引脚 BGA 封装,可以在 −40°C 至 +85°C 的环境温度范围内工作。此产品受美国专利保护。
请注意,在整个数据手册中,多功能引脚(例如 FD_A/GPIO_A0)可由整个引脚名称指定,也可以由引脚的单一功能指定,例如 FD_A(当仅与该功能相关时)。
产品亮点
- 宽泛的输入 −3 dB 带宽 (9 GHz) 支持对高达 5 GHz 左右的信号进行直接射频 (RF) 采样。
- 四个集成宽带抽取滤波器和 NCO 模块支持多频段接收器。
- 通过 GPIO 引脚进行快速的 NCO 切换
- SPI 控制多种不同的产品特性和功能,以满足特定的系统要求。
- 可编程的快速超范围检测和信号监测。
- 用于系统热量管理的片内温度二极管。
- 12mm × 12mm 196 引脚 BGA 封装
应用
- 分集多频段、多模数字接收器
- 3G/4G、TD-SCDMA、W-CDMA、GSM、LTE、LTE-A
- 电子测试和测量系统
- 相控阵雷达与电子战
- DOCSIS 3.0 CMTS 上行接收路径
- HFC 数字反向路径接收器
产品生命周期
推荐新设计使用
本产品已上市。数据手册包含所有最终性能规格和工作条件。ADI公司推荐新设计使用这些产品。
评估套件 (2)
参考资料
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Designing Power Solutions for High Speed Converter Applications8/18/2023
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5G毫米波无线电射频技术4/26/2019
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三大解决方案实战讲解优化模拟集成的4大法宝4/26/2019
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Enabling Next-Generation EW and Phased-Array Systems4/9/2018
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Streamlining Flexible System Design using RF ADCs with DSP4/9/2018
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ADI公司:5G测试与测量功能11/13/2019
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镜频抑制 >43dB 的 1.2GHz 带宽直接接收器10/15/2018
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28nm CMOS射频数据转换器10/15/2018
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宽带功率效率10/15/2018
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An Interview with Analog Devices Discussing RF Electronics for Phased Array Applications1/1/2019
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位到波束:5G毫米波无线电射频技术演进12/1/2018 Thought Leadership
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带有分布式锁相环的相控阵的系统级LO相位噪声模型11/1/2018
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28 nm Analog-to-Digital Converters Enable Next-Generation Electronic Warfare Receiver Systems6/29/2018
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RF转换器为下一代无线基站提供高效多频段无线电2/1/2018
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宽带RF接收机架构方案综述2/1/2017
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高速ADC电源域5/7/2018
工具及仿真模型
Virtual Eval - BETA
Virtual Eval是一款网络应用程序,可帮助设计人员评估ADC和DAC产品。 利用ADI公司服务器上的详细模型,Virtual Eval在几秒内可仿真关键部件的性能特征。 对工作条件(如输入音和外部抖动)以及器件特性(如增益或数字下变频)进行配置。 性能特征包括噪声、失真和分辨率、FFT、时序图、频率响应图等。

IBIS模型
S参数
设计工具
This command line executable tool generates a Verilog module which implements the JESD204 receive transport layer. The user specifies in a configuration file one or more modes to be supported by the transport layer module. These modes are defined as a set of JESD204 parameter values: L, M, F, S, N', and CF. The transport layer converts JESD204 lane data output from a JESD204 link layer IP to a data bus with a fixed width, containing interleaved virtual converter samples. Both JESD204B and JESD204C link layers are supported.
The JESD204x Frame Mapping Table Generator tool consists of two Windows executables that will allow the user to input any valid combination of JESD204x parameters (L, M, F, S, NP) in order to output a .csv file that illustrates the frame mapping of the JESD204x mode in table format. There is an executable that allows the user to input a single JESD204x mode and another, that allows the user to input the parameters for multiple JESD204x modes in a specified .csv format in order to output a .csv file that illustrates the frame mapping of each of the JESD204x modes that were input into separate tables.
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设计资源
ADI始终把满足您可靠性水平的产品放在首要位置。我们通过在所有产品、工艺设计和制造过程中引入高质量和可靠性检查实践这一承诺。发运的产品实现“零缺陷”始终是我们的目标。
Part Number | Material Declaration | Reliability Data | Pin/Package Drawing | CAD Symbols, Footprints & 3D Models |
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AD9208BBPZ-3000 | 材料声明 | 质量和可靠性 | 196-Ball BGA (12mm x 12mm x 1.42mm w/ EP) | |
AD9208BBPZRL-3000 | 材料声明 | 质量和可靠性 | 196-Ball BGA (12mm x 12mm x 1.42mm w/ EP) | |
Wafer Fabrication Data |
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