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特長
- SNR＝79.9dBFS＠16MHz（VREF＝1.4V）
- SNR＝78.1dBFS＠64MHz（VREF＝1.4V）
- SFDR＝86dBc、ナイキストまで（VREF＝1.4V）
- JESD204Bサブクラス1にコード化されるシリアル・デジタル出力
- 柔軟なアナログ入力範囲：2.0V p-p～2.8V p-p
- 1.8V電源動作
- 低消費電力：125Msps（2レーン）で197mW / チャンネル
- DNL誤差：±0.6LSB（VREF＝1.4V）
- INL誤差：±4.5LSB（VREF＝1.4V）
- 650MHzのフル・パワー・アナログ入力帯域幅
- シリアル・ポート制御、
- フルチップと個別チャンネルのパワーダウン・モード
- 内蔵とカスタムのデジタル・テスト・パターンの生成
- マルチチップの同期とクロック・デバイダ
- スタンバイ・モード
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AD9656は、サンプル＆ホールド回路内蔵のクワッド16ビット125MSPSのA/Dコンバータ（ADC）であり、低価格、低消費電力、小型で使い易く設計されています。この製品は、最大125MSPSまでの変換レートで動作し、小型パッケージ・サイズを重要とするアプリケーション向けに、並外れたダイナミック性能と低消費電力化に関して最適化されています。
このADCは、フル性能動作のためには1.8Vの単電源とLVPECL / CMOS / LVDS互換のサンプル・クロック・レートを必要とします。ほとんどのアプリケーションでは、外付けのリファレンス電圧またはドライバ部品を必要としません。
各チャンネルは独立したパワーダウン機能をサポートしており、全チャンネルがディスエーブル時の消費電力は14mW（typ）未満となります。このADCは、プログラマブルな出力クロック、データ・アライメントおよびデジタル・テスト・パターン発生器など、柔軟性を最大化しシステム・コストを最小化するような設計のための、いくつかの特長を備えています。デジタル・テスト・パターンとしては、決まった擬似乱数パターンを含んでおり、カスタムのユーザー定義のテスト・パターンもシリアル・ポート・インターフェース（SPI）を介して入力することも可能です。
AD9656はRoHS準拠、非磁性の56ピンLFCSPパッケージを採用しています。
仕様は工業温度範囲－40℃～＋85℃にわたって規定されています。
製品のハイライト
- 小型フットプリント形状。4個のADCを小型の8mm×8mmパッケージに格納
- 内蔵PLLは、単一のADCサンプリング・クロックでの使用を可能とし、PLLはADCのサンプリング・クロックをJESD204Bのデータ・レート・クロックに対応するまでの逓倍を行います。
- 構成可能なJESD204B出力ブロックは、レーンあたり最大8.0Gbpsをサポート
- JESD204B出力クロックは、1つ、2つおよび4つのレーン構成をサポート
- 低消費電力：125Msps、2レーンで198mW / チャンネル
- SPI制御は、特別なシステムの要求に合致するための広範囲で柔軟な機能を提供
アプリケーション
- 医用画像処理
- 高速画像処理
- 直交変調無線受信器
- ダイバーシティ無線受信器
- ポータブル・テスト装置
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よく聞かれる質問（FAQ）
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AD9656
資料
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データシート
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情報
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アナログ・デバイセズ社は、提供する情報が正確で信頼できるものであることを期していますが、その情報の利用に関して、あるいはその利用によって生じる第三者の特許やその他の権利の侵害に関して一切の責任を負いません。また、アナログ･デバイセズ社の特許または特許の権利の使用を明示的または暗示的に許諾するものでもありません。仕様は予告なしに変更する場合があります。本紙記載の商標および登録商標は、各社の所有に属します。
本データシートの英語以外の言語への翻訳はユーザの便宜のために提供されるものであり、リビジョンが古い場合があります。最新の内容については、必ず最新の英語版をご参照ください。
なお、日本語版のデータシートは基本的に「Rev.0」（リビジョン0）で作成されています。そのため、英語版が後に改訂され、複数製品のデータシートがひとつに統一された場合、同じ「Rev.0」の日本語版のデータシートが異なる製品のデータシートとして表示されることがあります。たとえば、「ADM3307E」の場合、日本語データシートをクリックすると「ADM3311E」が表示されます。これは、英語版のデータシートが複数の製品で共有できるように1本化され、「ADM3307E/ADM3310E/ADM3311E/ADM3312E/ADM3315E」（Rev.G）と改訂されたからで、決して誤ってリンクが張られているわけではありません。和文化されたデータシートを少しでも有効に活用していただくためにこのような方法をとっておりますので、ご了解ください。
ドキュメント
デバイス・ドライバ 1
FPGA相互運用性レポート 1
| 製品モデル | ピン／パッケージ図 | 資料 | CADシンボル、フットプリント、および3Dモデル |
|---|---|---|---|
| AD9656BCPZ-125 |
56-Lead LFCSP (8mm x 8mm w/ EP)
|
|
|
| AD9656BCPZRL7-125 |
56-Lead LFCSP (8mm x 8mm w/ EP)
|
|
- AD9656BCPZ-125
- ピン／パッケージ図
-
56-Lead LFCSP (8mm x 8mm w/ EP)
- 資料
-
HTML
Material Declaration
-
HTML
Reliablity Data
- CADシンボル、フットプリント、および3Dモデル
-
Ultra Librarian
-
SamacSys
- AD9656BCPZRL7-125
- ピン／パッケージ図
-
56-Lead LFCSP (8mm x 8mm w/ EP)
- 資料
-
HTML
Material Declaration
-
HTML
Reliablity Data
- CADシンボル、フットプリント、および3Dモデル
-
Ultra Librarian
-
SamacSys
モデルでフィルタ
製品モデル
製品ライフサイクル
PCN
1 18, 2017
- 16_0079
AD9656 Datasheet Specification Updates
AD9656BCPZ-125
製造中
AD9656BCPZRL7-125
製造中
モデルでフィルタ
製品モデル
製品ライフサイクル
PCN
1 18, 2017
- 16_0079
AD9656 Datasheet Specification Updates
ソフトウェアおよび製品のエコシステム
デバイス・ドライバ
評価用ソフトをお探しですか？ ここで見つけることができます。
| 製品モデル | 製品ライフサイクル | 詳細 | ||
|---|---|---|---|---|
|
クロック生成デバイス1 |
||||
|
新規設計に推奨 |
クロック・ジェネレータ、14 LVDS / HSTL出力、JESD204B対応 |
|||
|
クロック分配器 （クロック・ディストリビューション）1 |
||||
|
新規設計に推奨 |
JESD204B/JESD204C 用機能付き、3.2 GHz、14 出力、高性能ファンアウト・バッファ |
|||
|
シングルエンド入力差動出力アンプ1 |
||||
|
新規設計に推奨 |
超低ノイズ・ドライバ・アンプ、低電圧 A/D コンバータ向け |
|||
|
パワー・スイッチ内蔵型降圧レギュレータ1 |
||||
|
製造中 |
ステップダウンDC-DCコンバータ、600mA、小型、3MHz |
|||
|
完全差動アンプ1 |
||||
|
新規設計に推奨 |
差動アンプ、超高ダイナミックレンジ、6GHz |
|||
|
正電圧のリニア電圧レギュレータ（LDO）1 |
||||
|
製造中 |
リニア・レギュレータ、1A、低ドロップアウト、CMOS |
|||
|
低入力バイアス電流アンプ（＜100pA）1 |
||||
|
製造中 |
オペアンプ、デュアル、FET入力、単電源、低消費電力、レールtoレール入 / 出力 |
|||
必要なソフトウェア／ドライバが見つかりませんか？
ドライバ／ソフトウェアをリクエスト評価用キット 1
EVAL-AD9656
AD9656 Evaluation Board
機能と利点
- 6V 2A switching supply (such as CUI EPS060250UH-PHP-SZ) (optional)
- 12V, 3 A switching power supply
- Analog signal source and anti aliasing filter
- Analog Clock source (if not using the on-board crystal)
- PC running Windows
- USB 2.0 port recommended (USB 1.1 compatible)
- AD9656 Evaluation Board (AD9656EBZ)
- HSC-ADC-EVALEZ Data Capture Board
製品の詳細
The AD9656 data sheet provides additional information related to device configuration and performance, and should be consulted when using these tools. All documents and Visual Analog and SPI Controller are available at the High Speed ADC Evaluation Boards page. For additional information or questions, please email highspeed.converters@analog.com
ツールおよびシミュレーション 6
MathWorks® 1
IBISモデル 1
設計ツール
設計ツール
Visual Analog
ADC Companion Transport Layer RTL Code Generator Tool
JESD204x Frame Mapping Table Generator
