AD9517-3

新規設計に推奨

クロック・ジェネレータ、12出力、2.0GHzのVCO内蔵

データシート (Rev. F) 製品セレクション・テーブル
製品モデル
4
1Ku当たりの価格
最低価格：$8.60
利用上の注意

アナログ・デバイセズ社は、提供する情報が正確で信頼できるものであることを期していますが、その情報の利用に関して、あるいはその利用によって生じる第三者の特許やその他の権利の侵害に関して一切の責任を負いません。また、アナログ･デバイセズ社の特許または特許の権利の使用を明示的または暗示的に許諾するものでもありません。仕様は予告なしに変更する場合があります。本紙記載の商標および登録商標は、各社の所有に属します。


本データシートの英語以外の言語への翻訳はユーザの便宜のために提供されるものであり、リビジョンが古い場合があります。最新の内容については、必ず最新の英語版をご参照ください。

なお、日本語版のデータシートは基本的に「Rev.0」（リビジョン0）で作成されています。そのため、英語版が後に改訂され、複数製品のデータシートがひとつに統一された場合、同じ「Rev.0」の日本語版のデータシートが異なる製品のデータシートとして表示されることがあります。たとえば、「ADM3307E」の場合、日本語データシートをクリックすると「ADM3311E」が表示されます。これは、英語版のデータシートが複数の製品で共有できるように1本化され、「ADM3307E/ADM3310E/ADM3311E/ADM3312E/ADM3315E」（Rev.G）と改訂されたからで、決して誤ってリンクが張られているわけではありません。和文化されたデータシートを少しでも有効に活用していただくためにこのような方法をとっておりますので、ご了解ください。
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製品の詳細

  • 低位相ノイズ、フェーズ・ロック・ループ（PLL）
    • 低位相ノイズ、PLL 内蔵VCOのチューニング範囲1.75～2.25GHz
    • オプションの外付けVCO / VCXO（最大2.4GHz）
    • 1個の差動 / 2個のシングルエンド・リファレンス入力
      リファレンス監視機能
    • 自動復帰と手動のリファレンス
      • スイッチオーバー／ホールドオーバー・モード
    • 最大250MHzのLVPECL、LVDS、またはCMOSリファレンスが入力可能
      PFDへのパスのプログラマブルな遅延
    • 選択可能なデジタルまたはアナログのロック検出
  • 電源投入時にすべての出力が自動同期
  • 手動出力同期が可能
  • 48ピンLFCSPで供給
  • 2ペアの1.6GHz LVPECL出力
    • 各出力ペアで1対32分周期を共有（粗位相遅延あり）
    • 追加出力ジッタ：225 fs rms
    • 出力ペアのチャンネル間スキュー<10ps
  • 2ペアの800 MHz LVDSクロック出力
    • 各ペアでカスケード接続された2個の1～32分周器（コース位相遅延が設定可能）を共用
    • 追加出力ジッタ：275 fs rms
    • 各LVDS出力のファイン遅延調整（Δt）
    • 各LVDS出力は2つの250MHz CMOS出力として構成可能
AD9517-3
クロック・ジェネレータ、12出力、2.0GHzのVCO内蔵
AD9517-3-fbl AD9517-3 Pin Configuration
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サポート

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ドキュメント

データシート 1

ユーザ・ガイド 1

アプリケーション・ノート 11

技術記事 6

評価用設計ファイル 4

よく聞かれる質問 1

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ソフトウェア・リソース

FPGA/HDL 1

ハードウェア・エコシステム

製品モデル 製品ライフサイクル 詳細
インテジャー N PLL 1
ADF4002
新規設計に推奨 PLL周波数シンセサイザ／位相検出器
高速コンパレータ（伝播遅延100ns未満） 1
LTC6957
位相ノイズの小さいデュアル出力バッファ/ドライバ/ロジック・コンバータ
Modal heading
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ツールおよびシミュレーション

AD9517-x IBIS Models 1

ADIsimCLK 設計・評価 ソフトウェア

ADIsimCLKはアナログ・デバイセズの超低ジッタのクロック分配器とクロック生成用製品向けに開発された設計ツールです。ADIsimCLKを使用すれば、ワイヤレス・インフラストラクチャ、計測器、ネットワーキング、ブロードバンド、ATE（自動試験装置）あるいはクロック性能が予測可能であることが求められるあらゆる分野のアプリケーションで、設計を迅速に開発、評価、最適化できます。

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評価用キット

EVAL-AD9517-3

AD9517- 3 Evaluation Board

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機能と利点

  • Simple power connection using 6 V wall adapter and on-board LDO voltage regulators
  • LDOs are easily bypassed for power measurements
  • 8 ac-coupled differential LVPECL SMA connectors
  • 2 ac-coupled LVPECL differential headers
  • 2 dc-coupled differential LVDS SMA connectors that are reconfigurable to four CMOS SMA connectors
  • 2 dc-coupled LVDS differential headers that are reconfigurable to four CMOS connectors
  • SMA connectors for
    2 reference inputs
    Charge pump output
    Clock distribution input
  • USB connection to PC
  • Microsoft Windows-based evaluation software with simple graphical user interface
  • On-board PLL loop filter
  • Easy access to digital I/O and diagnostic signals via I/O header
  • Status LEDs for diagnostic signals

製品詳細

The AD9516-x, AD9517-x, and AD9518-x are very low noise PLL clock synthesizers featuring an integrated VCO, clock dividers, and up to 14 outputs. The AD9516 features automatic holdover and a flexible reference input circuit allowing for very smooth reference clock switching. The AD9516 family also features the necessary provisions for an external VCXO.

The AD9516 evaluation board is a compact, easy-to-use platform for evaluating all features of the AD9516. The AD9516, AD9517, and AD9518 differ only in package size, and the number of outputs. The evaluation software main window for the AD9517 and AD9518 reflects fewer outputs, but the operation is identical for all devices.

Use the user guide in conjunction with the AD9516, AD9517, and AD9518 data sheets.
EVAL-AD9517-3
AD9517- 3 Evaluation Board

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1 年前
The CLK frequency output from AD9516-1 on DAC AD9787 evaluation board &#39;AD9787-DPG2-EBZ&#39;, i.e., ~2440MHz, didn&#39;t match the configuration of 2560MHz by ACE.
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