概览

优势和特点

  • 14路输出,可配置为HSTL或LVDS
  • 最大输出频率:
    6路输出高达1.25 GHz
    8路输出高达1 GHz
  • 取决于压控晶体振荡器
    • (VCXO)频率精度(启动频率精度:<±100 ppm)
  • 每路输出均提供专用的8位分频器
    粗调延迟: 63个步长为RF VCO分频器输出频率一半的步进,不受抖动影响
    微调延迟: 15个步进,分辨率为31 ps
 
  • 典型输出间偏斜: 20 ps
  • 针对奇数分频器设置提供占空比校正
  • 输出12和输出13,上电时VCXO输出
  • 绝对输出抖动: <160 fS(122.88 MHz时)
    12 kHz至20 MHz积分范围
  • 数字锁频检测
  • SPI和I2C兼容型串行控制端口
  • 双PLL架构
    • PLL1
      • 利用外部VCXO实现参考输入时钟清零
      • 鉴相器速率:最高110 MHz
      • 冗余参考输入
      • 自动和手动参考切换模式
      • 恢复式和非恢复式切换
      • 保持模式支持参考丢失检测
      • VCXO提供的低噪声LVDS/HSTL输出可用于射频/中频(RF/IF)频率合成器
    • PLL2
      • 鉴相器速率:最高275 MHz
      • 集成低噪声VCO
 

产品详情

AD9528是一款双级PLL,集成JESD204B SYSREF发生器,可用于多器件同步。第一级锁相环(PLL) (PLL1)通过减少系统时钟的抖动,从而实现输入基准电压调理。第二级PLL (PLL2)提供高频时钟,可实现来自时钟输出驱动器的较低积分抖动以及较低宽带噪声。外部VCXO提供PLL2所需的低噪声基准电压,以满足苛刻的相位噪声和抖动要求,实现可以接受的性能。片内VCO的调谐频率范围为3.450 GHz至4.025 GHz。集成的SYSREF发生器输出单次、N次或连续信号,并与PLL1和PLL2输出同步,以便对齐多个器件的时间。

AD9528产生最高频率为1.25 GHz的六路输出(输出0至输出3、输出12和输出13),以及最大频率高达1 GHz的八路输出。每一路输出均可配置为直接从PLL1、PLL2或内部SYSREF发生器输出。14路输出通道的每一路都包含一个带数字相位粗调功能的分频器,以及一个模拟微调相位延迟模块,允许全部14路输出具有时序对齐的高度灵活性。AD9528还可用作灵活的双通道输入缓冲器,以便实现14路器件时钟和/或SYSREF信号的分配。上电时,AD9528直接向输出12和输出13发送VCXO信号,用作上电就绪时钟。

应用

  • 高性能无线收发器
  • LTE和多载波GSM基站
  • 无线和宽带基础设施
  • 医疗仪器
  • 为高速ADC、DAC、DDS、DDC、DUC、MxFE提供时钟;支持JESD204B
  • 低抖动、低相位噪声时钟分配
  • 自动测试设备(ATE)和高性能仪器仪表


产品生命周期 icon-recommended 推荐新设计使用

本产品已上市。数据手册包含所有最终性能规格和工作条件。ADI公司推荐新设计使用这些产品。

评估套件 (7)

软件代码及系统需求

评估软件

JESD204接口框架

Integrated JESD204 software framework for rapid system-level development and optimization

工具及仿真模型

IBIS模型

设计工具

ADIsimCLK设计与评估软件

ADIsimCLK是一款专门针对ADI公司的超低抖动时钟分配和时钟产生产品系列而开发的设计工具。无论是在无线基础设施、仪器仪表、网络、宽带、自动测试设备领域,还是在其它要求可预测时钟性能的应用,ADIsimCLK都能帮助您迅速开发、评估和优化设计。

设计资源

ADI始终把满足您最高可靠性水平的产品放在首要位置。我们通过在所有产品、工艺设计和制造过程中引入高质量和可靠性检查实践这一承诺。发运的产品实现“零缺陷”始终是我们的目标。

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