ADN4667
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ADN4667

CMOS差動ライン・レシーバ:3 V LVDS クワッド

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よく聞かれる質問(FAQ)

製品モデル 5
1Ku当たりの価格 最低価格:$1.40
特長
  • 出力ピンの±15 kV ESD保護
  • スイッチング・レート: 400 Mbps (200 MHz)
  • フロー・スルー・ピン配置によりPCBレイアウトを簡素化
  • 差動スキュー: 300 ps (typ)
  • 最大差動スキュー: 400 ps
  • 最大伝搬遅延: 1.7 ns
  • 電源電圧: 3.3 V
  • 既存5 V LVDSレシーバと互換

製品概要
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ADN4667は、クワッドのCMOS低電圧差動シグナリング(LVDS)ライン・ドライバであり、400 Mbps (200 MHz)を超えるデータ・レートと超低消費電力を提供します。 フロー・スルー・ピン配置を採用しているため、PCBレイアウトおよび入力信号と出力信号の分離が容易になります。

このデバイスは低電圧TTL/CMOSロジック信号を入力して、ツイストペア・ケーブルのような伝送媒体を駆動する±3.1 mAの差動電流出力に変換します。送信された信号は、受信端で終端抵抗の両端に±310 mVの差動電圧を発生します。この差動電圧は、ADN4668のようなLVDSレシーバによってTTL/CMOSロジック・レベルに戻されます。また、ADN4667はアクティブ・ハイとアクティブ・ローのイネーブル/ディスエーブル入力(ENとEN)も提供します。これらの入力は4個すべてのドライバを制御し、ディスエーブル状態では出力電流をターンオフして静止消費電力を10 mW (typ)に削減します。

ADN4667とこれと対になるLVDSレシーバの組み合わせは、高速な1対1データ伝送に対する新しいソリューションを提供し、ECL (emitter-coupledロジック)またはPECL (positive emitter-coupledロジック)に対する低消費電力の代替品を提供します。

アプリケーション

  • バック・プレーン・データ伝送
  • ケーブル・データ伝送
  • クロック分配
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    なお、日本語版のデータシートは基本的に「Rev.0」(リビジョン0)で作成されています。そのため、英語版が後に改訂され、複数製品のデータシートがひとつに統一された場合、同じ「Rev.0」の日本語版のデータシートが異なる製品のデータシートとして表示されることがあります。たとえば、「ADM3307E」の場合、日本語データシートをクリックすると「ADM3311E」が表示されます。これは、英語版のデータシートが複数の製品で共有できるように1本化され、「ADM3307E/ADM3310E/ADM3311E/ADM3312E/ADM3315E」(Rev.G)と改訂されたからで、決して誤ってリンクが張られているわけではありません。和文化されたデータシートを少しでも有効に活用していただくためにこのような方法をとっておりますので、ご了解ください。

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    アナログ・デバイセズは、最高レベルの品質と信頼性を満たす製品を供給することを常に最重要視しています。これを実現するため、製品、プロセス設計、更には製造プロセスに対しあらゆる観点から品質と信頼性のチェックを行っています。アナログ・デバイセズでは出荷製品に対する「ゼロ・ディフェクト」を常に目指しています。詳細については、アナログ・デバイセズの品質および信頼性プログラム、認証のページを参照してください。
    製品モデル ピン/パッケージ図 資料 CADシンボル、フットプリント、および3Dモデル
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