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製品概要
機能と利点
- JESD204B (サブクラス 1)にコード化されたシリアル・デジタル出力
- レーン・レート: 15 Gbps max
- 全電力1.66 W ＠500 MSPS
- A/Dコンバータ(ADC)チャンネルあたり415 mW
- SFDR = 82 dBFS @305 MHz（入力範囲:1.80 V p-p ）
- SNR = 66.8 dBFS @ 305 MHz (入力範囲:1.80 V p-p)
- ノイズ密度 = −151.5 dBFS/Hz (入力範囲: 1.80 V p-p)
- DC動作電源電圧：0.975 V、1.8 V、2.5 V
- ノーミス・コード
- ADC用電圧リファレンスを内蔵
- アナログ入力バッファ
- 小信号の直線性を高めるオンチップのディザリング
- 柔軟な差動入力範囲
- 1.44 V p-p ～ 2.16 V p-p (公称1.80 V p-p)
- アナログ入力フルパワー帯域幅：1.4 GHz
- 効果的なAGCの実施ための振幅検出ビット
- 4個の広帯域デジタル・プロセッサを内蔵
- 48ビットNCO、最大4個の直列接続ハーフバンド・フィルタ
- 差動クロック入力
- 1、 2、 4、 8の整数クロック分周
- ダイオード温度センサーを内蔵
- 柔軟性あるJESD204Bレーン構成
製品概要
AD9694は、クワッド、14ビット、500MSPSのA/Dコンバータ(ADC)です。このデバイスはバッファとサンプル＆ホールド回路を内蔵し、低消費電力、小型、使い易さを考慮して設計されています。この製品は最大1.4 GHzの広帯域アナログ信号をサンプリングできるように設計されています。AD9694は小型パッケージに収納され広い入力帯域、高サンプリング・レート、優れた直線性、低消費電力を目標に最適化されています。
クワッドのADC コアはマルチステージの差動パイプライン・アーキテクチャを採用し、出力誤差補正ロジックを内蔵しています。各ADCの入力は広帯域になっており、ユーザ選択可能な、多様な入力範囲に対応します。電圧リファレンスを内蔵しているので回路設計が容易です。
アナログ入力とクロック信号は差動入力です。ADCデータ出力の各ペアはクロスバー・マルチプレクサを介して内部で2個のDDCに接続されています。各DDCは直列接続された5段の信号処理段で構成されています：48ビット周波数変換器(NCO)と最大4個のハーフバンド・デシメーション・フィルタ。
AD9694は DDC回路の他に、通信用レシーバ内に自動ゲイン制御 (AGC) 機能を簡素化する複数の機能を備えています。さらに、スレッショールドが可変の検出器を使うと、ADCの高速検出出力ビットを使って着信信号電力をモニターすることができます。入力信号レベルが可変のスレッショールドを超えると、高速検出インジケータがハイ・レベルになります。このスレッショールド・インジケータのレイテンシは小さいため、ユーザは迅速にシステム・ゲインを下げて、ADC入力がオーバー・レンジ状態になるのを防ぐことができます。
ユーザは中間周波数（IF）レシーバ出力の各ペアをデシメーション・レシオと受信側ロジック・デバイスで受信できるレーン・レートに応じて、1 レーン、2 レーンいずれかのJESD204B（サブクラス 1）準拠高速シリアル出力に構成できます。SYSREF±、SYNCINB±AB、SYNCINB±CD入力ピンを通して複数のデバイスを同期させることができます。
AD9694には必要に応じて大幅な省電力を可能にする柔軟なパワーダウン・オプションがあります。これらすべての機能は1.8 V 対応3線式 SPI を使って設定可能です。
AD9694は72ピンの鉛フリーLFCSPパッケージを採用し、-40°C～+105°Cのジャンクション温度範囲で仕様を規定しています。
製品のハイライト
- チャンネルあたりの消費電力が低い。
- JESD204Bレーン・レートは15 Gbpsまで対応。
- 広いフルパワー帯域幅は、最大1.4GHzまでの信号のIFサンプリングをサポートします。
- バッファ付き入力によりフィルタの設計と実装が容易。
- 内蔵の4個の広帯域デシメーション・フィルタと数値制御発振器(NCO) ブロックにより、マルチバンド・レシーバをサポート。
- 柔軟なシリアル・ポート・インターフェース（SPI）は、個別のシステム要求を満たすために製品の各種特性と機能を制御します。
- プログラマブルな高速オーバー・レンジ検出機能。
- システムの温度管理用ダイオード温度センサーを内蔵。
アプリケーション
- 通信関連
- ダイバーシティ・マルチバンド、マルチ・モード・デジタル・レシーバ 3G/4G、 W-CDMA、 GSM、 LTE、 LTE-A
- 汎用ソフトウェア無線
- 超広帯域衛星レシーバ
- 計測器
- レーダー
- シグナル・インテリジェンス(SIGINT)
製品ライフサイクル
新規設計にお薦めします
発売済みの製品です。データシートには、最終的な仕様と動作条件がすべて記載されています。新規の設計には、これらの製品の使用を推奨します。
評価キット (1)
ドキュメント
ツール
Virtual Eval（仮想評価、 ベータ版）
Virtual Evalは、ADC、DAC、およびその応用製品評価を支援するウェブベースの設計ツールです。アナログ・デバイセズのサーバ上にあるモデルを使用して、重要な部品の性能特性をわずか数秒でシミュレートします。使用時は、入力トーンや外部ジッタなどの動作条件のほか、ゲインやデジタル・ダウンコンバージョンといったデバイス機能を設定してください。ノイズ、歪み、分解能、FFT、タイミング図、周波数応答プロット、その他さまざまな性能特性を確認することができます。
IBIS Models
設計ツール
The JESD204x Frame Mapping Table Generator tool consists of two Windows executables that will allow the user to input any valid combination of JESD204x parameters (L, M, F, S, NP) in order to output a .csv file that illustrates the frame mapping of the JESD204x mode in table format. There is an executable that allows the user to input a single JESD204x mode and another, that allows the user to input the parameters for multiple JESD204x modes in a specified .csv format in order to output a .csv file that illustrates the frame mapping of each of the JESD204x modes that were input into separate tables.
This command line executable tool generates a Verilog module which implements the JESD204 receive transport layer. The user specifies in a configuration file one or more modes to be supported by the transport layer module. These modes are defined as a set of JESD204 parameter values: L, M, F, S, N', and CF. The transport layer converts JESD204 lane data output from a JESD204 link layer IP to a data bus with a fixed width, containing interleaved virtual converter samples. Both JESD204B and JESD204C link layers are supported.
参考資料
28nm CMOS 技術を採用した RF 対応の ADC/DAC
設計リソース
ADI has always placed the highest emphasis on delivering products that meet the maximum levels of quality and reliability. We achieve this by incorporating quality and reliability checks in every scope of product and process design, and in the manufacturing process as well. "Zero defects" for shipped products is always our goal.
PCN-PDN Information
サポート ＆ ディスカッション
AD9694 Discussions
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