AD9652

推荐用于新设计

16位、310 MSPS、3.3/1.8 V双通道模数转换器(ADC)

数据手册 (Rev. C) 产品选型表
产品技术资料帮助

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概述

  • 高动态范围
    -SNR = 75.0 dBFS（70 MHz，AIN = −1 dBFS）
    -SFDR = 87 dBc（70 MHz，AIN = −1 dBFS）
    -欲了解更多特性，请参考数据手册
  • 出色的IF采样性能
    -SNR = 73.7 dBFS（170 MHz，AIN = −1 dBFS）
    -SFDR = 85 dBc（170 MHz，AIN = −1 dBFS）
    -全功率带宽为465 MHz
  • 片内3.3 V缓冲器
    -可编程输入范围为2 V p-p至2.5 V p-p（默认值）
  • 差分时钟输入接收机，带1、2、4和8整数输入（时钟分频器输入最高可达1.24 GHz）
  • 内部ADC时钟占空比稳定器
  • SYNC输入允许多芯片同步
  • 总功耗：
    2.16 W
    -3.3 V和1.8 V 电源电压
  • DDR LVDS（ANSI-644电平）输出
  • 串行端口控制
  • 节能的掉电模式


AD9652是一款双通道、16位、采样速率最高达310 MSPS的模数转换器(ADC)。 它用于支持高要求、高速度信号处理应用，该应用需要在宽输入频率范围（最高达465 MHz）具有出色的动态范围。 其出色的低本底噪声(-157.6 dBFS)和大信号无杂散动态范围(SFDR)性能（超过85 dBFS，典型值）可在大信号存在的情况下解析低电平信号。

这款双通道ADC内核采用多级、流水线架构，并集成了输出纠错逻辑。 高性能片内缓冲器和内部基准电压源简化了外部驱动电路接口，同时保持ADC的出色性能。

AD9652可支持最高达1.24 GHz的输入时钟频率，其采用1、2、4和8整数时钟分频器来生成ADC采样时钟。 提供占空比稳定器来补偿ADC时钟占空比的波动。 来自每个ADC的16位输出数据（带超量程位）与双数据速率(DDR)时钟在单独的LVDS输出端口交错。 设置与控制编程利用三线式SPI兼容型串行接口来完成。

AD9652采用144引脚CSP_BGA封装，额定温度范围为−40 ℃至+85 ℃工业温度范围。该产品受正在申请中的美国专利保护。

产品特色

  1. 集成双通道、16位310 MSPS ADC。
  2. 片内缓冲器简化ADC驱动器接口。
  3. 采用3.3 V和1.8 V电源供电，数字输出驱动器则采用独立电源供电，以支持LVDS输出。
  4. 取得专利的差分输入在最高至485 MHz的输入频率下仍保持出色的信噪比(SNR)性能。
  5. SYNC输入可在多个设备之间实现同步。
  6. 三线式、3.3 V或1.8 V SPI端口，用于寄存器编程和回读。

应用

  • 军用雷达和通信
  • 多模式数字接收机（3G或4G）
  • 测试和仪器仪表
  • 智能天线系统

AD9652
16位、310 MSPS、3.3/1.8 V双通道模数转换器(ADC)
AD9652 Functional Block Diagram AD9652 Pin Configuration
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数据手册 1

用户手册 1

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软件资源

器件驱动器 1

硬件生态系统

部分模型 产品周期 描述
差分放大器 3
ADL5566
推荐用于新设计 4.5 GHz 超高动态范围双通道差分放大器
ADA4938-2
推荐用于新设计 超低失真差分ADC驱动器（双通道）
ADA4930-2
推荐用于新设计 超低噪声驱动器，适用于低压ADC
可变增益放大器(VGA) 2
AD8375
量产 超低失真IF VGA
AD8376
推荐用于新设计 超低失真IF双通道VGA
时钟IC 2
AD9530
推荐用于新设计 集成5.4 GHz VCO的4路CML输出、低抖动时钟发生器
AD9525
推荐用于新设计 AD9525旨在满足长期演进(LTE)和多载波GSM基站设计的转换器时钟要求。
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工具及仿真模型

Virtual Eval - BETA

Virtual Eval是一款网络应用程序，可帮助设计人员评估ADC和DAC产品。 利用ADI公司服务器上的详细模型，Virtual Eval在几秒内可仿真关键部件的性能特征。 对工作条件（如输入音和外部抖动）以及器件特性（如增益或数字下变频）进行配置。 性能特征包括噪声、失真和分辨率、FFT、时序图、频率响应图等。

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AD9652 Simulink ADIsimADC Model

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评估套件

eval board
schematic 1
HSC-ADC-EVALCZ

基于FPGA的数据采集套件

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特性和优点

  • 64kB FIFO深度
  • 适用于单通道和多通道ADC
  • 与VisualAnalog®软件配合使用
  • 基于Virtex-4 FPGA
  • 可能需要适配器，才能与某些ADC评估板接口
  • 允许对SPI控制进行编程 每个通道的DDR编码速率高达644 MSPS SDR / 800MSPS
  • 每个通道的DDR编码速率

产品详情

HSC-ADC-EVALCZ高速转换器评估平台使用基于FPGA的缓冲存储器板，采集来自ADI高速模数转换器(ADC)评估板的数字数据块。该板通过USB端口连接到PC，并与VisualAnalog®软件配合使用来快速评估高速ADC的性能。该评估套件设置简单。所需的额外设备包括ADI高速ADC评估板、信号源和时钟源。一旦连接该套件并上电，PC便立即开始评估。

eval board
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EVAL-AD-FMCOMMS6-EBZ

AD-FMCOMMS6-EBZ 评估板

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特性和优点

  • 降低接收机复杂性，减少所需级数；提高性能和降低功耗
  • 避免镜像抑制问题和干扰混频

产品详情

AD-FMCOMMS6-EBZ评估板是一款400MHz至4.4GHz接收器，采用AD9652 双通道16位模数转换器、ADL5566高动态范围RF/IF双通道差分放大器和ADL5380 正交解调器。

它采用的是一种I和Q解调方法，可直接转换（亦称为零差或零中频）接收器架构。 与可以执行多次频率转换的超外差式接收机相比，直接变频无线电只能执行一次频率转换。 一次频率转换的优势如下：

  • 降低接收机复杂性，减少所需级数；提高性能和降低功耗
  • 避免镜像抑制问题和干扰混频

这种拓扑可提供镜像抑制能力，并能快速部署差分信号环境。 该评估板集成放大级，可保持ACD的满量程输入。 板上集成本振和ADC时钟，共享相同的参考信号，防止拖尾现象。 该产品的尺寸兼容VITA57，所有直流电源均从数据捕捉板通过FMC连接器进行路由。 这款评估板展示了高性能的接收器信号链，针对采用“现成商业技术”(COTS)组件的军事和通信雷达应用。 整体电路的带宽为220MHz，通带平坦度为+/_ 1.0 dB。 145MHz中频时，测得的SNR和SFDR分别为64dB和75dBc。




eval board
schematic 3
schematic 4
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EVAL-AD9652

AD9652评估板

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特性和优点

  • AD9652的全功能评估板
  • 用于设置和控制的SPI接口
  • 外部时钟选项
  • 巴伦/变压器或放大器输入驱动选项
  • LDO调节器或开关电源选项
  • VisualAnalog®和SPI控制器软件接口

产品详情

AD9652-310EBZ用于评估双通道16位ADC AD9652。本参考设计提供在各种模式和配置下运行器件所需的全部支持电路。它设计为可直接与HSC-ADC-EVALCZ的数据捕获卡进行接口，允许用户下载捕获的数据用于分析。Visual Analog软件包用来与器件的硬件部分实现接口，允许用户下载捕获的数据并通过用户友好型图形界面进行分析。同时，SPI控制器软件包也兼容硬件部分，允许用户使用AD9652的SPI可编程功能。

AD9652数据手册提供了更多有关器件配置和性能的信息，在使用这些工具时应加以参考。所有文档、Visual Analog软件以及SPI控制器均可在高速ADC评估板页面上找到。欲了解更多信息，或有任何疑问，请发送电子邮件至highspeedproductssupport@analog.com。
HSC-ADC-EVALCZ
基于FPGA的数据采集套件
High_Speed_ADC_evalboard_05
EVAL-AD-FMCOMMS6-EBZ
AD-FMCOMMS6-EBZ 评估板
eval-image-unavailable
EVAL-AD9652
AD9652评估板
EVAL-AD9652-310EBZ Evaluation Board EVAL-AD9652-310EBZ Evaluation Board - Top View EVAL-AD9652-310EBZ Evaluation Board - Bottom View

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