AD9430

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12位、170/210 MSPS、3.3 V ADC

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  • 信噪比(SNR):
    65 dB(Fin最高为70 MHz,210 MSPS)
  • ENOB:
    10.6(Fin最高为70 MHz,210 MSPS)
  • 无杂散动态范围(SFDR):
    80 dBc(Fin最高为70 MHz,210 MSPS)
  • 出色的线性度:
    - 微分非线性(DNL)= ±0.3 LSB(典型值)
    - 积分非线性(INL)= ±0.5 LSB(典型值)
  • 两种输出数据可供选择:
    - 解复用3.3 V CMOS输出(每路105 MSPS)
    - 可选择交错或并行数据输出
    - LVDS(210 MSPS)
  • 700 MHz全功率模拟带宽
  • 功耗:1.3 W(典型值,210 MSPS)
  • 1.5 V输入电压范围
  • 3.3 V电源供电
  • 可选择输出数据格式
  • 提供数据同步输入和数据时钟输出
  • 时钟占空比稳定器
AD9430
12位、170/210 MSPS、3.3 V ADC
AD9430 Functional Block Diagram AD9430 Pin Configuration AD9430 Pin Configuration
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参考资料

数据手册 1

用户手册 1

应用笔记 17

技术文章 5

评估设计文件 2

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