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特性
- 2个可选差分输入
- 工作频率:4.8 GHz
- 宽带随机抖动:75 fs rms
- 片内输入端接
- 电源:3.3 V
该器件具有两个差分输入,通过IN_SEL控制引脚进行选择。两个输入均配备中心抽头、差分、100 Ω片内端接电阻,接受直流耦合LVPECL、CML、3.3 V CMOS(单端)以及交流耦合1.8 V CMOS、LVDS和LVPECL输入。提供VREFx引脚用于偏置交流耦合输入。
ADCLK948内置8个全摆幅射极耦合逻辑(ECL)输出驱动器。对于LVPECL(正ECL)工作模式, VCC 偏置至正电源, VEE 偏置至接地。对于ECL工作模式, VCC 偏置至接地, VEE 偏置至负电源。输出级旨在从各端将800 mW直接驱动至端接于VCC -2V的50 Ω负载,从而获得1.6 V的总差分输出摆幅。
ADCLK948采用32引脚LFCSP封装,额定工作温度范围为−40°C至+85°C标准工业温度范围。
应用
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ADCLK948
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参考资料
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产品型号 | 引脚/封装图-中文版 | 文档 | CAD 符号,脚注和 3D模型 |
---|---|---|---|
ADCLK948BCPZ | 32-Lead LFCSP (5mm x 5mm x 0.75mm w/ EP) |
|
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ADCLK948BCPZ-REEL7 | 32-Lead LFCSP (5mm x 5mm x 0.75mm w/ EP) |
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- ADCLK948BCPZ
- 引脚/封装图-中文版
- 32-Lead LFCSP (5mm x 5mm x 0.75mm w/ EP)
- 文档
- HTML Material Declaration
- HTML Reliablity Data
- CAD 符号,脚注和 3D模型
- Ultra Librarian
- SamacSys
- ADCLK948BCPZ-REEL7
- 引脚/封装图-中文版
- 32-Lead LFCSP (5mm x 5mm x 0.75mm w/ EP)
- 文档
- HTML Material Declaration
- HTML Reliablity Data
- CAD 符号,脚注和 3D模型
- Ultra Librarian
- SamacSys
根据型号筛选
产品型号
产品生命周期
PCN
12月 3, 2015
- 15_0255
ADCLK9xx die change
ADCLK948BCPZ
量产
ADCLK948BCPZ-REEL7
量产
11月 10, 2014
- 14_0047
Conversion of 5x5mm body Size LFCSP Package Outlines from Punch to Sawn and Transfer of Assembly Site to Amkor Philippines.
ADCLK948BCPZ
量产
ADCLK948BCPZ-REEL7
量产
根据型号筛选
产品型号
产品生命周期
PCN
12月 3, 2015
- 15_0255
ADCLK9xx die change
11月 10, 2014
- 14_0047
Conversion of 5x5mm body Size LFCSP Package Outlines from Punch to Sawn and Transfer of Assembly Site to Amkor Philippines.
ADCLK948BCPZ
量产
ADCLK948BCPZ-REEL7
量产
软件和型号相关生态系统
评估套件 1
EVAL-ADCLK948
ADCLK948评估板
产品详情
资料
工具及仿真模型 2
IBIS 模型 1
ADIsimCLK设计与评估软件
参考电路 1
CN0294
利用低抖动LVPECL扇出缓冲器增加时钟源的输出数