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ADV7682

新規設計には非推奨

APIX2 Transmitter with Dual Port HDMI and HDCP Support

利用上の注意

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なお、日本語版のデータシートは基本的に「Rev.0」(リビジョン0)で作成されています。そのため、英語版が後に改訂され、複数製品のデータシートがひとつに統一された場合、同じ「Rev.0」の日本語版のデータシートが異なる製品のデータシートとして表示されることがあります。たとえば、「ADM3307E」の場合、日本語データシートをクリックすると「ADM3311E」が表示されます。これは、英語版のデータシートが複数の製品で共有できるように1本化され、「ADM3307E/ADM3310E/ADM3311E/ADM3312E/ADM3315E」(Rev.J)と改訂されたからで、決して誤ってリンクが張られているわけではありません。和文化されたデータシートを少しでも有効に活用していただくためにこのような方法をとっておりますので、ご了解ください。

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製品情報

  • APIX2 transmitter with HDCP
    High-bandwidth Digital Content Protection (HDCP) 1.4 support with internal preprogrammed HDCP keys
    Dual-channel encryption engine supports simple daisy-chain implementation for remote displays
  • Independent encryption of video and audio
  • Up to 3000 Mbps sustained downstream link bandwidth
  • ITU-R BT.656 Support
    8-bit ITU-R BT.656 Interface with embedded timing
    720p Supported at 148.5 MHz Clock rate
  • Supports for two independent video streams and two synchronous audio streams
  • Up to 187.5 Mbps upstream link bandwidth
  • Audio support
  • HDMI audio extraction support
    Supports multiplexed (TDM) I2S audio I/O
  • General
    Dual interrupt controller with APIX link status reporting
    Internal EDID RAM
  • Qualified for automotive applications
  • See data sheet for additional features

The ADV7682 is a high quality, dual input HDMI® and single input ITU-R BT.656 receiver with an APIX®2 transmitter, compatible with APIX® and APIX2 receiver technology from Inova Semiconductors. It incorporates dual port HDMI receivers that support all mandatory 3D TV formats defined in HDMI. The ITU-R BT.656 8-bit receiver supports resolutions up to 720p when using a 148.5 MHz input clock. A standard ITU-R BT.656 input clock of 27 MHz is also supported. When using the ITU-R BT.656 interface, only embedded timing is supported. There is no provision for using separate horizontal sync (Hsync) or vertical sync (Vsync) inputs. The ADV7682 also supports DVI or HDMI resolutions up to a 107 MHz pixel clock at 24 BPP or a 140 MHz pixel clock at 18 BPP. However, the input format configuration across both video ports must be managed to ensure that the maximum total video payload for the APIX2 interface is not exceeded.

ADV7682 integrates a CEC controller that supports the capability discovery and control (CDC) feature.

The ADV7682 has an audio output port for the audio data extracted from any one of the HDMI input streams. The HDMI receiver also has an advanced mute controller that prevents audible extraneous noise (pops and clicks) in the audio output. Additionally, the ADV7682 can be set to output TDM serial audio, which allows transmission of four multiplexed stereo serial audio channels on a single audio output interface port.

The following HDMI source audio formats are accessible as outputs from the ADV7682:

  • A stream from the audio serializer (two audio channels).
  • A TDM stream from the audio serializer (eight audio channels, time multiplexed). The maximum audio bit rate is 48 kHz.
  • A stream from the audio serializer (two uncompressed channels or N compressed channels, for example, AC3).
  • An external master clock (MCLK) used to output audio data in stereo modes. The maximum audio bit rate is 48 kHz for sample rate converter (SRC) mode with an external MCLK.

The following audio formats are supported as inputs to the ADV7682, for transmission over the APIX2 interface:

  • One serial audio stream (two audio channels).
  • One TDM serial audio stream (eight audio channels, time multiplexed). The maximum audio bit rate is 96 kHz.
  • Two serial audio streams using a combination of the serial audio input ports (I2S1 and I2S0) or HDMI extracted audio (two independent stereo audio channels with asynchronous master clocks). On-board SRC is performed in this configuration. The maximum audio bit rate is 48 kHz in SRC modes.

One of the HDMI input ports is assigned a dedicated 5 V detect and Hot Plug assert pins. The HDMI receiver also includes an integrated equalizer that ensures the robust operation of the interface with long cables, including support for Type E automotive cable assemblies and connectors.

The ADV7682 contains one main component processor (CP) that processes the video signals from any one of the HDMI receiver ports. The ADV7682 provides features such as contrast, brightness, and saturation adjustments; a standard identification (STDI) detection block; and free run and synchronization alignment controls.

Fabricated in an advanced CMOS process, the ADV7682 is provided in a 14 mm × 14 mm, 100-lead surface-mount LQFP_EP RoHS-compliant package and is specified over the −40°C to +85°C temperature range.

ADV7682 is offered in automotive, industrial version.

APPLICATIONS

  • Automotive infotainment
  • Infotainment head units
  • Rear seat entertainment systems
  • Automotive media port applications
  • HDMI repeaters and video switches

ADV7682
APIX2 Transmitter with Dual Port HDMI and HDCP Support
ADV7682 Functional Block Diagram
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