製品概要
機能と利点
- コア命令レート：100 MHz（10.5 ns）
- 2つの演算ユニットのSIMD動作を含み、命令を1サイクルで実行
- 570 MFLOPSピーク、380 MFLOPSの持続性能（FIRをベース）
- モジュロおよびビット反転アドレシング機能付きの2個のData Address Generators（DAG）
- EEE 1149.1 JTAG規格テスト・アクセス・ポートとオンチップ・エミュレーション
- 効率的なプログラム・シーケンシング機能を提供する、ゼロ・オーバーヘッドのループ処理と1サイクルのループ・セットアップ
- 400ボール27 x 27 mmメトリックPBGAパッケージ
- 単一命令複数データ（SIMD）アーキテクチャは2つの演算処理エレメントを提供、同時実行そしてADSP-2106x SHARC DSPファミリーとアセンブラ・レベルでコード互換
製品概要
ADSP-21160N SHARC® DSPはADSP-21160の2つ目の繰り返し製品です。この製品は0.18ミクロンCMOSプロセスで製造され、その前の製品ADSP-21160Mより高性能で低消費電力になっています。ADSP-21160Nは、携帯性を簡素化するために、SISD（単一命令、単一データ）モードで、第一世代のADSP-2106x SHARC DSPとアプリケーション・ソース・コード互換になっています。プロセッサのSIMD（単一命令複数データ）機能を利用するには、いくつかのコードを変更する必要があります。ADSP-21160Nは、他のSHARCのように高性能DSPアプリケーションに最適化された32ビット・プロセッサです。ADSP-21160Nは100 MHzコア、デュアル・ポート・オンチップSRAM、マルチプロセシング支援付き統合型I/Oプロセッサ、I/Oのボトルネックを解消する複数の内部バスを内蔵しています。
ADSP-21160Nは単一命令、複数データ（SIMD）処理を取り入れます。2つの演算ユニット（ADSP-2106x SHARC DSPは1つ）を使用するので、ADSP-21160Nは様々なDSPアルゴリズムに関してADSP-2106xに対し性能を2倍にできます。
ADSP-21160NはDSPの集積のためのSHARCの業界最先端の規格を継承し、高性能32ビットDSPコアと集積化されたオンチップのシステム機能を結合しています。これらの機能には4Mビットデュアル・ポートSRAMメモリ、ホスト・プロセッサ・インターフェース、I/Oプロセッサが含まれており、14 DMAチャンネル、2個のシリアル・ポート、6個のリンク・ポート、外部パラレル・バス、外部部品不要のマルチプレシングをサポートします。
製品ライフサイクル
製造中
この製品ファミリーの1つ以上の型番が生産／供給中です。新規の設計に適していますが、より新しい代替製品を提供している場合があります。
評価キット (1)
参考資料
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EE-112: Class Implementation in Analog C++11/14/2016
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EE-356: エミュレータ／評価ハードウェアのトラブルシューティング・ガイド CCES 対応版 (Rev. 1)10/4/2012
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• EE-356: Associated Files (Rev 1, 09/2012)
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EE-332: Cycle Counting and Profiling (Rev. 2)8/18/2009
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• EE-332: Code example
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EE-340: SPIによるSHARC®とBlackfin®間接続 (Rev. 1)7/11/2008
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• EE-340: Code example (Rev 1, 07/2008)
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EE-323: Implementing Dynamically Loaded Software Modules (Rev. 1)3/8/2008
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• EE-323: Associated Code
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EE-330: Windows Vista Compatibility in VisualDSP++ 5.0 Development Tools (Rev. 1)8/31/2007
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EE-328: Migrating from ADSP-2106x/2116x to ADSP-2126x/2136x/2137x SHARC® Processors (Rev. 1)7/27/2007
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EE-175: Emulator and Evaluation Hardware Troubleshooting Guide for VisualDSP++ Users (Rev. 14)5/21/2007
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• EE-175: Associated Files
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EE-56: Tips and Tricks on SHARC® EPROM and Host Boot Loader (Rev. 3)3/7/2007
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EE-84: External Port DMA Modes of Operation for SHARC Processors (Rev. 2)3/2/2007
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• EE-84: Code Example (Rev 2, 2/2007)
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EE-223: In-Circuit Flash Programming on SHARC® Processors (Rev. 2)2/23/2007
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• EE-223: Code Example (Rev 2, 02/2007)
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EE-253: Power Bypass Decoupling of SHARC® Processors (Rev. 1)12/5/2006
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EE-305: SHARC®プロセッサ採用システムのデザインとデバッグ (Rev. 1)11/15/2006
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EE-284: Implementing Overlays on ADSP-21160 SHARC® Processors (Rev. 1)3/20/2006
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• EE-284: Software Code
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EE-270: Extended-Precision Fixed-Point Arithmetic on SIMD SHARC® Processors (Rev. 1)7/8/2005
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• EE-270 Software Code
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EE-267: Implementing In-Place FFTs on SISD and SIMD SHARC® Processors (Rev. 1)4/4/2005
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• EE-267 Software Code
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EE-261: Understanding Jitter Requirements of PLL-Based Processors (Rev. 1)2/15/2005
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EE-202: Using the Expert Linker for Multiprocessor LDFs (Rev. 3)9/15/2004
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• EE-202 Software Code
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EE-241: SHARC® DSPs to TigerSHARC® Processors Code Porting Guide (Rev. 1)7/19/2004
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• EE-241 Software Code
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EE-195: Moving from the ADSP-21160M SHARC® DSP to the ADSP-21160N SHARC DSP9/10/2003
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EE-191: Implementing a Glueless UART Using The SHARC® DSP SPORTs5/21/2003
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• EE-191 Software Code
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EE-177: SHARC® SPI Slave Booting (Rev. 3)5/2/2003
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• EE-177: Code Example (Rev 3, 01/2007)
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EE-68: Analog Devices JTAG Emulation Technical Reference (Rev. 10)12/20/2002
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EE-141: Benchmarking C Code on the ADSP-2106x and the ADSP-2116x Family of DSPs12/16/2002
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EE-148: Introduction to SHARC® Multiprocessor Systems using VisualDSP++™9/26/2002
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• EE-148 Software Code
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EE-160: Examining ADSP-21160 Link Port Backward Compatibility to the ADSP-2106x Link Ports9/18/2002
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• EE-160 Software Code
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EE-140: Using the ADSP-21160 Serial Ports in Multi-channel Mode9/18/2002
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EE-134: Writing C Compatible Assembly Code Interrupt Handlers for the SHARC® Family9/18/2002
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EE-132: Placing C Code and Data Modules in SHARC memory using VisualDSP++™9/18/2002
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• EE-132 Software Code
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EE-128: DSP in C++: Calling Assembly Class Member Functions From C++9/18/2002
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EE-106: Link Port Open Systems Interconnect Cable Standard9/17/2002
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EE-77: SHARC Link Port Booting9/17/2002
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EE-69: Understanding and Using Linker Description Files on SHARC Processors (Rev. 2)9/17/2002
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• EE-69: Code Example (Rev 2, 01/2007)
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EE-110: A Quick Primer on ELF and DWARF File Formats5/17/2000
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EE-69: リンカー記述ファイルを使いこなす1/1/2000
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• EE-69 Software Code
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EE-104: Setting Up Streams with the VisualDSP Debugger11/5/1999
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• EE-104 Software Code
ZIP
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SHARCプロセッサ：マニュアル5/17/2023
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Getting Started with SHARC2/14/2015
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ADSP-21160 SHARC® DSP Hardware Reference (Rev. 4.1)7/10/2006
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Documentation Errata
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ADSP-21160 SHARC® DSP Instruction Set Reference (Rev. 2.1)6/26/2006
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SHARCプロセッサ・ファミリー1/23/2011
ソフトウェア & システム
Software & Tools Anomaly
ソフトウェア開発ツール
CrossCore® Embedded Studio
CrossCore Embedded Studioは、アナログ・デバイセズのBlackfin®、SHARC®、Arm®の各プロセッサ・ファミリ向けに用意された、世界トップクラスの統合開発環境（IDE）です。
ツールおよびシミュレーション
BSDL Model File
設計ツール
SHARC プロセッサ ソフトウェア＆ツール
SHARC プロセッサ ソフトウェア＆ツールの一覧を掲載しております。
設計リソース
アナログ・デバイセズでは、最高レベルの品質と信頼性を備えた製品を提供することに最大の力を常に注いでいます。これを実現するため、製品およびプロセスの設計のあらゆる観点で品質と信頼性のチェックを行っています。そして、それは、製造工程においても同様です。アナログ・デバイセズは常に、出荷製品の「ゼロ・ディフェクト」を目指しています。詳細についてはアナログ・デバイセズの品質および信頼性プログラム/認定証をご覧ください。
| 製品番号 | 材料宣誓書（MD） | 信頼性データ | ピン/パッケージ図 | CADシンボル、フットプリント & 3Dモデル |
|---|---|---|---|---|
| ADSP-21160NCBZ-100 | 材料宣誓書（MD） | 信頼性データ | 400-Ball PBGA (27mm x 27mm) | |
| ウェハ・ファブリケーション・データ |
PCN-PDN情報
以下ドロップダウンからモデルを選択しPCN/PDN通知に登録してください。過去の通知も参照できます。
サポート ＆ ディスカッション
ADSP-21160N Discussions
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