ADCMP604

製造中

コンパレータ、超高速、6ピンSC70パッケージ、レールtoレール、2.5~5.5V、単電源、LVDS出力

利用上の注意

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なお、日本語版のデータシートは基本的に「Rev.0」(リビジョン0)で作成されています。そのため、英語版が後に改訂され、複数製品のデータシートがひとつに統一された場合、同じ「Rev.0」の日本語版のデータシートが異なる製品のデータシートとして表示されることがあります。たとえば、「ADM3307E」の場合、日本語データシートをクリックすると「ADM3311E」が表示されます。これは、英語版のデータシートが複数の製品で共有できるように1本化され、「ADM3307E/ADM3310E/ADM3311E/ADM3312E/ADM3315E」(Rev.J)と改訂されたからで、決して誤ってリンクが張られているわけではありません。和文化されたデータシートを少しでも有効に活用していただくためにこのような方法をとっておりますので、ご了解ください。

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製品情報

  • VCC=2.5~5.5Vで仕様が完全に規定されたレールtoレール動作
  • -0.2VからVCC+0.2Vまでの範囲の入力同相電圧
  • 低グリッチのLVDS互換出力段
  • 1.6nsの伝播遅延
  • 2.5V時で37mWの消費電力
  • シャットダウン・ピン
  • プログラマブル・ヒステリシスおよびラッチを1本のピンだけで制御
  • 電源電圧変動除去比:>60 dB
  • 動作温度範囲:-40~+125℃

ADCMP604/ADCMP605は、アナログ・デバイセズ独自のXFCB2プロセスで製造された超高速コンパレータで、融通性が非常に高く使いやすい製品です。その特長として、VEE-0.5VからVCC+0.5Vまでの入力範囲、低ノイズのLVDS互換出力ドライバ、調整可能なヒステリシス/シャットダウン入力付きのTTL/CMOSラッチ入力が挙げられます。

これ等のデバイスは、わずか1psRMSのランダム・ジッタ(RJ)で1.5nsの伝播遅延を提供しますオーバードライブとスルーレート・デスパーションは50ps以下を実現します。柔軟性の高い電源方式により、正の+2.5V単電源で-0.5~+3.0Vの入力信号範囲最大+5.5V電源では-0.5~+6Vの入力信号範囲での動作が可能です。入力電源と出力電源が分離され、しかも電源シーケンシングに関する制約がないため、幅広い入力信号範囲を設定できると同時に、個別の出力振幅制御が可能になり、消費電力を節減できます。

LVDS互換の出力段は、標準的LVDS入力を備えたいかなるデバイスも駆動することが可能です。コンパレータ入力段は大きい入力オーバードライブに対して確実に保護され、その出力は入力信号がその有効範囲を超えても位相の反転を起こしません。独自の単一ピン制御オプションを利用する高速ラッチおよびプログラマブル・ヒステリシス機能も用意されています。

ADCMP604は6ピンのSC70パッケージ、ADCMP605は12ピンのLSCFPパッケージで提供されます。

アプリケーション

  • 高速計測機器
  • クロックおよびデータ信号の復帰
  • ロジックのレベル・シフトおよび変換
  • パルス分光
  • 高速ライン・レシーバ
  • スレッショールド検出
  • ピークおよびゼロクロス検出器
  • 高速トリガ回路
  • パルス幅変調
  • 電流/電圧制御発振器
  • 自動試験装置(ATE)
  • ADCMP604
    コンパレータ、超高速、6ピンSC70パッケージ、レールtoレール、2.5~5.5V、単電源、LVDS出力
    ADCMP604/ADCMP605 Functional Block Diagram ADCMP604 Pin Configuration
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