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  4. 高速コンパレータ(伝播遅延100ns未満)
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製品概要

機能と利点

  • 3.3 V/5.2 Vの単電源動作
  • 伝搬遅延: 150 ps
  • オーバードライブとスルーレート・バラツキ: 15 ps
  • 等価入力立上がり時間帯域幅: 8 GHz
  • 最小パルス幅: 80 ps
  • 立上がり/立下がり時間: 35 ps (Typ)
  • ディタミ二スティク・ジッタ(DJ): 10 ps
  • ランダム・ジッタ(RJ): 200 fs
  • 両入力ピンに終端を内蔵
  • 出力位相反転がない強固な入力
  • 抵抗設定可能なヒステリシス
  • 差動ラッチ制御
  • 拡張工業用温度範囲: -40°C~+125°C

製品概要

ADCMP572とADCMP573は、アナログ・デバイセズ独自のXFCB3シリコン・ゲルマニウム(SiGe)バイポーラ・プロセスで製造された超高速コンパレータです。ADCMP572はCML出力ドライバとラッチ入力を、ADCMP573は縮小振幅PECL (RSPECL)出力ドライバとラッチ入力を、それぞれ内蔵しています。

両デバイスは、200 fs rmsのランダム・ジッタ(RJ)を持つ10 Gbpsの動作に対して、150 psの伝搬遅延と80 psの最小パルス幅を提供します。オーバードライブとスルーレートのバラツキは、15 ps (typ)以下です。

両デバイスは柔軟な電源方式を採用しているため、3.3 Vの正単電源動作、−0.2 V~+1.2 Vの入力信号範囲またはこの範囲を広げて−0.2 V~+3.2 Vの入力信号範囲にする入力/出力分割電源、独立な出力レベル範囲が可能です。両入力は50 Ω終端抵抗を内蔵し、高インピーダンス入力を必要とするアプリケーションに対して各ピンを個別にオープンのままにするオプション機能も持っています。

CML出力ステージは、3.3 V~5.2 Vへ終端された50 Ω伝送線を直接400 mV駆動するようにデザインされています。RSPECL出力ステージは、VCCO − 2 Vへ終端された50 Ω伝送線を400 mV駆動するようにデザインされており、一般的な複数のPECLロジック・ファミリーと互換性を持っています。コンパレータ入力ステージでは、大きな入力オーバードライブに対して強力な保護機能を提供し、有効な入力信号レンジを超えても出力は位相反転しません。高速ラッチとプログラマブルなヒステリシス機能も内蔵しています。

ADCMP572とADCMP573は16ピンLFCSPパッケージを採用し、−40°C~+125°Cの拡張工業用温度範囲でキャラクタライズされています。

製品ライフサイクル icon-recommended 製造中

この製品ファミリーの1つ以上の型番が生産/供給中です。新規の設計に適していますが、より新しい代替製品を提供している場合があります。

評価キット (1)

設計リソース

アナログ・デバイセズでは、最高レベルの品質と信頼性を備えた製品を提供することに最大の力を常に注いでいます。これを実現するため、製品およびプロセスの設計のあらゆる観点で品質と信頼性のチェックを行っています。そして、それは、製造工程においても同様です。アナログ・デバイセズは常に、出荷製品の「ゼロ・ディフェクト」を目指しています。詳細についてはアナログ・デバイセズの品質および信頼性プログラム/認定証をご覧ください。

製品番号 材料宣誓書(MD) 信頼性データ ピン/パッケージ図 CADシンボル、フットプリント & 3Dモデル
ADCMP572BCPZ-R2 材料宣誓書(MD) 信頼性データ 16-Lead LFCSP (3mm x 3mm w/ EP)
ADCMP572BCPZ-RL7 材料宣誓書(MD) 信頼性データ 16-Lead LFCSP (3mm x 3mm w/ EP)
ADCMP572BCPZ-WP 材料宣誓書(MD) 信頼性データ 16-Lead LFCSP (3mm x 3mm w/ EP)
ウェハ・ファブリケーション・データ

PCN-PDN情報

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サンプル&購入


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リードタイム


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評価用ボード

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