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AD6634: WCDMA受信信号プロセッサ(RSP)、80MSPS、デュアル・チャンネル (Rev. 0)8/28/2008PDF1221 kB
製品概要
機能と利点
- 80MSPSの高帯域入力(14のリニア・ビットと3つのRSSI)
- 1つのパッケージに2つのW-CDMAデジタル・レシーバ
- 16ビットのパラレル出力
- RAKEレシーバ用のデジタルAGC出力ビット
- 非整数値デシメーション・レート用のデジタル・リサンプリング
- プログラマブル・デシメーションFIRフィルタ
- マルチキャリアとフェーズド・アレイのための柔軟な制御
- クリップ防止およびレベル・インジケータによる外部ゲイン・レンジングのためのプログラマブル減衰器制御
- 3.3VのI/O、2.5VのCMOSコア
- ユーザー設定可能な内蔵セルフテスト(BIST)機能
- JTAGバウンダリ・スキャン
- 156ピンBGAパッケージ
製品概要
AD6634は、周波数変換器、2つの固定係数デシメーション・フィルタ、およびプログラマブル係数デシメーション・フィルタの4つの信号処理エレメントをカスケード接続しています。2チャンネル(デュアル)のデジタル受信信号プロセッサ(RSP)で、16ビットのパラレル出力ポートにより、WB-CDMAアプリケーションなどの高データレートの出力に対応する手段を提供できます。AD6634は、アナログ・デバイセズのマルチキャリア・トランシーバのチップセットSoftCell™の1つであり、アナログ・デバイセズの高サンプリング・レートのIFサンプリングADCファミリー(AD6640 / AD6644の12ビットと14ビット)との互換性を保つように設計しています。SoftCell™のデジタル・レシーバには、チューニングとチャンネル選択のために、キャリアの全スペクトルをデジタル化する機能と対象キャリアをデジタル式に選択する機能があります。このアーキテクチャにより、ワイヤレス基地局のアプリケーションで余分な無線がなくなります。
高ダイナミックレンジのデシメーション・フィルタにより、広範囲のデシメーション・レートを実現します。RAMベースのアーキテクチャにより、マルチモードのアプリケーションの再構成が容易になります。
製品カテゴリ
製品ライフサイクル
新規設計には非推奨
新規設計にはお勧めしていません。
参考資料
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AN-835: 高速A/Dコンバータ(ADC)のテストと評価について (Rev. 0)12/11/2006PDF1039 kB
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AN-851: A WiMax Double Downconversion IF Sampling Receiver Design (Rev. 0)7/26/2006PDF262 kB
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高速A/Dコンバータ(ADC)のテストと評価について (Rev. AN-835)1/1/2000PDF
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Smart Partitioning Eyes 3G Basestation10/18/2002
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デジタル無線レシーバー設計の基礎(無線入門)3/6/1998
ツールおよびシミュレーション
BSDL Model Files
設計リソース
アナログ・デバイセズでは、最高レベルの品質と信頼性を備えた製品を提供することに最大の力を常に注いでいます。これを実現するため、製品およびプロセスの設計のあらゆる観点で品質と信頼性のチェックを行っています。そして、それは、製造工程においても同様です。アナログ・デバイセズは常に、出荷製品の「ゼロ・ディフェクト」を目指しています。詳細についてはアナログ・デバイセズの品質および信頼性プログラム/認定証をご覧ください。
製品番号 | 材料宣誓書(MD) | 信頼性データ | ピン/パッケージ図 | CADシンボル、フットプリント & 3Dモデル |
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AD6634BBC | 材料宣誓書(MD) | 信頼性データ | 196-Ball CSPBGA (15mm x 15mm x 1.7mm) | |
AD6634BBCZ | 材料宣誓書(MD) | 信頼性データ | 196-Ball CSPBGA (15mm x 15mm x 1.7mm) | |
ウェハ・ファブリケーション・データ |
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