AD4880

発売前

Dual Channel 20-Bit, 40 MSPS, SAR ADC with Analog Front End

利用上の注意

本データシートの英語以外の言語への翻訳はユーザの便宜のために提供されるものであり、リビジョンが古い場合があります。最新の内容については、必ず最新の英語版をご参照ください。

なお、日本語版のデータシートは基本的に「Rev.0」(リビジョン0)で作成されています。そのため、英語版が後に改訂され、複数製品のデータシートがひとつに統一された場合、同じ「Rev.0」の日本語版のデータシートが異なる製品のデータシートとして表示されることがあります。たとえば、「ADM3307E」の場合、日本語データシートをクリックすると「ADM3311E」が表示されます。これは、英語版のデータシートが複数の製品で共有できるように1本化され、「ADM3307E/ADM3310E/ADM3311E/ADM3312E/ADM3315E」(Rev.J)と改訂されたからで、決して誤ってリンクが張られているわけではありません。和文化されたデータシートを少しでも有効に活用していただくためにこのような方法をとっておりますので、ご了解ください。

アナログ・デバイセズ社は、提供する情報が正確で信頼できるものであることを期していますが、その情報の利用に関して、あるいはその利用によって生じる第三者の特許やその他の権利の侵害に関して一切の責任を負いません。また、アナログ・デバイセズ社の特許または特許の権利の使用を明示的または暗示的に許諾するものでもありません。仕様は予告なしに変更する場合があります。本紙記載の商標および登録商標は、各社の所有に属します。

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製品情報

  • Integrated fully differential ADC drivers
    • Wide input common-mode voltage range
    • High common-mode rejection
    • Single-ended to differential conversion
  • Gain options include: 1.03, 1.25, 1.53, 2.03, 2.74, 4.11, and 5.77
    • Integrated gain-setting resistors
  • High performance
    • 20-bit resolution, no missing codes
    • Throughput: 40 MSPS per channel
    • Conversion latency: 46.25 ns
    • INL: ±5 ppm (typical), ±10 ppm (maximum)
    • SNR/THD
      • 92.6 dB (typical)/−110 dB (typical) at fIN = 1 kHz
      • TBD dB (typical)/−TBD dB (typical) at fIN = 500 kHz
    • Noise spectral density: −167.6 dBFS/Hz
  • Low power
    • 105 mW per channel typical at 40 MSPS
  • Integrated, low-drift reference buffers and decoupling
  • Integrated VCM generation
  • Digital features and data interface
    • Conversion result FIFO, 16K samples per channel
    • Digital averaging filter with up to 210 decimation
  • SPI configuration per channel
  • Configurable data interface per channel
    • Single lane, DDR, serial LVDS, 800 MBPS per lane
    • Dual lane, DDR, serial LVDS, 400 MBPS per lane
    • Single/quad lane SPI data interface
  • Package
    • 196-ball, 10 mm x 10 mm CSP_BGA, 0.65 mm pitch
    • Integrated supply decoupling capacitors
  • Operating temperature range: −40°C to +85°C

The AD4880 is a dual-channel, low noise, high speed, low distortion, 20-bit, successive approximation register (SAR) analog-to-digital converter (ADC) with integrated fully differential drivers (FDA) and gain setting resistors. Maintaining high performance (signal-to-noise and distortion (SINAD) ratio > TBD dB) at signal frequencies up to TBD kHz allows the AD4880 to service a wide variety of precision, wide bandwidth data acquisition applications.

The integration of the ADC drivers, low drift reference buffers, low dropout (LDO) regulators along with all critical decoupling capacitors greatly alleviate analog front-end design challenges. Specified performance is easier to achieve, requiring a simpler and overall smaller printed circuit board (PCB) layout.

The internal nodes of the FDA stage are accessible, which allows setting its frequency response in a flexible way, enabling filter configurations up to 3rd order by the use of external passive components without the need for an additional amplifier. The requirements for the input anti-alias filtering can be relaxed by oversampling in combination with usage of the integrated digital filters and decimation to reduce noise and lower the output data rate, for applications that do not require the lowest latency of the AD4880.

High throughput and low-latency applications can benefit from the two independent, multilane low voltage differential signaling (LVDS) interfaces. Alternatively, the load on the digital host can be eased by storing the captured data in the on-chip, 16K samples per channel first in, first out (FIFO) memory, then asynchronously accessing it via the data interfaces.

APPLICATIONS

  • Digital imaging
  • Cell analysis
  • Spectroscopy
  • High speed data acquisition
  • Digital control loops, hardware in the loop
  • Power quality analysis
  • Source measurement units
  • Nondestructive test

AD4880
Dual Channel 20-Bit, 40 MSPS, SAR ADC with Analog Front End
AD4880 Chip Illustration
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