AD4083

新規設計に推奨

16-Bit, 40MSPS, Low Noise, Low Power SAR ADC

利用上の注意

本データシートの英語以外の言語への翻訳はユーザの便宜のために提供されるものであり、リビジョンが古い場合があります。最新の内容については、必ず最新の英語版をご参照ください。

なお、日本語版のデータシートは基本的に「Rev.0」(リビジョン0)で作成されています。そのため、英語版が後に改訂され、複数製品のデータシートがひとつに統一された場合、同じ「Rev.0」の日本語版のデータシートが異なる製品のデータシートとして表示されることがあります。たとえば、「ADM3307E」の場合、日本語データシートをクリックすると「ADM3311E」が表示されます。これは、英語版のデータシートが複数の製品で共有できるように1本化され、「ADM3307E/ADM3310E/ADM3311E/ADM3312E/ADM3315E」(Rev.J)と改訂されたからで、決して誤ってリンクが張られているわけではありません。和文化されたデータシートを少しでも有効に活用していただくためにこのような方法をとっておりますので、ご了解ください。

アナログ・デバイセズ社は、提供する情報が正確で信頼できるものであることを期していますが、その情報の利用に関して、あるいはその利用によって生じる第三者の特許やその他の権利の侵害に関して一切の責任を負いません。また、アナログ・デバイセズ社の特許または特許の権利の使用を明示的または暗示的に許諾するものでもありません。仕様は予告なしに変更する場合があります。本紙記載の商標および登録商標は、各社の所有に属します。

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製品情報

  • 16-bit resolution, no missing codes
  • Throughput: 40MSPS, 48.43ns conversion latency
  • Noise spectral density: 10.69nV/√Hz,165.9dBFS/Hz
  • Low 1/f, low frequency noise (0.1Hz to 10Hz): 265nV rms
  • Low Power:70.2mW typical at 40MSPS
  • INL: ±8ppm (typ), ±12ppm (max)
  • Dynamic range: 92.94dBFS
  • SNR/THD
    • 92.2dB (typ)/−111dB (typ) at fIN = 1kHz
    • 92dB (typ)/−103.4dB (typ) at fIN = 1MHz
  • Easy Drive
    • 6V p-p differential input range
    • Continuous signal acquisition
    • Linearized, 5μA/MSPS input current
  • Integrated, low-drift reference buffer and decoupling
  • Integrated VCM generation
  • Digital features and data interface
    • Conversion result FIFO, 16K sample depth
    • Digital averaging filter with up to 210 decimation
  • SPI configuration
  • Configurable data interface
    • Single lane, DDR, serial LVDS, 640Mbps per lane
    • Dual lane, DDR, serial LVDS, 320Mbps per lane
    • Single/quad lane SPI data interface
  • Package
    • 49-ball, 5mm × 5mm CSP_BGA, 0.65mm pitch
    • Integrated supply decoupling capacitors
  • Operating temperature range: −40°C to +85°C

The AD4083 is a high speed, low noise, low distortion, 16-bit, Easy Drive, successive approximation register (SAR) analog-to-digital converter (ADC). Maintaining high performance (signal-to-noise and distortion (SINAD) ratio > 90dBFS) at signal frequencies in excess of 1MHz enables the AD4083 to service a wide variety of precision, wide bandwidth data acquisition applications. Simplification of the input anti-alias filter design can be accomplished by applying oversampling along with the integrated digital filtering and decimation to reduce noise and lower the output data rate for applications that do not require the lowest latency of the AD4083.

The AD4083 Easy Drive features reduce both signal chain complexity and power consumption while enabling greater channel density and flexibility in companion component selection. The product input structure was designed to minimize any input dependent signal currents, therefore reducing any converter induced settling artifacts. The continuous acquisition architecture allows settling across the entire conversion cycle, easing ADC driver settling and bandwidth requirements as compared to other high-speed data converters.

The AD4083 includes several elements that simplify data converter integration: a low drift reference buffer, low dropout (LDO) regulators to generate ADC core and digital interface supply rails, and a 16K result data first-in first out (FIFO) that can greatly reduce the load on the digital host. Additionally, critical supply and reference decoupling capacitors are integrated in the package to ensure optimum performance, simplify printed circuit board (PCB) layout, and reduce the overall solution footprint.

APPLICATIONS

  • Digital imaging
  • Cell analysis
  • Spectroscopy
  • Automated test equipment
  • High speed data acquisition
  • Digital control loops, hardware in the loop
  • Power quality analysis
  • Source measurement units
  • Electron and X-ray microscopy
  • Radar level measurement
  • Nondestructive test

AD4083
16-Bit, 40MSPS, Low Noise, Low Power SAR ADC
AD4083 Functional Block Diagram AD4083 Pin Configuration AD4083 Chip Illustration
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