概览
优势和特点
- 完全集成的VCO/PLL内核
- 均方根抖动：0.39 ps（12 kHz至20 MHz，156.25 MHz）
- 均方根抖动：0.15 ps（1.875 MHz至20 MHz，156.25 MHz）
- 均方根抖动：0.40 ps（12 kHz至20 MHz，106.25 MHz）
- 均方根抖动：0.15 ps（637 kHz至10 MHz，106.25 MHz）
- 输入晶振频率：19.44 MHz、25 MHz或25.78125 MHz
- 针对33.33 MHz、62.5 MHz、
100 MHz, 106.25 MHz, 125 MHz, 155.52 MHz, 156.25 MHz,
159.375 MHz, 161.13 MHz, 和312.5 MHz输出，提供引脚可选的分频比 - LVDS/LVPECL/LVCMOS输出格式
- 集成环路滤波器
- 4.4 mm × 5.0 mm TSSOP封装，节省空间
- 欲了解更多特性，请参考数据手册
产品详情
AD9575是一款高度集成的双路输出时钟发生器，包括一个针对网络定时而优化的片内PLL内核。整数N分频PLL设计基于ADI公司成熟的高性能、低抖动频率合成器系列，可实现线路卡的较高性能。对相位噪声和抖动要求苛刻的其它应用也能受益于该器件。PLL部分由低噪声鉴频鉴相器(PFD)、精密电荷泵、低相位噪声压控振荡器(VCO)和引脚可选的反馈与输出分频器组成。通过连接一个外部晶振，可以将常用的网络输出频率锁定至输入参考。输出分频比和反馈分频比可针对所要求的输出速率，通过引脚进行编程。无需外部环路滤波器，从而节省宝贵的设计时间和电路板空间。
AD9575提供16引脚、4.4 mm × 5.0 mm TSSOP封装，可以采用3.3 V单电源供电。温度范围为−40°C至+85°C。
应用
- GbE/FC/SONET 线路卡、交换机和路由器
- CPU/PCI-E 应用
- 低抖动、低相位噪声时钟产生
产品生命周期
推荐新设计使用
本产品已上市。数据手册包含所有最终性能规格和工作条件。ADI公司推荐新设计使用这些产品。
评估套件 (1)
参考资料
-
FAQs3/10/2020
设计资源
ADI始终把满足您可靠性水平的产品放在首要位置。我们通过在所有产品、工艺设计和制造过程中引入高质量和可靠性检查实践这一承诺。发运的产品实现“零缺陷”始终是我们的目标。
| Part Number | Material Declaration | Reliability Data | Pin/Package Drawing | CAD Symbols, Footprints & 3D Models |
|---|---|---|---|---|
| AD9575ARUZLVD | 材料声明 | 质量和可靠性 | 16-Lead TSSOP | |
| AD9575ARUZPEC | 材料声明 | 质量和可靠性 | 16-Lead TSSOP | |
| Wafer Fabrication Data |
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